[发明专利]具有高操作确定性的片上系统有效
| 申请号: | 201580054653.0 | 申请日: | 2015-10-07 |
| 公开(公告)号: | CN106796575B | 公开(公告)日: | 2018-06-26 |
| 发明(设计)人: | 瑟琳·刘;尼古拉斯·查理;尼古拉斯·马蒂 | 申请(专利权)人: | 赛峰电子与防务公司 |
| 主分类号: | G06F15/173 | 分类号: | G06F15/173 |
| 代理公司: | 北京派特恩知识产权代理有限公司 11270 | 代理人: | 姚开丽;杨雅 |
| 地址: | 法国布洛*** | 国省代码: | 法国;FR |
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| 摘要: | |||
| 搜索关键词: | 主处理模块 主模块 外围设备 内部存储器 从属模块 片上系统 时钟源 电源 直接存储器访问控制器 邻近 高速缓冲存储器 辅助处理模块 外部存储器 处理模块 共享 确定性 配置 访问 | ||
1.一种片上系统SoC(100),包括一组主模块和从属模块,
所述主模块来自:
-对所述片上系统的所有组件具有优先访问权限的主处理模块(101a)和与所述主处理模块(101a)相连的直接存储器访问DMA控制器(102a);
-至少一个辅助处理模块(101b)和与每个辅助处理模块(101b)相连的直接存储器访问DMA控制器(102b);
每个主模块被配置为连接到时钟源、电源和从属模块,所述从属模块来自:
-通过专用通信链路连接到所述主模块处的一组外围设备,也称为“邻近外围设备”(105a,105b),
-至少一个内部存储器(104a,104b),
-由所述主模块共享的一组外围设备和外部存储器(106),
其特征在于:
主处理模块及该主处理模块的直接存储器访问DMA控制器的所述时钟源、所述电源、所述邻近外围设备(105a,105b)和高速缓冲存储器(103a,103b)专用于所述主处理模块且不与所述一组主模块中的其他处理模块共享,
每个主处理模块及该主处理模块的直接存储器访问DMA控制器的所述至少一个内部存储器(104a,104b)专用于所述主处理模块,所述主处理模块(101a)始终能够访问该至少一个内部存储器。
2.根据前一权利要求所述的系统,其中,所述主处理模块通过至少一个通信总线连接到所述辅助处理模块的内部存储器。
3.根据前述权利要求中任一项所述的系统,包括至少两级互连:
-将每个主模块连接到该主模块的内部存储器(104a,104b)处的第一级互连,
-将所述主模块连接到所述一组共享的外围设备和外部存储器(106)处的从属模块的第二级互连,所述从属模块根据所述从属模块的功能、所述从属模块的优先级和/或所述从属模块的带宽要求而分布在多个互连之间,所述从属模块彼此不直接通信,
互连由经由一级或多级接线器连接到多个从属端口的多个主端口组成。
4.根据权利要求3所述的系统,其中,所述第二级互连以及所述一组共享的外围设备和外部存储器连接到与所述主模块的时钟源和电源隔离开的时钟源和电源。
5.根据权利要求3所述的系统,包括能够通过所述第二级互连的互连连接到所述共享外围设备处的外部主机(111)。
6.根据权利要求1所述的系统,其中,主模块的所述邻近外围设备(105a,105b)和所述内部存储器(104a,104b)连接到该主模块的所述电源和时钟源。
7.根据权利要求1所述的系统,其中,主模块的所述邻近外围设备(105a,105b)与该主模块的通信接口连接到该主模块的时钟源。
8.根据权利要求1所述的系统,其中,主模块的所述邻近外围设备(105a,105b)和所述内部存储器(104a,104b)连接到专用的电源和时钟源。
9.根据权利要求1所述的系统,其中,主模块的所述邻近外围设备(105a,105b)选自:复位控制器、看门狗、中断控制器、实时控制器、专用于航空航天应用的外围设备或直接存储器访问控制器。
10.根据权利要求1所述的系统,其中,辅助处理模块的邻近外围设备(105b)选自:实时控制器、看门狗、直接存储器访问DMA控制器或中断控制器。
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