[实用新型]一种下课时间提醒电路有效
申请号: | 201520760418.2 | 申请日: | 2015-09-29 |
公开(公告)号: | CN205049867U | 公开(公告)日: | 2016-02-24 |
发明(设计)人: | 樊军 | 申请(专利权)人: | 昆明理工大学 |
主分类号: | G04G13/02 | 分类号: | G04G13/02 |
代理公司: | 暂无信息 | 代理人: | 暂无信息 |
地址: | 650093 云*** | 国省代码: | 云南;53 |
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摘要: | |||
搜索关键词: | 一种 下课 时间 提醒 电路 | ||
1.一种下课时间提醒电路,其特征在于:包括电池(1)、定值电阻Ⅰ(2)、按钮开关(3)、定值电阻Ⅱ(4)、双时基集成电路(5)、定值电阻Ⅲ(6)、定值电阻Ⅳ(7)、定值电容Ⅰ(8)、定值电容Ⅱ(9)、扬声器(10)、定值电容Ⅲ(11)、可调电阻(12);其中电池(1)的负极接地,正极分别接定值电阻Ⅰ(2)的一端、双时基集成电路(5)的4脚、14脚和定值电阻Ⅲ(6)的一端,电阻Ⅰ(2)的另一端分别接双时基集成电路(5)的2脚、6脚、定值电容Ⅲ(11)的一端、可调电阻(12)的一端和中间端,定值电阻Ⅱ(4)接在双时基集成电路(5)的5脚、11脚之间,按钮开关(3)接在电阻Ⅰ(2)与定值电容Ⅲ(11)之间,定值电容Ⅲ(11)的另一端接地,可调电阻(12)的另一端接地,双时基集成电路(5)的7脚接地,定值电阻Ⅲ(6)的另一端接双时基集成电路(5)的13脚和定值电阻Ⅳ(7)的一端,定值电阻Ⅳ(7)的另一端分别接双时基集成电路(5)的8脚、12脚和定值电容Ⅰ(8)的一端,定值电容Ⅰ(8)的另一端接地,双时基集成电路(5)的9脚接定值电容Ⅱ(9)的一端,定值电容Ⅱ(9)的另一端接扬声器(10)的一端,扬声器(10)的另一端接地。
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