[实用新型]生成噪声校正的像素值的电子设备、减小噪声信号的电子设备和成像系统有效
申请号: | 201520249075.3 | 申请日: | 2015-04-23 |
公开(公告)号: | CN204906538U | 公开(公告)日: | 2015-12-23 |
发明(设计)人: | R·潘尼卡西;J·贝克;B·范霍夫 | 申请(专利权)人: | 半导体元件工业有限责任公司 |
主分类号: | H04N5/357 | 分类号: | H04N5/357 |
代理公司: | 中国国际贸易促进委员会专利商标事务所 11038 | 代理人: | 秦晨 |
地址: | 美国亚*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 生成 噪声 校正 像素 电子设备 减小 信号 成像 系统 | ||
1.一种用于生成噪声校正的像素值的电子设备,其特征在于包括:
图像传感器像素阵列,其中所述图像传感器像素阵列包含第一像素分组以及与所述第一像素分组不同的的第二像素分组;和
读出电路,其中所述读出电路包括:
从所述第一像素分组中获得第一像素值集的子电路;
从所述第二像素分组中获得第二像素值集的子电路;
基于所述第二像素值集来生成抖动的校正值的子电路;以及
从所述第一像素值集中减去所述抖动的校正值以生成噪声校正的像素值的子电路,其中在所述第二像素值集中的每个像素值都具有第一位宽度,并且其中基于所述第二像素值集而生成所述抖动的校正值的子电路包括:
对所述第二像素值集执行精度扩展操作以生成具有比所述第一位宽度大的第二位宽度的扩展精度像素值的子电路;
将所述扩展精度像素值乘以比例因子以生成缩放的扩展精度像素值的子电路;以及
使所述缩放的扩展精度像素值的至少一个位随机化以生成所述抖动的校正值的子电路,并且其中通过:生成伪随机数;以及将所述伪随机数的至少一个最低有效位加上所述缩放的扩展精度像素值来生成所述抖动的校正值。
2.一种用于减小噪声信号的电子设备,其特征在于包括成像系统,所述成像系统包括:
像素值校正电路;
多个图像像素;及
至少一个参考像素,其中所述像素值校正电路包括:
从所述多个图像像素中获得第一像素值并且从所述至少一个参考像素中获得第二像素值的子电路;
生成二进制位随机序列的子电路;
将所述二进制位随机序列的至少一个位加上所述第二像素值以生成像素校正值的子电路;以及
从所述第一像素值中减去所述像素校正值的子电路,其中获得所述第二像素值的子电路包括:
接收来自所述至少一个参考像素的多个数字暗像素值的子电路,其中所述多个数字暗像素值的每个数字暗像素值都具有第一位宽度;
对所述多个数字暗像素值求和以生成具有比所述第一位宽度大的第二位宽度的扩展精度暗像素值的子电路;以及
将所述扩展精度暗像素值乘以比例因子以生成所述第二像素值的子电路,其中将所述二进制位随机序列的所述至少一个位加上所述第二像素值以生成所述像素校正值的子电路包括:
将所述二进制位随机序列的至少一个最低有效位加上所述第二像素值以生成所述像素校正值的子电路。
3.根据权利要求2所述的电子设备,其中所述像素值校正电路还包括:
从所述多个图像像素中获得第三像素值的子电路;
生成与所述二进制位随机序列不同的附加的二进制位随机序列的子电路;
将所述附加的二进制位随机序列的至少一个位加上所述第二像素值以生成附加的像素校正值的子电路;以及
从所述第三像素值中减去所述附加的像素校正值的子电路。
4.一种成像系统,其特征在于包含:
中央处理单元;
存储器;
输入-输出电路;以及
成像设备,其中所述成像设备包含:
图像像素阵列,具有配置为生成第一像素值的第一像素分组以及配置为生成第二像素值的与所述第一像素分组不同的第二像素分组,其中在所述第二像素值中的每个像素值都具有第一位宽度;
用于将光聚焦到所述阵列上的透镜;
配置为基于所述第二像素值来生成随机化的校正值的校正值抖动电路,其中所述校正值抖动电路包括:
对所述第二像素值集执行精度扩展操作以生成具有比所述第一位宽度大的第二位宽度的扩展精度像素值的子电路;
将所述扩展精度像素值乘以比例因子以生成缩放的扩展精度像素值的子电路;以及
使所述缩放的扩展精度像素值的至少一个位随机化以生成所述随机化的校正值的子电路,并且其中通过:生成伪随机数;以及将所述伪随机数的至少一个最低有效位加上所述缩放的扩展精度像素值来生成所述随机化的校正值;以及
配置为通过从所述第一像素值中减去所述随机化的校正值来生成噪声校正的像素数据的减法电路。
5.根据权利要求4所述的系统,还包含:
配置为生成随机数的随机数生成电路,其中所述校正值抖动电路还被配置为将所生成的随机数的至少一个最低有效位加上所述第二像素值以生成所述随机化的校正值。
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