[实用新型]同时对多个图形发生器进行程序自动升级的设备有效
申请号: | 201520172343.6 | 申请日: | 2015-03-25 |
公开(公告)号: | CN204496483U | 公开(公告)日: | 2015-07-22 |
发明(设计)人: | 彭骞;李昂;刘荣华;雷新军;严运思;帅敏;陈凯;沈亚非 | 申请(专利权)人: | 武汉精测电子技术股份有限公司 |
主分类号: | G06F9/445 | 分类号: | G06F9/445 |
代理公司: | 武汉开元知识产权代理有限公司 42104 | 代理人: | 黄行军;李满 |
地址: | 430070 湖北省武汉*** | 国省代码: | 湖北;42 |
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摘要: | |||
搜索关键词: | 同时 图形 发生器 进行 程序 自动 升级 设备 | ||
技术领域
本实用新型涉及图形信号发生器内部程序加载领域,具体地指一种同时对多个图形发生器进行程序自动升级的设备。
背景技术
在显示面板的自动化生产流水线上,需大批量的图形信号发生器同时对显示面板进行检测,以满足产线生产效率的要求,当图形发生器内的ARM(Advanced RISC Machines)、FPGA(现场可编程门阵列,Field-Programmable Gate Arrays)和电源等程序需要升级时,需要对图形发生器内的这些程序进行加载。
目前,显示面板产线上的图形发生器的程序升级均采用一对一的方式,即一台图形发生器升级后再对下一个台图形发生器进行升级,不能同时对多台图形发生器内的程序进行升级,现有方法存在以下几个方面的弊端:
1)显示面板产线上的图形发生器的数量庞大,采用一对一的程序加载方式需耗费大量时间;
2)当需升级多个程序时,需人为的选择待升级程序,操作程序繁杂,自动化程度低。
实用新型内容
本实用新型的目的就是要提供一种同时对多个图形发生器进行程序自动升级的设备,该设备能解决当前显示面板产线上大批量图形发生器内部程序的自动升级的问题,从而提高产线的自动化能力和测试效率。
为实现此目的,本实用新型所设计的同时对多个图形发生器进行程序自动升级的设备,它包括文件传输协议(FTP,File Transfer Protocol)服务器、位于第一固定工位上的第一上位机,位于第二固定工位上的第二上位机、位于栈板组上的多个图形发生器测试组,其中,每个图形发生器测试组均包括第一图形发生器和第二图形发生器,每个第一图形发生器和第二图形发生器分别设置在栈板组对应的栈板上,所述文件传输协议服务器的第一通信端连接第一上位机的第一通信端,文件传输协议服务器的第二通信端连接第二上位机的第一通信端,所述第一上位机的第二通信端能与对应的第一图形发生器的测试控制端连接,所述第二上位机的第二通信端能与对应的第二图形发生器的测试控制端连接。
本实用新型的有益效果为:
本实用新型通过设置上述文件传输协议服务器、多个上位机和多个图形发生器,实现了多个上位机在一个文件传输协议服务器的控制下对多个图形发生器进行程序升级,并且升级完成后自动进行下一组的多个图形发生器的升级,这样极大的提高了批量图形发生器升级的效率,节省大量人力资源。另外,本实用新型还能一次对图形发生器内的多个待升级程序进行升级,进一步的提高了图形发生器的升级效率。
附图说明
图1为实现本实用新型的结构框图。
其中,1—图形发生器测试组、1.1—第一图形发生器、1.2—第二图形发生器、1.3—第一FPGA信号处理模块、1.4—第一ARM核心模块、1.5—第二FPGA信号处理模块、1.6—第二ARM核心模块、2—第一固定工位、2.1—第二固定工位、3—第一上位机、3.1—第二上位机、4—文件传输协议服务器、5—栈板组、5.1—控制器。
具体实施方式
以下结合附图和具体实施例对本实用新型作进一步的详细说明:
一种同时对多个图形发生器进行程序自动升级的设备,如图1所示,它包括文件传输协议服务器4、位于第一固定工位2上的第一上位机3,位于第二固定工位2.1上的第二上位机3.1、位于栈板组5(Pallet,一种在流水线上传送的装置)上的多个图形发生器测试组1,其中,每个图形发生器测试组1均包括第一图形发生器1.1和第二图形发生器1.2,每个第一图形发生器1.1和第二图形发生器1.2分别设置在栈板组5对应的栈板上,所述文件传输协议服务器4的第一通信端连接第一上位机3的第一通信端,文件传输协议服务器4的第二通信端连接第二上位机3.1的第一通信端,所述第一上位机3的第二通信端能与对应的第一图形发生器1.1的测试控制端连接,所述第二上位机3.1的第二通信端能与对应的第二图形发生器1.2的测试控制端连接。
上述技术方案中,所述第一图形发生器1.1包括第一ARM核心模块1.4和第一FPGA信号处理模块1.3,所述第一ARM核心模块1.4的第一通信端为第一图形发生器1.1的测试控制端,第一ARM核心模块1.4的第二通信端连接第一FPGA信号处理模块1.3的第一通信端,第一FPGA信号处理模块1.3的第二通信端为第一图形发生器1.1的测试通信端,该测试通信端用于连接对应的待测液晶模组6。
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