[发明专利]一种总线型驱动器端口及其控制方法有效
申请号: | 201510799783.9 | 申请日: | 2015-11-18 |
公开(公告)号: | CN105281999B | 公开(公告)日: | 2018-11-30 |
发明(设计)人: | 文长明;文可 | 申请(专利权)人: | 中工科安科技有限公司;文长明;文可 |
主分类号: | H04L12/28 | 分类号: | H04L12/28;H04L12/40;H04L12/935;H04L12/937 |
代理公司: | 合肥市泽信专利代理事务所(普通合伙) 34144 | 代理人: | 方荣肖 |
地址: | 230022 安徽省合*** | 国省代码: | 安徽;34 |
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摘要: | |||
搜索关键词: | 一种 线型 驱动器 端口 及其 控制 方法 | ||
1.一种总线型驱动器端口,其特征在于:其包括4~6个媒体经网络接口、4~6个网络变压器、4~6个物理接口收发器、4~6个介质独立接口、1个物理层控制器、1个数据链路层电路;所述数据链路层电路包括4~6个MAC模块、4~6个媒体访问本地内存、1个通道内存切换开关、1个媒体访问共享内存、1个控制寄存器、1个地址译码器、1个端口控制器;4~6个媒体经网络接口分别与4~6个网络变压器、4~6个物理接口收发器、4~6个介质独立接口一一对应,每个媒体经网络接口依次连接相应的网络变压器、相应的物理接口收发器、相应的介质独立接口再到相应的MAC模块;每一个MAC模块连接一个媒体访问本地内存;所述媒体访问共享内存通过所述通道内存切换开关选择性连接其中一个媒体访问本地内存;所述地址译码器的输入端连接所述控制寄存器和这些媒体访问本地内存,所述地址译码器的输出端连接所述媒体访问共享内存;所述控制寄存器与这些媒体访问本地内存、所述媒体访问共享内存均连接;所述端口控制器与每个MAC模块、所述通道内存切换开关、所述控制寄存器、所述地址译码器均连接;每个物理接口收发器连接所述物理层控制器的一端,所述物理层控制器的另一端连接这些媒体访问本地内存;
其中,媒体数据储存在媒体访问本地内存中,媒体访问本地内存的容量能够覆盖伺服电机的内置编码器内存;媒体访问本地内存通过通道内存切换开关与媒体访问共享内存交换数据;所述媒体访问共享内存划分出很多内存块,所述媒体访问共享内存在所述端口控制器的时钟控制下,与主站的运动控制核心通过AHB片内高速总线交换数据。
2.如权利要求1所述的总线型驱动器端口,其特征在于:所述驱动器端口通过所述媒体访问共享内存经AHB片内总线向上连接一个运动控制核心。
3.如权利要求2所述的总线型驱动器端口,其特征在于:所述驱动器端口还通过通用的现场总线、实时以太网或内部器件间总线向下连接一个伺服驱动器。
4.如权利要求1所述的总线型驱动器端口,其特征在于:所述媒体访问共享内存的内存空间被分割成与所述媒体访问本地内存数量相等的份数,并与所述媒体访问本地内存一一对应。
5.如权利要求4所述的总线型驱动器端口,其特征在于:媒体到达所述媒体访问本地内存以后,在所述端口控制器的控制下,经所述通道内存切换开关轮流切换,与所述媒体访问共享内存的对应的一份内存空间交换数据。
6.如权利要求5所述的总线型驱动器端口,其特征在于:交换数据的方式是共享内存;媒体访问的方向是双向的。
7.如权利要求1所述的总线型驱动器端口,其特征在于:所述总线型驱动器端口集成为一块芯片或组装设计为模块式电路。
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