[发明专利]一种制作阵列基板的方法及其阵列基板和显示装置有效
| 申请号: | 201510199009.4 | 申请日: | 2015-04-24 |
| 公开(公告)号: | CN104779202B | 公开(公告)日: | 2018-11-06 |
| 发明(设计)人: | 刘圣烈;崔承镇;宋泳锡 | 申请(专利权)人: | 京东方科技集团股份有限公司 |
| 主分类号: | H01L21/77 | 分类号: | H01L21/77;H01L27/12 |
| 代理公司: | 中国专利代理(香港)有限公司 72001 | 代理人: | 汪扬;景军平 |
| 地址: | 100015 *** | 国省代码: | 北京;11 |
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| 摘要: | |||
| 搜索关键词: | 一种 制作 阵列 方法 及其 显示装置 | ||
1.一种制作阵列基板的方法,包括:
形成作为源漏极和数据线的金属薄膜层的图形;
在所述金属薄膜层的图形上形成非晶半导体薄膜层;
退火,以便仅仅将源漏极和数据线上的所述非晶半导体薄膜层转换成金属半导体化合物。
2.根据权利要求1所述的方法,还包括:
在形成包括源漏极和数据线的图形之前,在衬底上形成栅极和栅线、覆盖在所述栅极和栅线上的栅绝缘层、以及覆盖在所述栅绝缘层上的对应于所述栅极区域的有源层。
3.根据权利要求2所述的方法,其中形成作为源漏极和数据线的金属薄膜层的图形的步骤包括:
形成金属薄膜层;
通过构图工艺,将源漏极和数据线之外位置的金属薄膜层去除。
4.根据权利要求3所述的方法,还包括:
将源漏极和数据线之外位置的非晶半导体薄膜层去除。
5.根据权利要求4所述的方法,还包括:
形成钝化层,并且在与漏极、栅线和数据线对应的位置刻蚀所述钝化层以形成对应的通孔。
6.根据权利要求5所述的方法,还包括:
在栅绝缘层上对应所述栅线位置,形成栅绝缘层过孔。
7.根据权利要求6所述的方法,还包括:
形成透明导电薄膜,通过构图工艺,在所述形成有通孔的钝化层上形成包括像素电极、栅线连接线以及数据线连接线的图形,其中所述漏极上的金属半导体化合物通过对应漏极的位置形成的通孔与所述像素电极电连接。
8.根据权利要求1-6中任一项所述的方法,其中所述金属薄膜层包括铜层或钛层。
9.根据权利要求1-6中任一项所述的方法,其中所述非晶半导体薄膜层包括α-硅、α-锗、α-砷化镓、α-硫化砷或α-硒层。
10.根据权利要求1-6中任一项所述的方法,其中所述金属半导体化合物包括铜的硅化物、铜的锗化物、铜与α-砷化镓的化合物、铜与α-硫化砷的化合物、铜与α-硒的化合物、钛的硅化物、钛的锗化物、钛与α-砷化镓的化合物、钛与α-硫化砷的化合物、钛与α-硒的化合物。
11.根据权利要求8所述的方法,其中所述金属薄膜层包括铜层。
12.根据权利要求9所述的方法,其中所述非晶半导体薄膜层包括α-硅层。
13.根据权利要求10所述的方法,其中所述金属半导体化合物包括铜的硅化物。
14.根据权利要求1-6中任一项所述的方法,其中所述非晶半导体薄膜层的厚度为10Å-50Å。
15.根据权利要求1-6中任一项所述的方法,其中所述退火温度在200℃-280℃之间。
16.根据权利要求1-6中任一项所述的方法,其中所述退火步骤是在氮气气氛下进行的。
17.根据权利要求2-6中任一项所述的方法,其中所述有源层为金属氧化物层。
18.根据权利要求17所述的方法,其中所述金属氧化物层包括InGaZnO、InSnZnO或ZnON半导体层。
19.使用根据权利要求1-18中任一项所述的制作阵列基板的方法制作的阵列基板。
20.一种显示装置,包括根据权利要求19所述的阵列基板。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造





