[发明专利]从同步信号映射有效
申请号: | 201510042329.9 | 申请日: | 2008-09-22 |
公开(公告)号: | CN104506295B | 公开(公告)日: | 2019-06-11 |
发明(设计)人: | E·N·翁哥萨努斯;A·G·达巴克 | 申请(专利权)人: | 英特尔公司 |
主分类号: | H04L5/00 | 分类号: | H04L5/00;H04L27/26;H04W56/00 |
代理公司: | 北京东方亿思知识产权代理有限责任公司 11258 | 代理人: | 宗晓斌 |
地址: | 美国加利*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 同步 信号 映射 | ||
1.一种用户设备(UE)的装置,包括:
处理电路,所述处理电路被配置为:
解码从演进型节点B(eNB)接收的主同步信号(PSS)以获得多个小区标识假设中针对所述eNB的小区的小区标识假设;
解码从同步信号(SSS)以从两个序列中获得物理层小区标识群,所述两个序列中的每个序列来自由索引对索引的一组N个序列;
基于所述小区标识假设和所述物理层小区标识群确定小区标识;并且
基于所述PSS和所述SSS执行与所述eNB的小区的时间和频率同步;以及
存储器,所述存储器耦合至所述处理电路并且被配置为存储所述小区标识。
2.根据权利要求1所述的装置,其中所述SSS是包括交织串联的两个长度为31的序列的62位序列。
3.根据权利要求2所述的装置,其中所述长度为31的序列中的每个序列包括所述两个序列,其中所述两个序列中的每个序列分别出现在所述两个长度为31的序列的不同的偶数位置或奇数位置处。
4.根据权利要求1所述的装置,其中所述索引对中的每个索引的范围是从0到N-1,其中N是0≤N≤30的整数。
5.根据权利要求1所述的装置,其中所述物理层小区标识群(PCIG)是0≤PCIG≤167的整数。
6.根据权利要求1所述的装置,其中所述两个序列表示相同M序列的两个不同循环移位。
7.根据权利要求1所述的装置,其中所述物理层小区标识群(PCIG)和所述索引对(ind0,ind1)按照如下映射进行映射:
8.根据权利要求1所述的装置,其中,所述PSS和所述SSS是在下行链路帧的时隙0和时隙10内被接收的,并且其中所述处理电路禁止在所述帧的其余时隙内解码PSS和SSS信令。
9.根据权利要求8所述的装置,其中,所述PSS在所述下行链路帧的时隙0和时隙10中在最后OFDM符号处具有固定的位置。
10.根据权利要求8所述的装置,其中,所述下行链路帧包括在所述帧中被标识为子帧0至9的位置的10个子帧,并且其中,所述处理电路将所述UE配置为仅在具有被标识为子帧0和5的预定位置的非空子帧中接收所述PSS。
11.根据权利要求10所述的装置,其中,所述子帧包括被标识为符号#0至#13的14个符号,并且所述PSS在子帧0和5中在符号#6处具有固定位置,并且所述SSS在子帧0和5中在符号#5处具有固定位置。
12.根据权利要求1所述的装置,还包括:
一个或多个天线;以及
收发器电路,所述收发器电路被耦合至所述处理电路和所述一个或多个天线并且被配置为接收所述PSS和所述SSS。
13.一种演进型节点B(eNB)的装置,所述装置包括:
处理电路,所述处理电路被配置为:
生成主同步信号(SSS)以包括多个小区标识假设中针对所述eNB的小区的小区标识假设;
使用两个序列生成从同步信号(PSS)以包括物理层小区标识群,所述两个序列中的每个序列来自由索引对索引的一组N个序列,其中所述索引对中的每个索引的范围为0至N-1;并且
解码用于传输至用户设备(UE)的一个或多个下行链路子帧,以在所述子帧的固定位置处包括所述PSS和所述SSS;以及
存储器,所述存储器耦合至所述处理器电路并且被配置为存储所述一组N个序列。
14.根据权利要求13所述的装置,其中所述SSS是包括交织串联的两个长度为31的序列的62位序列。
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