[发明专利]受益于气隙集成电容的过孔自对准和短路改善有效
申请号: | 201480083536.2 | 申请日: | 2014-12-22 |
公开(公告)号: | CN107004601B | 公开(公告)日: | 2021-05-14 |
发明(设计)人: | K·J·辛格;A·M·迈尔斯 | 申请(专利权)人: | 英特尔公司 |
主分类号: | H01L21/336 | 分类号: | H01L21/336;H01L29/78 |
代理公司: | 永新专利商标代理有限公司 72002 | 代理人: | 张伟;王英 |
地址: | 美国加*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 受益 集成 电容 对准 短路 改善 | ||
1.一种用于形成集成电路结构的方法,包括:
在金属线之间形成牺牲材料,所述金属线具有位于其上的硬掩模;
在所述牺牲材料上形成掩模,其中,所述掩模与所述金属线上的所述硬掩模横向上相邻并共面,所述掩模包括与所述金属线上的所述硬掩模不同的材料;以及
在形成所述掩模之后,去除所述牺牲材料以在所述金属线之间留下空隙。
2.根据权利要求1所述的方法,其中,所述掩模是具有孔隙率的电介质材料,所述孔隙率被选择为允许通过所述电介质材料进行质量输运。
3.根据权利要求2所述的方法,其中,去除所述牺牲材料包括通过所述掩模去除所述牺牲材料。
4.根据权利要求1或2所述的方法,其中,将所述牺牲材料平坦化到所述金属线。
5.一种用于形成集成电路结构的方法,包括:
在设置于电介质材料中的金属线上形成硬掩模并且去除所述电介质材料的一部分,其中,在所述金属线上形成所述硬掩模包括:在第一金属线上形成第一硬掩模材料以及在第二金属线上形成第二硬掩模材料,其中,所述第二硬掩模材料不同于所述第一硬掩模材料;
在所述金属线之间形成牺牲材料;
在所述牺牲材料上形成掩模;以及
在形成所述掩模之后,去除所述牺牲材料以在所述金属线之间留下空隙。
6.根据权利要求5所述的方法,其中,所述第一金属线和所述第二金属线是初始金属化层级,并且在去除所述牺牲材料之后,所述方法包括形成随后的金属化层级。
7.根据权利要求6所述的方法,其中,形成所述随后的金属化层级包括:在所述第一硬掩模材料和所述第二硬掩模材料之一中但不在另一个中形成开口、以及将所述随后的金属化层级耦合到所述初始金属化层级。
8.根据权利要求1或2所述的方法,其中,在去除所述牺牲材料之后,所述方法包括在所述掩模上形成电介质层。
9.一种包括一个或多个金属化层的集成电路结构,所述集成电路结构是通过权利要求1-8的方法中的任一种制造的。
10.一种用于形成集成电路结构的方法,包括:
在集成电路衬底上的电介质层中形成第一金属化层级,所述第一金属化层级包括多条金属线,所述多条金属线具有位于其上的硬掩模;
利用牺牲材料代替所述电介质层的一部分;
在所述牺牲材料上形成掩模,其中,所述掩模与所述多条金属线上的所述硬掩模横向上相邻并共面,所述掩模包括与所述多条金属线上的所述硬掩模不同的材料;
通过所述掩模去除所述牺牲材料;以及
将第二金属化层级耦合到所述第一金属化层级。
11.根据权利要求10所述的方法,其中,所述掩模是具有孔隙率的电介质材料,所述孔隙率被选择为允许通过所述电介质材料进行质量输运。
12.根据权利要求10所述的方法,其中,将所述牺牲材料平坦化到所述第一金属化层级。
13.一种用于形成集成电路结构的方法,包括:
在集成电路衬底上的电介质层中形成第一金属化层级,所述第一金属化层级包括多条金属线;
在所述多条金属线中的相邻金属线上形成硬掩模,其中,在所述多条金属线中的相邻金属线上形成所述硬掩模包括:在第一金属线上形成第一硬掩模材料以及在第二金属线上形成第二硬掩模材料,其中,所述第二硬掩模材料不同于所述第一硬掩模材料;
利用牺牲材料代替所述电介质层的一部分;
在所述牺牲材料上形成掩模;
通过所述掩模去除所述牺牲材料;以及
将第二金属化层级耦合到所述第一金属化层级。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造