[发明专利]用于与非易失性存储器通信的方法和系统有效

专利信息
申请号: 201480062303.4 申请日: 2014-11-13
公开(公告)号: CN105723317B 公开(公告)日: 2019-06-28
发明(设计)人: G.林;M.戴维森;M.巴洛卡斯;A.格塔 申请(专利权)人: 桑迪士克科技有限责任公司
主分类号: G06F3/06 分类号: G06F3/06
代理公司: 北京市柳沈律师事务所 11105 代理人: 万里晴
地址: 美国得*** 国省代码: 美国;US
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摘要:
搜索关键词: 用于 非易失性存储器 通信 方法 系统
【说明书】:

一种装置,包括存储器接口模块和与存储器接口模块通信的存储器控制器。存储器接口模块配置为与第一和第二存储器条进行通信。响应于从主机系统接收多个存储器命令,存储器控制器生成多个命令序列。多个命令序列的每个对应于多个存储器命令的一个。多个命令序列的一些包括第一部分和第二部分,并且第一部分和第二部分的每个是原子的。多个命令序列的每个与优先级相关联。基于相关联的优先级,多个命令序列的一个被选择。多个命令序列的一个的第一部分被发送到第一存储器条或第二存储器条的任一个。

技术领域

本申请一般涉及在存储器系统中管理数据。更具体地,本申请涉及存储器系统的操作以改善在与具有多个裸芯或条的可重复编程的非易失性半导体闪速存储器通信中的并行性。

背景技术

这里提供的背景技术描述是为了一般呈现本公开的上下文的目的。当前提名的发明人的工作,以及其它在提交时可能否则有资格作为现有技术的说明书的方面,在该背景技术部分中描述的程度上,既没有明示也没有暗示地承认作为针对本公开的现有技术。

复杂的操作系统(OS)为通用计算机以及如数码相机、扫描仪等的专用装置提供动力。OS的常常被吹捧的优点之一是其允许用户同时使用多个软件应用。经常地,这些软件应用访问经由硬件接口连接到装置的处理器的硬件组件。取决于系统架构,硬件组件可以共享公共硬件接口。硬件接口可以包含PCI总线、USB总线、ISA总线、ATAPI总线和/或允许经由硬件接口与处理器通信的多个硬件组件的任何专有接口。经由硬件接口访问硬件组件可以取决于访问的类型消耗有限的时间量。为了该讨论的目的,硬件组件包含闪速存储器、紧凑式闪速、打印机、扫描仪、硬盘驱动器、DVD、CD、USB存储棒等。为了访问的持续时间,其它软件应用有时被锁定在访问连接到硬件接口的其它硬件组件之外。如果另一个应用需要访问另一个硬件组件以进行时间严格的操作,这是不期望的。可能期望的是,共享在以有序的并且可配置的方式的若干应用程序之间的公共硬件接口。

另外,软件应用程序和硬件组件之间传送的数据的量取决于访问的类型。例如,硬件组件的状态检查可以仅消耗少量的时间。与此相反,传送包括若干兆字节的数据文件可以消耗更大量的时间。时间密集的访问可以通过向访问部署可用的硬件资源而被加快。可能期望的是,基于量化或者限制访问的类型的度量而将硬件资源分配到访问。如果这样的分配(和解除分配)以灵活的、透明的方式进行,一般地,稀少的和有限的硬件资源可以被明智地用于优化系统的操作。

发明内容

为了解决在多个条和/或多个裸芯存储器系统中的改善的存储器管理的需要,这里公开了用于实现在与闪速条通信中的并行性的方法和系统。

根据一个方面,公开了一种在闪速存储器系统中通信数据的方法。在一个实施例中,闪速存储器包括存储器控制器和闪速装置。闪速存储器系统接收包括用于在存储器控制器和第一闪速装置之间通信数据的第一集合的资源。基于第一模板,闪速存储器系统配置用于在存储器控制器和第一闪速装置之间通信数据的第一集合的资源。根据该方法,闪速存储器系统经由第一集合的资源引起在存储器控制器和第一闪速装置之间通信数据。响应于接收到包括用于在存储器控制器和第一闪速装置通信数据的第二集合的资源的第二模板,基于第二模板,闪速存储器系统配置用于在存储器控制器和第一闪速装置之间通信数据的第二集合的资源。最后,闪速存储器系统经由第二集合的资源引起在存储器控制器和第一闪速装置之间通信数据。

根据另一个方面,公开了一种用于与闪速装置通信的系统。该系统包括具有闪速接口模块的存储器控制器。存储器控制器适配为通信地耦接到主机系统。存储器控制器配置为接收模板。模板包括用于基于模板在存储器控制器和的闪速装置之间通信数据的第一集合的资源。存储器控制器适配为配置用于在存储器控制器和第一闪速装置之间通信数据的第一集合的资源。最后,闪速接口模块被可通信地耦接到存储器控制器。闪速接口模块配置为经由第一集合的资源在存储器控制器和第一闪速装置之间通信数据。

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