[发明专利]持久存储器中数据的观察有效

专利信息
申请号: 201480039876.5 申请日: 2014-06-10
公开(公告)号: CN105378682B 公开(公告)日: 2019-01-25
发明(设计)人: W·H·小布莱杰;P·罗文斯坦;M·A·勒特雷尔 申请(专利权)人: 甲骨文国际公司
主分类号: G06F12/084 分类号: G06F12/084;G06F12/0868
代理公司: 中国国际贸易促进委员会专利商标事务所 11038 代理人: 罗亚男
地址: 美国加*** 国省代码: 美国;US
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摘要:
搜索关键词: 持久 存储器 数据 观察
【权利要求书】:

1.一种计算系统,包括:

多个处理器;

高速缓存,被配置为被所述多个处理器中的至少两个处理器访问;

高速缓存控制器,耦合到高速缓存;

持久存储器,耦合到高速缓存控制器;

其中由所述多个处理器中的第一处理器执行的多个线程中的第一线程被配置为经由高速缓存控制器向持久存储器发送给定数据块,以便存储;及

其中高速缓存控制器被配置为:

响应于接收到所述给定数据块并确定与所述给定数据块对应的相干状态还没有阻止读访问,递增用于第一线程的相应的每线程计数;

响应于检测到所述给定数据块要被发送以便存储在持久存储器中,阻止对所述高速缓存中所述给定数据块的拷贝的任何读访问;以及

响应于接收到所述给定数据块存储在持久存储器中的对应确认,递减用于第一线程的相应的每线程计数。

2.如权利要求1所述的计算系统,其中高速缓存控制器还被配置为,响应于接收到所述给定数据块存储在持久存储器中的确认,允许对所述高速缓存中所述给定数据块的所述拷贝的读和写访问。

3.如权利要求2所述的计算系统,其中,响应于确定所述给定数据块要存储在持久存储器中,高速缓存控制器还被配置为使第一处理器与所述高速缓存之间的任何高速缓存级中所述给定数据块的任何拷贝失效。

4.如权利要求2所述的计算系统,其中,响应于检测到数据要存储在持久存储器中,高速缓存控制器还被配置为只对由第一处理器执行的多个线程中的第一线程允许对所述高速缓存中所述给定数据块的所述拷贝的写访问。

5.如权利要求4所述的计算系统,其中,响应于执行第一线程中的给定指令,第一处理器被配置为:

选择要发送到持久存储器用于存储并具有对应的确认的所述给定数据块;及

将指示和所述给定数据块都发送到高速缓存控制器,其中所述指示指示在持久存储器中存储所述给定数据块并具有确认。

6.如权利要求5所述的计算系统,其中所述给定指令是持久存储指令并且持久存储器利用包括相变存储器(PCM)、自旋力矩转移RAM和忆阻器之一的存储介质。

7.如权利要求5所述的计算系统,其中第一处理器还被配置为阻止绕过对应于持久存储指令的数据块而去到依赖于该持久存储指令的加载指令。

8.如权利要求5所述的计算系统,其中,响应于检测到相应的数据块要存储在持久存储器中,高速缓存控制器还被配置为阻止到指示相应数据块既脏又可读访问的相干状态的任何相干状态过渡。

9.如权利要求5所述的计算系统,其中高速缓存控制器还被配置为响应于确定已经为要发送到持久存储器进行存储的、对应于第一线程的每个数据块接收到相应的确认,向第一处理器发送指示提交由第一线程执行的同步指令的指示。

10.如权利要求5所述的计算系统,其中高速缓存控制器还被配置为:

从第一处理器接收对于由第一线程执行的同步指令被提交的第一指示;及

响应于确定还未接收到用于要发送到持久存储器进行存储的、对应于第一线程的数据块的至少一个相应确认,存储指示同步指令还未完成的第二指示。

11.如权利要求10所述的计算系统,其中高速缓存控制器还被配置为响应于确定已经接收到用于要发送到持久存储器进行存储的、对应于第一线程的每个数据块的相应确认,存储指示同步指令完成的第三指示。

12.如权利要求10所述的计算系统,其中高速缓存控制器还被配置为,响应于确定对于在第一指示之前接收到的数据块还未接收到至少一个相应确认,阻止在第一指令之后接收到的、来自第一处理器中第一线程的任何数据块被发送到持久存储器进行存储。

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