[实用新型]站所识别仪有效

专利信息
申请号: 201420440040.3 申请日: 2014-08-06
公开(公告)号: CN204044559U 公开(公告)日: 2014-12-24
发明(设计)人: 杨光;张可;邱名义;张钻;王何舟;冯蓓艳;李振洲;吴亚叶 申请(专利权)人: 国网上海市电力公司;科大智能科技股份有限公司
主分类号: G05B19/042 分类号: G05B19/042;G06Q50/06
代理公司: 上海信好专利代理事务所(普通合伙) 31249 代理人: 徐茂泰;徐雯琼
地址: 200002 *** 国省代码: 上海;31
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摘要:
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【说明书】:

技术领域

实用新型涉及一种站所识别仪,属于台区用户识别仪的站端设备,是载波信号的发送端。

背景技术

在低压供电线路中,一般采用架空线和电缆线从变压器台区向居民和住宅楼供电。在实际的接进户线操作中,由于城市建筑和市政规划缘故,接进户线大多分批次安装,并且跨越的时间段较长。从而造成用户用电信息和保留的档案混乱,变压器台区实际负荷的用电客户与电力营销系统中的用户信息有出入的现象。从而大大影响了对单个台区线损的考核和事故抢修停电操作。但是由于架空线和地下电缆大多被建筑物所遮挡,有些走线凌乱,无法通过观察确定接进户线所属变压器台区,特别是几个台区的交界处,存在交叉现象。对供电企业营销和电力事故抢修带来诸多不便。为此,用电管理部门经常需要普查各类台区的用户资料,包括用户是由哪台变压器供电,由哪个母线分支供电,由哪个相线供电,实现台区精细化管理,为降耗减损提供真实准确的基础数据。实现这种功能的仪器叫台区用户识别仪、台区用户查询仪、营业普查仪等。台区识别、线路分支识别采用传统的“拉闸验电”的方法确定用户的变压器台区和相线属性存在很多弊端,而传统的台区用户识别仪采用电力载波通信方式和工频通信方式。但是传统的这两种方式都有其自身的缺陷,无法准确识别台区用户由哪个母线分支供电或哪相供电。主要体现如下问题或缺点:

在共高压、共地、及共电缆沟情况下会造成误判。由于传统台区识别仪仅仅采用电力载波信号进行用户识别,而载波信号会通过变压器传输到高压侧,再通过高压线传输到相邻变压器,造成“串线”的现象,既“共高压串线”。同样原因,若相邻变压器有共地情况,载波信号也会串线到相邻变压器既“共地串线”。若相邻变压器的低压电缆走同一电缆沟,电力载波信号会通过电缆间的耦合电容传播到其它变压器上,既“共电缆沟串线”。由于共高压串线、共地串线、共电缆沟串线等情况的存在,仅仅采用电力载波信号的传统台区识别仪经常会造成误判。

对于距离长、干扰大的线路无法识别。城区电力公变台区的供电半径在500米到2000米之间,所以台区识别仪测量距离应不小于2000米。电力载波信号是高频信号,衰减严重,无法远距离传输,使得传统台区识别仪无法识别距离长、线路干扰大的用户。

实用新型内容

本实用新型的目的是提供一种站所识别仪,其为台区用户识别仪的站端设备,其将载波信号经由时隙分时以三相独立相线发送至远方终端。

为实现上述目的,本实用新型的技术方案是提供一种站所识别仪,其包含:输出接口单元,该输出接口单元包含三相信号输出接口和人机交互接口;数据处理单元,该数据处理单元与所述的人机交互接口相连接;信号处理单元,该信号处理单元包含FPGA数字信号处理器,以及与该FPGA数字信号处理器相连接的时间片控制器;该FPGA数字信号处理器与所述的数据处理单元相连接,该时间片控制器分别与所述的数据处理单元以及三相信号输出接口相连接。

所述的三相信号输出接口包含分别与所述的时间片控制器相连接的A相输出端、B相输出端和C相输出端。

所述的数据处理单元采用MCU控制器。

所述的FPGA数字信号处理器包含依次连接的数字信号调制解调器,滤波器和功率放大器,该数字信号调制解调器与所述的数据处理单元相连接,该功率放大器与所述的时间片控制器相连接。

所述的站所识别仪还包含电源管理单元,其分别与所述的数据处理单元以及信号处理单元相连接。

本实用新型所提供的站所识别仪,其为台区用户识别仪的站端设备,是载波信号的发送端,该站所识别仪发送的载波信号被远方终端接收。所述的站所识别仪将载波信号经由时隙分时以三相独立相线发送,发送距离超过2000m,能区分特定的变电站,且能够持续工作2小时以上。

附图说明

图1为本实用新型提供的站所识别仪的电路框图。

具体实施方式

以下结合图1,详细说明本实用新型的一个优选的实施例。

如图1所示,为本实用新型所提供的站所识别仪的电路框图,其包含:输出接口单元,该输出接口单元包含三相信号输出接口和人机交互接口1;数据处理单元5,该数据处理单元5与所述的人机交互接口1相连接;信号处理单元,该信号处理单元包含FPGA(现场可编程门阵列,Field-Programmable Gate Array)数字信号处理器,以及与该FPGA数字信号处理器相连接的时间片控制器9;该FPGA数字信号处理器与所述的数据处理单元5相连接,该时间片控制器9分别与所述的数据处理单元5以及三相信号输出接口相连接。

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