[发明专利]一种机载网络数据次序完整性的测试方法在审
申请号: | 201410727713.8 | 申请日: | 2014-12-03 |
公开(公告)号: | CN104486145A | 公开(公告)日: | 2015-04-01 |
发明(设计)人: | 余亚刚;于峰;王红春;王世奎;史岩;李雯 | 申请(专利权)人: | 中国航空工业集团公司第六三一研究所 |
主分类号: | H04L12/26 | 分类号: | H04L12/26 |
代理公司: | 西安智邦专利商标代理有限公司 61211 | 代理人: | 王少文 |
地址: | 710119 *** | 国省代码: | 陕西;61 |
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摘要: | |||
搜索关键词: | 一种 机载 网络 数据 次序 完整性 测试 方法 | ||
技术领域
本发明属于机载通信网络技术领域,涉及机载网络数据次序完整性的测试方法。
背景技术
当前航空电子系统逐渐从传统的分立式、联合式向综合化、分布式综合模块化演进,分布式综合模块化航空电子(DIMA:Distributed Integrated Modular Avionics)系统当前综合了燃油系统、电源系统、液压系统、环控系统、飞控系统、防冰系统、防火系统、起落架系统、舱门系统等非传统航电系统的处理和控制功能。网络化已是机载航电系统发展的必然趋势。
机载网络传输的数据帧之间通常会存在一定的关联,尤其是将飞控、机电系统等涉及安全的关键业务引入传统的机载航电网络后,同一传输通道内的数据帧有序传输就必须得到保障。在网络交换节点可能发生的丢帧、错帧及阻塞等不应该致使接收端出现数据帧乱序情况,如果接收端收到某一传输通路中数据帧的先后次序与发送端发出的次序不一致,接收端必须能够检测并做相应的过滤操作。
发明内容
为降低网络传输中由于丢帧、错帧及交换机阻塞对系统造成的影响,增强机载网络系统数据传输的可靠性,本发明提出一种机载网络数据次序完整性的测试方法。
本发明的目的:使用该测试方法构建测试场景、定义测试激励数据流并最终给出被测设备接收数据帧时的次序完整性检查功能是否满足要求,从而提高机载网络数据传输的安全性和可靠性指标。
本发明给出以下技术方案:
一种机载网络数据次序完整性的测试方法,其特殊之处在于:测试步骤如下:
1)测试设备构造序列号为SN的N个数据帧;
2)测试设备通过逻辑通路向被测设备发送数据帧;
当测试设备将构造的序列号为SN的N个数据帧发送至被测设备,被测设备的次序完整性检测使能或非使能时,若被测设备接收到序列号为SN的N个数据帧,则被测设备的次序完整性测试合格,否则被测设备的次序完整性测试失败;
当在测试设备构造的N个数据帧中任意剔除一个序号为M的数据帧后,得到序列号为SN1的N-1个数据帧,在被测设备的次序完整性检测使能或非使能时,测试设备将序列号为SN1的N-1个数据帧发送至被测设备,若被测设备接收到序列号为SN1的N-1个数据帧,则被测设备的次序完整性测试合格,否则被测设备的次序完整性测试失败;
当在测试设备构造的N个数据帧中任意剔除序列号为M和M+1的两个相邻数据帧后,得到序列号为SN2的N-2个数据帧,在序列号为SN2的N-2个数据帧剔除序号为M+2的数据帧后,得到序列号为SN3的N-3个数据帧,测试设备将序列号为SN2的N-2个数据帧发送至被测设备,
在被测设备的次序完整性检测使能时,若被测设备接收到序列号为SN3的N-3个数据帧,则被测设备的次序完整性测试合格,否则被测设备的次序完整性测试失败;
或者在被测设备的次序完整性检测非使能时,若被测设备接收到序列号为SN2的N-2个数据帧,则被测设备的次序完整性测试合格,否则被测设备的次序完整性测试失败。
上述步骤2)中,所述逻辑通路有多条,测试设备分别将序列号为SN的N个数据帧、序列号为SN1的N-1个数据帧和序列号为SN2的N-2个数据帧分别通过每条逻辑通路发送至被测设备;对于同一条逻辑通路,测试设备将序列号为SN的N个数据帧、序列号为SN1的N-1个数据帧和序列号为SN2的N-2个数据帧逐一发送至被测设备。
上述序列号SN的序号连续,序列号SN从0开始,序列号SN的最大值为255,所述N不小于256个。
本发明具有以下技术效果:
本发明提出的机载网络数据次序完整性测试方法,降低网络通信中由于交换机阻塞、丢帧、错帧对系统造成影响,即单个帧的丢失不会影响后续到达帧的接收,提高了完整性检查功能的鲁棒性,从而增强机载网络系统数据传输的可靠性。
保证了机载网络数据帧传输次序完整性要求,提高了机载网络数据传输的安全性和可靠性指标。
本发明主要针对机载网络传输的数据帧的次序完整性需求在接收端对到达的数据帧次序完整性检查功能进行测试,构建符合数据帧次序完整性要求的测试项,并给出正常和异常的情况的测试激励数据帧序列,从而能够开展对被测设备次序完整性检查功能进行测试和验证。
附图说明
图1是测试场景及硬件连接示意图。
图2是次序完整性校验模块示意图。
图3是完整性检查流程图。
具体实施方式
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