[发明专利]一种像素电路、有机电致发光显示面板及显示装置有效

专利信息
申请号: 201410640340.0 申请日: 2014-11-13
公开(公告)号: CN104318897A 公开(公告)日: 2015-01-28
发明(设计)人: 木素真;胡祖权 申请(专利权)人: 合肥鑫晟光电科技有限公司;京东方科技集团股份有限公司
主分类号: G09G3/32 分类号: G09G3/32
代理公司: 北京同达信恒知识产权代理有限公司 11291 代理人: 黄志华
地址: 230011 *** 国省代码: 安徽;34
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摘要:
搜索关键词: 一种 像素 电路 有机 电致发光 显示 面板 显示装置
【说明书】:

技术领域

发明涉及显示技术领域,尤其涉及一种像素电路、有机电致发光显示面板及显示装置。

背景技术

随着显示技术的进步,越来越多的有源矩阵有机发光二极管(Active Matrix Organic Light Emitting Diode,AMOLED)显示面板进入市场,与传统的晶体管液晶显示面板(Thin Film Transistor Liquid Crystal Display,TFT LCD)相比,具有低能耗、生产成本低、自发光、宽视角及响应速度快等优点,目前,在手机、PDA、数码相机等显示领域已经开始逐步取代传统的LCD显示屏。与TFT LCD利用稳定的电压控制亮度不同,AMOLED属于电流驱动,需要稳定的电流来控制发光。

现有的驱动OLED发光的像素电路,如图1所示,包括:驱动晶体管M1、开关晶体管M2、存储电容C以及发光器件OLED;其中,驱动晶体管M1的栅极分别与开关晶体管M2的漏极和存储电容C的一端相连、源极与高电压信号端VDD相连、漏极分别与存储电容的另一端和发光器件OLED的一端相连;开关晶体管M2的栅极与扫描信号端Gate相连、源极与数据信号端Data相连;发光器件OLED的另一端与低电压信号端VSS相连;驱动晶体管M1驱动发光器件OLED发光时,驱动电流由高电压信号端VDD、数据信号端Data以及驱动晶体管M1共同控制,由于OLED的发光亮度对其驱动电流的变化相当敏感,且驱动晶体管M1在制作过程中无法做到完全一致,而且由于工艺制程和器件老化,以及工作过程中温度的变化等原因,会使各像素电路中的驱动晶体管M1的阈值电压Vth存在不均匀性,这样就导致了流过每个像素点OLED的电流发生变化使得显示亮度不均,从而影响整个图像的显示效果。

因此,如何消除像素电路中驱动晶体管阈值电压的变化对发光器件的发光亮度的影响,保证驱动发光器件OLED的电流的均一性,从而保证显示画面的质量,是本领域技术人员亟待解决的问题。

发明内容

本发明实施例提供了一种像素电路、有机电致发光显示面板及显示装置,用以解决现有技术中存在的像素电路中驱动晶体管阈值电压的变化影响发光器件的发光亮度的问题。

本发明实施例提供了一种像素电路,包括:初始化模块、充电控制模块、驱动模块、具有发光器件的发光模块;其中,

所述驱动模块的控制端与第一节点相连,输入端与第二节点相连,输出端与所述发光模块的输入端相连;所述充电控制模块的控制端与扫描信号端相连,输入端与数据信号端相连,输出端与第三节点相连;所述初始化模块连接于所述第一节点、所述第二节点、所述第三节点、第一参考信号端、第一信号控制端和所述扫描信号端之间;所述发光模块的第一控制端与第二信号控制端相连,第二控制端与发光信号控制端相连,输出端与第二参考信号端相连;

在初始化阶段,所述初始化模块用于在所述扫描信号端的控制下对所述第一节点进行初始化,所述充电控制模块用于在所述扫描信号端的控制下对所述第三节点进行初始化;

在补偿阶段,所述发光模块用于在所述第二信号控制端的控制下将所述驱动模块的输出端与所述第二参考信号端导通,所述初始化模块用于在所述第一信号控制端和所述扫描信号端的控制下对所述第一节点进行所述驱动模块的阈值电压补偿;

在数据写入阶段,所述充电控制模块用于在所述扫描信号端的控制下通过所述初始化模块对所述第一节点进行数据写入;

在发光阶段,所述初始化模块用于在所述第一信号控制端的控制下将所述第一参考信号端与所述驱动模块的输入端导通,使所述驱动模块驱动所述发光模块中的所述发光器件发光。

在一种可能的实施方式中,本发明实施例提供的上述像素电路中,所述驱动模块,具体包括:驱动晶体管;

所述驱动晶体管的栅极与所述第一节点相连,源极与所述第二节点相连,漏极与所述发光模块的输入端相连。

在一种可能的实施方式中,本发明实施例提供的上述像素电路中,所述初始化模块,具体包括:第一开关晶体管、第二开关晶体管和存储电容;其中,

所述第一开关晶体管的栅极与所述扫描信号端相连,源极与所述第一参考信号端相连,漏极与所述第一节点相连;

所述第二开关晶体管的栅极与所述第一信号控制端相连,源极与所述第一参考信号端相连,漏极与所述第二节点相连;

所述存储电容连接于所述第一节点与所述第三节点之间。

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