[发明专利]处理超时的系统、方法和装置有效
| 申请号: | 201410257505.6 | 申请日: | 2014-03-14 | 
| 公开(公告)号: | CN104063290B | 公开(公告)日: | 2018-02-16 | 
| 发明(设计)人: | M·韦格;S·W·利姆 | 申请(专利权)人: | 英特尔公司 | 
| 主分类号: | G06F11/07 | 分类号: | G06F11/07 | 
| 代理公司: | 永新专利商标代理有限公司72002 | 代理人: | 张晰,王英 | 
| 地址: | 美国加*** | 国省代码: | 暂无信息 | 
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| 摘要: | |||
| 搜索关键词: | 处理 超时 系统 方法 装置 | ||
1.一种用于链路管理的装置,包括:
发送逻辑单元;
接收逻辑单元;以及
存储器,其用于存储链路训练和状况状态机(LTSSM),其中当遇到LTSSM中的差错时,所述发送逻辑单元和所述接收逻辑单元首先被转换为LTSSM的第一已知状态,然后被转换为第二已知状态,并且在所述发送逻辑单元和所述接收逻辑单元均处于所述第二已知状态后重启所述LTSSM,其中所述第一已知状态是省电状态,所述第二已知状态是维持配置设置的LTSSM的最低功率消耗状态。
2.如权利要求1所述的装置,其中所述省电状态是STALL状态。
3.如权利要求1所述的装置,其中所述第二已知状态是HIBERN8。
4.如权利要求1所述的装置,其中所述接收逻辑单元必须在所述发送逻辑单元之前转换到所述第二已知状态。
5.如权利要求1所述的装置,其中所述装置是PCI快速设备。
6.一种用于链路管理的系统,包括:
第一设备,包括发送逻辑单元和接收逻辑单元;
第二设备,包括发送逻辑单元和接收逻辑单元;
在所述第一设备的发送逻辑单元和所述第二设备的接收逻辑单元之间的第一物理线路;
在所述第一设备的发送逻辑单元和所述第二设备的接收逻辑单元之间的第二物理线路;
在每个设备中的存储器,其用于在设备中存储链路训练和状况状态机(LTSSM),其中当遇到LTSSM中的差错时,所有的发送逻辑单元和所有的接收逻辑单元都首先被转换为LTSSM的第一已知状态,然后被转换为第二已知状态,并且在设备的所有的发送逻辑单元和接收逻辑单元都处于所述第二已知状态后,重启所述LTSSM,其中,所述第一已知状态是省电状态,所述第二已知状态是维持配置设置的LTSSM的最低功率消耗状态。
7.如权利要求6所述的系统,其中省电状态是STALL状态。
8.如权利要求6所述的系统,其中所述第二已知状态是HIBERN8。
9.如权利要求6所述的系统,其中所述接收逻辑单元必须在所述发送逻辑单元之前转换到所述第二已知状态。
10.如权利要求6所述的系统,其中所述设备是PCI快速设备。
11.一种用于链路管理的方法,包括:
启动设备中的链路训练和状况状态机(LTSSM);
当遇到LTSSM中的差错时,
将所述设备的所有的发送逻辑单元和接收逻辑单元转换为所述LTSSM的第一已知状态,
将所述设备的所有的发送逻辑单元和接收逻辑单元转换为第二已知状态,以及
在所述设备的所有的发送逻辑单元和接收逻辑单元均处于所述第二已知状态后重启所述LTSSM,其中,所述第一已知状态是省电状态,所述第二已知状态是维持配置设置的LTSSM的最低功率消耗状态。
12.如权利要求11所述的方法,其中所述省电状态是STALL状态。
13.如权利要求11所述的方法,其中所述第二已知状态是HIBERN8。
14.如权利要求11所述的方法,其中所述接收逻辑单元必须在所述发送逻辑单元之前转换到所述第二已知状态。
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