[发明专利]具有P型埋层的硅外延过程中抑制P型杂质自掺杂的工艺有效
申请号: | 201410225224.2 | 申请日: | 2014-05-26 |
公开(公告)号: | CN103972064B | 公开(公告)日: | 2017-01-11 |
发明(设计)人: | 丁海东;王海红 | 申请(专利权)人: | 上海先进半导体制造股份有限公司 |
主分类号: | H01L21/265 | 分类号: | H01L21/265 |
代理公司: | 上海专利商标事务所有限公司31100 | 代理人: | 徐洁晶 |
地址: | 200233 *** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 具有 型埋层 外延 过程 抑制 杂质 掺杂 工艺 | ||
1.一种具有P型埋层的硅外延过程中抑制P型杂质自掺杂的工艺,包括步骤:
A.提供硅片,作为制作半导体器件的衬底,所述硅片的表面注入形成有P型埋层和N型埋层,将所述硅片在低温和常压的环境下作烘烤;
B.将所述硅片在低温和常压的环境下作刻蚀,去除所述硅片的表面因之前形成所述P型埋层和所述N型埋层时所造成的损伤;
C.在常压的环境下于所述硅片的表面形成一层本征的顶盖层;以及
D.在减压的环境下于所述顶盖层的表面生长外延层。
2.根据权利要求1所述的工艺,其特征在于,在上述步骤A和步骤B中,所述低温是指温度为1080~1120℃。
3.根据权利要求2所述的工艺,其特征在于,在上述步骤A、步骤B和步骤C中,所述常压是指气压为标准大气压。
4.根据权利要求3所述的工艺,其特征在于,在上述步骤D中,所述减压是指气压为45~60托。
5.根据权利要求4所述的工艺,其特征在于,所述P型埋层是指硼埋层,所述P型杂质是指硼原子;所述N型埋层是指锑埋层。
6.根据权利要求5所述的工艺,其特征在于,所述硅片为P型掺杂,其电阻率为35~40Ohm.cm。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造