[发明专利]一种供电电源掉电处理电路和一种网络终端有效
| 申请号: | 201410166797.2 | 申请日: | 2014-04-23 | 
| 公开(公告)号: | CN105024448B | 公开(公告)日: | 2017-07-28 | 
| 发明(设计)人: | 韩杰;杨春晖;王艳辉 | 申请(专利权)人: | 北京视联动力国际信息技术有限公司 | 
| 主分类号: | H02J9/06 | 分类号: | H02J9/06 | 
| 代理公司: | 北京润泽恒知识产权代理有限公司11319 | 代理人: | 苏培华 | 
| 地址: | 100000 北京市*** | 国省代码: | 北京;11 | 
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| 摘要: | |||
| 搜索关键词: | 一种 供电 电源 掉电 处理 电路 网络 终端 | ||
技术领域
本发明涉及电路技术领域,特别是涉及一种供电电源掉电处理电路和一种网络终端。
背景技术
网络终端(例如路边监控终端、路边发布终端等)在工作时需要供电电源对其进行正常供电,因此当供电电源掉电时,网络终端将不能正常工作。目前,针对供电电源掉电的情况,网络终端通常会发送一个掉电信号至服务器,以通知服务器供电电源已掉电。上述掉电信号称为Dying gasp(死前喘口气)信号,Dying gasp信号是指在输入电压无法满足终端正常工作需要的时候,终端会利用最后存储的一点电能自动发送一个信号给服务器,通知服务器终端可能将要无法正常工作。
目前实现发送Dying gasp信号的方法,通常是芯片厂商在设计芯片的时候会设计一个Dying gasp性能模块在芯片内,此模块通过监测外部输入电压来实现Dying gasp功能,当监测到外部输入电压为0后,该芯片将控制终端自动发送Dying gasp信号。
但是,上述方法是将Dying gasp性能模块固化在芯片内部,也即Dying gasp性能模块的各项功能(例如储电功能、控制终端自动发送Dying gasp信号的功能等)均已固定,因此该种Dying gasp性能模块在实现Dying gasp信号功能时,灵活性较差,并且要将Dying gasp性能模块集成在芯片内部,工艺较为复杂。
发明内容
本发明提供一种供电电源掉电处理电路和一种网络终端,以解决Dying gasp性能模块在实现Dying gasp信号功能时,灵活性较差,并且将Dying gasp性能模块集成在芯片内部工艺较为复杂的问题。
为了解决上述问题,本发明公开了一种供电电源掉电处理电路,其特征在于,包括:供电电源、储能单元、第一信号生成单元和CPU;其中,所述供电电源的电压输出端分别与所述储能单元的电压输入端和所述第一信号生成单元的电压输入端连接;所述储能单元的电压输出端与所述CPU的电压输入端连接,所述第一信号生成单元的第一信号输出端与所述CPU的第一GPIO引脚连接;
在所述供电电源供电时,利用所述供电电源输入所述储能单元的电压对所述储能单元进行充电;在供电导致所述供电电源输入所述第一信号生成单元的电压高于或等于第一阈值时,所述第一信号输出端输出低电平至所述第一GPIO引脚;
在所述供电电源掉电时,所述储能单元进行放电以供所述CPU继续工作;在掉电导致所述供电电源输入所述第一信号生成单元的电压低于第一阈值时,所述第一信号输出端输出高电平至所述第一GPIO引脚;所述第一GPIO引脚在检测到电平由低到高跳变后产生第一中断信号,致使所述CPU生成掉电信号,并将所述掉电信号发送至服务器,以通知服务器所述供电电源掉电。
优选地,所述第一信号生成单元包括第一电容,所述第一电容的第一端连接所述第一信号输出端,所述第一电容的第二端接地;
在供电导致所述供电电源输入所述第一信号生成单元的电压高于或等于第一阈值时,对所述第一电容进行充电;
在掉电导致所述供电电源输入所述第一信号生成单元的电压低于第一阈值时,所述第一电容放电致使所述第一信号输出端输出低电平至所述第一GPIO引脚;在所述第一电容放电结束后致使所述第一信号输出端输出高电平至所述第一GPIO引脚。
优选地,所述第一信号生成单元还包括第一电阻、第二电阻和第一MOS管,
其中,所述第一电阻的第一端连接所述第一信号生成单元的电压输入端连接,所述第一电阻的第二端连接所述第二电阻的第一端连接,所述第二电阻的第二端接地;
所述第一MOS管的栅极与所述第一电阻的第二端或者所述第二电阻的第一端连接,所述第一MOS管的漏极与所述第一信号输出端连接,所述第一MOS管的源极接地;
在供电导致所述供电电源输入所述第一信号生成单元的电压高于或等于第一阈值时,所述第一MOS管导通,致使所述第一信号输出端输出低电平;在掉电导致所述供电电源输入所述第一信号生成单元的电压低于第一阈值时,所述第一MOS管截止,致使所述第一信号输出端输出高电平。
优选地,还包括第二信号生成单元,所述供电电源的电压输出端与所述第二信号生成单元的电压输入端连接,所述第二信号生成单元的第二信号输出端与所述CPU的第二GPIO引脚连接;
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