[发明专利]具有重写能力和低写放大的非易失性存储器有效
申请号: | 201410096590.2 | 申请日: | 2014-03-14 |
公开(公告)号: | CN104050998B | 公开(公告)日: | 2019-09-03 |
发明(设计)人: | H·纳扎里安;S·T·阮 | 申请(专利权)人: | 科洛斯巴股份有限公司 |
主分类号: | G11C7/18 | 分类号: | G11C7/18;G11C8/14;G11C16/06 |
代理公司: | 北京鸿元知识产权代理有限公司 11327 | 代理人: | 许向彤;陈英俊 |
地址: | 美国加*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 具有 重写 能力 放大 非易失性存储器 | ||
1.一种用于与计算设备通信连接的固态非易失性存储器驱动器,包括:
双端存储元件的阵列,其被配置为可与多条字线及多条位线结合工作,其中所述双端存储元件的阵列包括:所述双端存储元件的第一子集和所述双端存储元件的第二子集,所述第一子集包括等于或少于所述双端存储元件的一个页面,所述双端存储元件的所述第一子集与所述多条位线的对应子集连接并且通过源线被部分地访问,并且其中所述双端存储元件的所述第二子集与所述多条位线的所述对应子集连接并且也通过所述源线被部分地访问;
存储控制器,其用于通过所述多条字线的一条字线激活访问晶体管以通过所述源线连接所述双端存储元件的所述第一子集,从而访问所述双端存储元件的所述第一子集,该存储控制器进一步用于写入数据集到所述双端存储元件的所述第一子集,以及重写所述双端存储元件的所述第一子集处的所述数据集,
其中,所述双端存储元件包括电路元件,所述电路元件具有两个导电触头以及所述两个导电触头之间的有源区,
其中,所述存储控制器用于在不擦除存储所述数据集的物理地址位置的情况下重写所述数据集,从而为所述计算设备提供等于1的写放大。
2.根据权利要求1所述的固态非易失性存储器驱动器,其中,所述计算设备包括存储设备和控制所述存储设备的主控制器。
3.根据权利要求2所述的固态非易失性存储器驱动器,进一步包括本地字线,每个所述本地字线连接到所述双端存储元件的所述第一子集的每一个的第一端子,所述本地字线用于被所述多条字线的所述一条字线激活,其中,所述多条字线的所述一条字线用于激活包括所述本地字线的多条本地字线,所述多条本地字线分别连接到所述双端存储元件的所述第一子集和所述双端存储元件的第三子集,所述多条本地字线不与所述双端存储元件的所述第二子集连接。
4.根据权利要求3所述的固态非易失性存储器驱动器,其中,所述多条本地字线的所述本地字线的激活促进写入所述数据集到所述双端存储元件的所述第一子集,以及重写所述双端存储元件的所述第一子集处的所述数据集,所述多条本地字线的第二条本地字线的激活促进写入以及重写所述双端存储元件的所述第三子集。
5.根据权利要求1所述的固态非易失性存储器驱动器,其中,所述双端存储元件的所述第一子集包括8个或更少的双端存储元件。
6.根据权利要求1所述的固态非易失性存储器驱动器,其中,所述双端存储元件的所述第一子集包括单个双端存储元件。
7.根据权利要求1所述的固态非易失性存储器驱动器,其中,所述双端存储元件的阵列还包括另一组双端存储元件,并且所述固态非易失性存储器驱动器进一步包括:
输入输出接口集;
本地字线集,其至少部分被所述多条字线之一控制;以及
复用组件,其用于结合存储操作选择性地将所述另一组双端存储元件中的各个双端存储元件与所述输入输出接口集中的各个输入输出接口连接。
8.根据权利要求7所述的固态非易失性存储器驱动器,其中,所述另一组双端存储元件包括连接到所述本地字线集的第一条本地字线的第一双端存储元件,并且所述另一组双端存储元件包括连接到所述本地字线集的第二条本地字线的第二双端存储元件。
9.根据权利要求8所述的固态非易失性存储器驱动器,其中,所述复用组件结合所述存储操作将连接到所述第一条本地字线的所述第一双端存储元件连接到所述输入输出接口集中的第一输入输出接口,并将连接到所述第二条本地字线的所述第二双端存储元件连接到所述输入输出接口集中的第二输入输出接口。
10.根据权利要求7所述的固态非易失性存储器驱动器,其中,
所述存储控制器用于从所述本地字线集的各条本地字线中选择所述另一组双端存储元件中的各个双端存储元件;以及
所述复用组件促进所述另一组双端存储元件的所述各个双端存储元件与所述输入输出接口集中的各个输入输出接口的互联。
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