[发明专利]一种应变沟道晶体管及其制备方法有效
| 申请号: | 201410093072.5 | 申请日: | 2014-03-13 |
| 公开(公告)号: | CN104916540B | 公开(公告)日: | 2018-05-01 |
| 发明(设计)人: | 赵猛 | 申请(专利权)人: | 中芯国际集成电路制造(上海)有限公司;中芯国际集成电路制造(北京)有限公司 |
| 主分类号: | H01L21/336 | 分类号: | H01L21/336;H01L21/28;H01L29/78;H01L29/10;H01L29/40 |
| 代理公司: | 上海申新律师事务所31272 | 代理人: | 俞涤炯 |
| 地址: | 201203 上海市*** | 国省代码: | 上海;31 |
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| 摘要: | |||
| 搜索关键词: | 一种 应变 沟道 晶体管 及其 制备 方法 | ||
1.一种应变沟道晶体管的制备方法,其特征在于,包括以下步骤:
步骤S1:提供一SOI结构,该SOI结构自下而上依次包括衬底、埋氧层和硅化物层;沉积一掩膜层将所述SOI结构上表面予以覆盖并刻蚀去除部分掩膜层;
步骤S2:以剩余的掩膜层为掩膜刻蚀部分所述硅化物层和埋氧层至所述衬底的上表面停止形成沟槽;
步骤S3:在所述沟槽内制备应变沟道层,所述应变沟道层包括位于衬底之上的第一半导体材料层和位于所述第一半导体材料层之上的第二半导体材料层,所述第一半导体材料层的晶格常数大于所述第二半导体材料层的晶格常数;
步骤S4:制备一侧墙将沟槽暴露的侧壁表面予以覆盖后,继续在应变沟道层暴露的上表面制备一栅介质层;
步骤S5:填充栅极材料层充满所述沟槽并抛光至所述剩余掩膜层上表面;
步骤S6:去除剩余掩膜层并在剩余硅化物层上方生长一层外延层,进行源漏制备工艺。
2.如权利要求1所述的方法,其特征在于,所述衬底为锗衬底,所述掩膜层的材质为氮化硅。
3.如权利要求1所述的方法,其特征在于,根据工艺需求来选择是否对所述硅化物层进行源漏掺杂。
4.如权利要求1所述的方法,其特征在于,所述第一半导体层为锗材料层,所述第二半导体层为硅材料层,采用以下工艺在所述沟槽内制备形成应变沟道层:
采用第一外延生长工艺在沟槽底部生长一层锗材料层后,继续采用第二外延生长工艺在所述锗材料层的上表面生长一层硅材料层。
5.如权利要求1所述的方法,其特征在于,所述栅极材料层为多晶硅层或金属层。
6.如权利要求5所述的方法,其特征在于,所述栅介质层的材质根据所述栅极的材料而设定;
当所述栅极材料层为多晶硅层时,所述栅介质层的材质为二氧化硅;当所述栅极材料层为金属层时,所述栅介质层的材质为金属。
7.如权利要求1所述的方法,其特征在于,采用原位掺杂工艺或离子注入工艺进行源漏制备工艺,且原位掺杂工艺或离子注入工艺的离子均为硼离子。
8.如权利要求1所述的方法,其特征在于,所述外延层的顶面高度低于所述栅极材料层的顶面高度。
9.如权利要求1所述的方法,其特征在于,所述硅化物层和外延层的材质均为碳化硅。
10.如权利要求1所述的方法,其特征在于,所述侧墙的材质为二氧化硅。
该专利技术资料仅供研究查看技术是否侵权等信息,商用须获得专利权人授权。该专利全部权利属于中芯国际集成电路制造(上海)有限公司;中芯国际集成电路制造(北京)有限公司,未经中芯国际集成电路制造(上海)有限公司;中芯国际集成电路制造(北京)有限公司许可,擅自商用是侵权行为。如果您想购买此专利、获得商业授权和技术合作,请联系【客服】
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造





