[发明专利]一种半导体器件及其制造方法有效
申请号: | 201410089112.9 | 申请日: | 2014-03-11 |
公开(公告)号: | CN104916538B | 公开(公告)日: | 2018-06-01 |
发明(设计)人: | 王桂磊;赵超;徐强;杨涛 | 申请(专利权)人: | 中国科学院微电子研究所 |
主分类号: | H01L21/336 | 分类号: | H01L21/336;H01L29/78 |
代理公司: | 北京维澳专利代理有限公司 11252 | 代理人: | 王立民;吉海莲 |
地址: | 100029 *** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 扩散阻挡层 栅沟槽 钨层 半导体器件 金属栅极层 前驱物 离子 阻挡 扩散 栅介质层 衬底 填满 制造 | ||
本发明提供了一种半导体器件的制造方法,包括步骤:在衬底上形成栅沟槽;在栅沟槽中形成栅介质层以及其上的金属栅极层;在金属栅极层表面上形成扩散阻挡层;采用ALD工艺,在扩散阻挡层上形成填满栅沟槽的钨层,所述扩散阻挡层阻挡形成钨层过程中的前驱物中离子的扩散。扩散阻挡层阻挡ALD形成钨层时前驱物中离子的扩散,有效提高了器件的性能以及可靠性。
技术领域
本发明涉及半导体制造领域,特别涉及一种半导体器件及其制造方法。
背景技术
目前,在CMOSFET(互补金属氧化物半导体场效应晶体管)制造工艺的研究可大概分为两个方向,即前栅工艺和后栅工艺。
后栅工艺目前广泛应用于先进的集成电路工艺制造中,其通常是先形成伪栅和源漏区,而后去除伪栅并在栅沟槽中重新填充高k金属栅堆叠的替代栅极。由于栅极形成在源漏极之后,此工艺中栅极不需要承受很高的退火温度,对栅层材料选择更广泛并且更能体现材料本征的特性。
现有技术中多采用CVD、PVD等常规方法制备Al、Mo等金属作为替代栅极的金属填充层,然而其台阶覆盖性较差,后续的CMP工艺难以实现对小尺寸器件的超薄金属层的控制,制备的金属层的质量无法满足40nm以下的工艺要求。
ALD(原子层沉积)工艺是基于化学吸收的表面限制反应,能够提供固有的单层沉积,在高深宽比缝隙中具有100%的台阶覆盖率。目前,在后栅工艺中通常采用ALD工艺进行金属钨(W)的填充来形成替代栅极的顶层金属,以提供具有良好台阶覆盖率和缝隙填充能力的高质量金属层,满足40nm以下尺寸的器件的要求。
然而,ALD制备W时,多采用硼烷(B
发明内容
本发明的目的旨在至少解决上述技术缺陷,提供一种半导体器件的制造方法,避免ALD制备W时硼的扩散,提高器件的性能。
本发明提供了一种半导体器件的制造方法,应用于后栅工艺中,包括:
在衬底上形成栅沟槽;
在栅沟槽中形成栅介质层以及其上的金属栅极层;
在金属栅极层表面上形成扩散阻挡层;
采用ALD工艺,在扩散阻挡层上形成填满栅沟槽的钨层,所述扩散阻挡层阻挡形成钨层过程中的前驱物中离子的扩散。
可选地,形成所述扩散阻挡层和钨层的步骤具体为:
采用ALD工艺,对金属栅极层进行NH
采用ALD工艺,通入形成钨层的前驱物,在该表面上形成氮化钨的扩散阻挡层,以及在扩散阻挡层上形成钨层。
可选地,前驱物为B
可选地,在形成栅介质层之后,形成金属栅极层之前,还包括步骤:在所述栅介质层上形成金属阻挡层。
可选地,所述金属阻挡层包括Al、Ti、TiAl、TiN、WN及其组合。
此外,本发明还提供了由上述方法形成的半导体器件,包括:
衬底;
衬底上的栅沟槽;
栅沟槽中的栅介质层以及其上的金属栅极层;
金属栅极层上的扩散阻挡层,所述扩散阻挡层为氮化钨;
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造