[发明专利]SPSRAM封装器有效
| 申请号: | 201410033720.8 | 申请日: | 2014-01-23 |
| 公开(公告)号: | CN104637529B | 公开(公告)日: | 2017-11-24 |
| 发明(设计)人: | 谢维哲;郑基廷;苏建国;李政宏;张琮永 | 申请(专利权)人: | 台湾积体电路制造股份有限公司 |
| 主分类号: | G11C11/413 | 分类号: | G11C11/413 |
| 代理公司: | 北京德恒律治知识产权代理有限公司11409 | 代理人: | 章社杲,孙征 |
| 地址: | 中国台*** | 国省代码: | 台湾;71 |
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| 摘要: | |||
| 搜索关键词: | spsram 封装 | ||
1.一种用于对单端口存储器件进行存取操作的系统,包括:
封装控制器,被配置为:
在第一时钟周期期间启动从封装器地址组件的第一端口到单端口存储器件的第一存取操作;
接收来自所述单端口存储器件的时钟复位信号,所述时钟复位信号表明所述第一存取操作完成;
响应于接收所述时钟复位信号,在所述第一时钟周期期间启动从所述封装器地址组件的第二端口到所述单端口存储器件的第二存取操作。
2.根据权利要求1所述的系统,包括:
数据封装器,被配置为在所述第一时钟周期期间传输与所述第一存取操作相关联的第一数据和与所述第二存取操作相关联的第二数据。
3.根据权利要求2所述的系统,所述数据封装器被配置为在不锁存所述第一数据的情况下将所述第一数据传输至所述单端口存储器件。
4.根据权利要求1所述的系统,所述第一存取操作包括第一读出存取操作和第一写入存取操作中的至少一种,所述第二存取操作包括第二读出存取操作和第二写入存取操作中的至少一种。
5.根据权利要求1所述的系统,所述封装控制器包括:
多时钟发生器,被配置为:
响应于识别与所述第一时钟周期相关联的系统时钟信号的上升沿,产生第一内部时钟信号以启动所述第一存取操作。
6.根据权利要求1所述的系统,所述封装控制器包括:
多时钟发生器,被配置为:
响应于所述时钟复位信号,产生第二内部时钟信号以启动所述第二存取操作。
7.根据权利要求1所述的系统,所述封装控制器被配置为在所述第一时钟周期期间对所述单端口存储器件进行多次存取操作,所述多次存取操作包括所述第一存取操作、所述第二存取操作以及第三存取操作。
8.根据权利要求1所述的系统,所述封装控制器被配置为以串行方式进行所述第一存取操作和所述第二存取操作。
9.根据权利要求1所述的系统,包括:
所述封装器地址组件,包括:
所述第一端口,被配置为传输第一端口输入;以及
所述第二端口,被配置为传输第二端口输入。
10.根据权利要求1所述的系统,所述第一端口被配置为接收第一端口地址、第一芯片使能信号和第一写入使能信号中的至少一个,以用于所述第一存取操作。
11.根据权利要求1所述的系统,所述第二端口被配置为接收第二端口地址、第二芯片使能信号和第二写入使能信号中的至少一个,以用于所述第二存取操作。
12.根据权利要求1所述的系统,所述封装控制器包括:
多时钟发生器,被配置为:
在所述第一时钟周期期间产生多个内部时钟信号,所述多个内部时钟信号包括第一内部时钟信号以启动所述第一存取操作以及第二内部时钟信号以启动所述第二存取操作。
13.一个用于对单端口存储器件进行存取操作的系统,包括:
封装器地址组件,包括:
第一端口,被配置成传输第一端口输入;以及
第二端口,被配置成传输第二端口输入;
封装控制器,包括:
多时钟发生器,被配置为:
在系统时钟的第一时钟周期期间基于系统时钟信号的上升沿产生第一内部时钟信号,所述第一内部时钟信号在所述第一时钟周期期间启动对单端口存储器件的所述第一端口输入的第一存取操作;以及
在所述第一时钟周期期间基于从所述单端口存储器件所接收的时钟复位信号产生第二内部时钟信号,所述第二内部时钟信号在所述第一时钟周期期间启动对所述单端口存储器件的所述第二端口输入的第二存取操作。
14.根据权利要求13所述的系统,包括:
数据封装器,被配置为在所述第一时钟周期期间传输与所述第一存取操作相关联的第一数据和与所述第二存取操作相关联的第二数据。
15.根据权利要求13所述的系统,所述单端口存储器件包括6晶体管位单元阵列。
16.根据权利要求13所述的系统,所述封装控制器被配置为以串行方式进行所述第一存取操作和所述第二存取操作。
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