[发明专利]半导体装置的制造方法以及PIN二极管有效

专利信息
申请号: 201380078145.7 申请日: 2013-07-11
公开(公告)号: CN105378923B 公开(公告)日: 2019-09-27
发明(设计)人: 藤井秀纪 申请(专利权)人: 三菱电机株式会社
主分类号: H01L27/04 分类号: H01L27/04;H01L21/20;H01L29/78
代理公司: 北京天昊联合知识产权代理有限公司 11112 代理人: 何立波;张天舒
地址: 日本*** 国省代码: 日本;JP
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摘要:
搜索关键词: 半导体 装置 制造 方法 以及 pin 二极管
【权利要求书】:

1.一种半导体装置的制造方法,其特征在于,具有:

在半导体衬底形成晶体管的工序;

在所述半导体衬底上利用多晶硅或者非晶硅形成PIN二极管的工序;

在形成所述晶体管之后使所述PIN二极管的一部分选择性地氧化或升华,从而将所述PIN二极管分割为多个二极管的工序;以及

对所述多个二极管的一部分选择性地进行热处理而进行再结晶化、氧化或者晶粒大小的变更的工序,

所述PIN二极管具有横向排列配置的n型层、i型层以及p型层,

将所述n型层选择性地再结晶化。

2.一种半导体装置的制造方法,其特征在于,具有:

在半导体衬底形成晶体管的工序;

在所述半导体衬底上利用多晶硅或者非晶硅形成PIN二极管的工序;

在形成所述晶体管之后使所述PIN二极管的一部分选择性地氧化或升华,从而将所述PIN二极管分割为多个二极管的工序;以及

对所述多个二极管的一部分选择性地进行热处理而进行再结晶化、氧化或者晶粒大小的变更的工序,

所述PIN二极管具有横向排列配置的n型层、i型层以及p型层,

将所述i型层选择性地再结晶化。

3.一种半导体装置的制造方法,其特征在于,具有:

在半导体衬底形成晶体管的工序;

在所述半导体衬底上利用多晶硅或者非晶硅形成PIN二极管的工序;

在形成所述晶体管之后使所述PIN二极管的一部分选择性地氧化或升华,从而将所述PIN二极管分割为多个二极管的工序;以及

对所述多个二极管的一部分选择性地进行热处理而进行再结晶化、氧化或者晶粒大小的变更的工序,

所述PIN二极管具有横向排列配置的n型层、i型层以及p型层,

将所述p型层选择性地再结晶化。

4.一种半导体装置的制造方法,其具有:

在半导体衬底形成晶体管的工序;

在所述半导体衬底上利用多晶硅或者非晶硅形成PIN二极管的工序;

在形成所述晶体管之后使所述PIN二极管的一部分选择性地氧化或升华,从而将所述PIN二极管分割为多个二极管的工序;以及

对所述多个二极管的一部分选择性地进行热处理而进行再结晶化、氧化或者晶粒大小的变更的工序,

所述PIN二极管具有横向排列配置的n型层、i型层以及p型层,

将所述n型层与所述i型层的结区域以及所述p型层与所述i型层的结区域选择性地再结晶化。

5.一种半导体装置的制造方法,其特征在于,具有:

在半导体衬底形成晶体管的工序;

在所述半导体衬底上利用多晶硅或者非晶硅形成PIN二极管的工序;

在形成所述晶体管之后使所述PIN二极管的一部分选择性地氧化或升华,从而将所述PIN二极管分割为多个二极管的工序;以及

对所述多个二极管的一部分选择性地进行热处理而进行再结晶化、氧化或者晶粒大小的变更的工序,

所述PIN二极管具有横向排列配置的n型层、i型层以及p型层,

将除了所述n型层与所述i型层的结区域以及所述p型层与所述i型层的结区域以外的区域选择性地再结晶化。

6.一种半导体装置的制造方法,其特征在于,具有:

在半导体衬底形成晶体管的工序;

在所述半导体衬底上利用多晶硅或者非晶硅形成PIN二极管的工序;

在形成所述晶体管之后使所述PIN二极管的一部分选择性地氧化或升华,从而将所述PIN二极管分割为多个二极管的工序;以及

对所述多个二极管的一部分选择性地进行热处理而进行再结晶化、氧化或者晶粒大小的变更的工序,

所述PIN二极管具有横向排列配置的n型层、i型层以及p型层,

将所述p型层的上层部、所述i型层的上层部以及所述n型层的上层部选择性地再结晶化。

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