[发明专利]去耦电路在审
申请号: | 201380054076.6 | 申请日: | 2013-09-12 |
公开(公告)号: | CN104756316A | 公开(公告)日: | 2015-07-01 |
发明(设计)人: | 西本研悟;深泽徹;宫下裕章 | 申请(专利权)人: | 三菱电机株式会社 |
主分类号: | H01Q1/52 | 分类号: | H01Q1/52;H01P5/19;H01Q1/46 |
代理公司: | 北京三友知识产权代理有限公司 11127 | 代理人: | 李辉;黄纶伟 |
地址: | 日本*** | 国省代码: | 日本;JP |
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摘要: | |||
搜索关键词: | 电路 | ||
技术领域
本发明涉及与无线通信装置等中安装的多个天线连接的去耦电路,尤其涉及降低两条天线之间的耦合的去耦电路。
背景技术
近年来,随着无线通信系统的高速化/高质量化,为了应用分集及MIMO(Multiple Input Multiple Output:多输入多输出),对在收发中使用多个天线的多天线技术的需求在提高。为了使分集及MIMO发挥效果,需要尽可能减小多个天线之间的耦合,降低天线相关性。
但是,通常在小型通信终端等较小的区域中安装多个天线的情况下,不能充分确保天线之间的距离,所以,天线间耦合变强,通信性能劣化。对于该问题,公知有如下方法:使去耦电路与天线连接,利用经由电路的耦合来抵消经由天线的耦合。
例如,公知有通过利用由两个传输线路与连接线路之间的电抗元件构成去耦电路,能够减小天线之间的相互耦合(参照例如非专利文献1)。此外,存在如下方法:对两条天线的形状进行设计,利用连接电路(电抗电路)连接天线之间,由此减小天线间耦合(例如参照专利文献1)。此外,公知有如下方法:在正交极化波共用贴片天线中,为了减小给电端口之间的耦合,利用经由方向性耦合器的耦合来抵消经由天线的耦合(参照非专利文献2)。
现有技术文献
专利文献
专利文献1:日本特开2011-205316号公报
非专利文献
非专利文献1:S.C.Chen,Y.S.Wang,and S.J.Chung,“A decoupling technique for increasing the port isolation between two strongly coupled antennas,”IEEE Trans.Antennas Propag.,vol.56,no.12,pp.3650-3658,Dec.2008.
非专利文献2:K.L.Lau,K.M.Luk,and D.Lin,“A wide-band dual-polarization patch antenna with directional coupler,”IEEE Antennas Wireless Propagat.Lett.,vol.1,pp.186-189,2002.
发明内容
发明要解决的问题
但是,现有的去耦电路的原理是在1个频率下减小耦合,在所使用的频带较宽的情况下,存在不能在整个频带内减小耦合的问题。尤其是,当在使用频带内天线间耦合的相位大幅变化的情况下,存在不能在整个频带内减小耦合的问题。
本发明是为了解决上述问题而完成的,其目的在于得到能够在宽频带中减小天线之间的耦合的去耦电路。
用于解决问题的手段
本发明的去耦电路具有:将一个输入分配为两个或将两个输入合成为一个的第1分配电路、第2分配电路;以及具有规定的特性阻抗的传输线路,第1分配电路具有第1端子、第2端子、第3端子,将从第1端子输入的高频信号输出到第2端子和第3端子,第2分配电路具有第4端子、第5端子、第6端子,将从第4端子输入的高频信号输出到第5端子和第6端子,并且,第3端子与传输线路的一端连接,并且,第6端子与传输线路的另一端连接,第2端子与第1天线连接,并且第5端子与第2天线连接。
发明效果
本发明的去耦电路具有:第1分配电路,其将从第1端子输入的高频信号输出到第2端子和第3端子;以及第2分配电路,其具有第4端子、第5端子、第6端子,将从第4端子输入的高频信号输出到第5端子和第6端子,在所述去耦电路中,第3端子与传输线路的一端连接,第6端子与传输线路的另一端连接,第2端子与第1天线连接,第5端子与第2天线连接,因此,可得到能够在宽频带中减小天线之间的耦合去耦电路。
附图说明
图1是示出本发明实施方式1的去耦电路的结构图。
图2是示出应用本发明实施方式1的去耦电路的天线的一例的说明图。
图3是示出图2的双元件偶极子天线中的天线间耦合的计算结果的说明图。
图4是示出在图2的双元件偶极子天线中应用了实施方式1的去耦电路的情况下的路径A、B的耦合的振幅、相位的说明图。
图5是示出在图2的双元件偶极子天线中应用了实施方式1的去耦电路的情况下的耦合量的说明图。
图6是示出在图2的双元件偶极子天线中应用了非专利文献1的去耦电路的情况下的耦合量的说明图。
图7是示出本发明实施方式2的去耦电路的结构图。
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