[实用新型]一种具有无边界接触窗的半导体元件有效
| 申请号: | 201320750054.0 | 申请日: | 2013-11-25 | 
| 公开(公告)号: | CN203588976U | 公开(公告)日: | 2014-05-07 | 
| 发明(设计)人: | 叶文冠 | 申请(专利权)人: | 叶文冠;绿亚电子(泉州)有限公司 | 
| 主分类号: | H01L21/28 | 分类号: | H01L21/28;H01L21/768;H01L29/41 | 
| 代理公司: | 厦门市首创君合专利事务所有限公司 35204 | 代理人: | 傅家强 | 
| 地址: | 中国台湾高雄*** | 国省代码: | 中国台湾;71 | 
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| 摘要: | |||
| 搜索关键词: | 一种 具有 边界 接触 半导体 元件 | ||
技术领域
本实用新型涉及一种具有无边界接触窗的半导体元件。
背景技术
近年来,半导体元件的需求因电子零件的大量使用特别是电脑的快速普及而大量增加。由于需要数百或是数千电晶体在单一半导体晶片上组成很复杂的集成电路,因此为了增加集成电路内电子元件密度及缩小布局面积,必须制造性能更佳的半导体元件,且保持元件原来所拥有的特性,所以所以改良半导体元件品质是亟需解决的问题。
实用新型内容
本实用新型的主要目的是克服现有技术的缺点,提供一种可克服翘曲效应,且可避免接合漏电,简化生产工艺的具有无边界接触窗的半导体元件。
本实用新型采用如下技术方案:
一种具有无边界接触窗的半导体元件,至少包含:
一半导体基底,具有一浅沟槽隔离区;
一氧化物层,形成于所述浅沟槽隔离区内及半导体基底表面上方,通过化学机械研磨法及氧化物回蚀方式,使该氧化物层的高度低于半导体基底表面;
一第一介电材料层,形成于所述浅沟槽隔离区的氧化物层上部内侧,用以作为无边界接触窗的阻绝层;
一闸氧化层与多晶硅层,依序形成于半导体基底表面上方,用以作为半导体的闸极结构;
一轻掺杂汲极,形成于所述闸极与浅沟槽隔离区之间;
一第二介电材料层,形成于所述闸极的侧壁,用以作为闸极的间隔壁;
一重掺杂离子植入区,形成于所述轻掺杂汲极与浅沟槽隔离区之间的半导体基底内,用以作为半导体的源/汲极;
多个金属硅化物,形成于所述闸极与源/汲极上方,用以降低接触电阻;
及一内层介电材料层,形成于晶片表面上方,所述源/汲极与该浅沟槽隔离区之间蚀刻一无边界接触窗,用以连接金属层。
进一步地,所述半导体基底为硅底材。
进一步地,所述第一介电材料层为氮化硅侧隙壁,至少包含氮化硅,采用化学气相沉积法制得。
进一步地,所述第二介电材料层为一间隙壁,至少包含氮化硅,采用非等向性蚀刻方式制得。
进一步地,所述闸氧化层至少包含二氧化硅,采用干式氧化法制得。
进一步地,所述金属硅化物至少包含钛金属。
进一步地,所述无边界接触窗,用以形成多重金属内连线的工艺。
进一步地,所述闸极至少包含多晶硅、磷、砷及硅化钨中的一种,采用低压化学气相沉积法制得。
进一步地,所述内层介电材料层采用化学气相沉积法制得。
由上述对本实用新型的描述可知,与现有技术相比,本实用新型具有如下有益效果:
第一,通过形成无边界接触窗,允许接触窗由于对准误差而裸露在浅沟槽隔离区上,因而可以节省布局面积,降低成本;
第二,藉由浅沟槽隔离区上部两侧的氮化硅侧隙壁,可克服翘曲效应的影响;
第三,闸极的寄生电阻会随着元件缩小而上升,在多晶硅上形成金属硅化物,可有效降低闸极电阻率;
第四,通过在源/汲级扩散区与浅沟槽隔离区之间,蚀刻一无边界接触窗,并在浅沟槽隔离区上部两侧形成氮化硅侧壁,用以作为无边界接触窗蚀刻时的阻绝层,可避免蚀刻时裸露的浅沟槽隔离区被过度蚀刻而造成接合漏电;
第五,传统工艺需蚀刻内层介电材料层,再蚀刻覆宽于扩散区与浅沟槽隔离区之上的氮化硅层,增加了蚀刻的复杂度,本实用新型只需蚀刻内层介电材料层,较之传统工艺简化了无边界接触窗的蚀刻工艺。
附图说明
图1是本实用新型具体实施方式的剖视图。
图中:1.硅底材,2.浅沟槽隔离区,3.闸极,4.闸氧化层,5.多晶硅层,6.轻掺杂汲极,7.间隙壁,8.源极,9.汲极,10.金属硅化物,11.内层介电材料层。
具体实施方式
以下通过具体实施方式对本实用新型作进一步的描述。
参照图1,本实用新型的一种具有无边界接触窗的半导体元件,至少包含:
一硅底材1,具有一浅沟槽隔离区2;
一氧化物层,形成于所述浅沟槽隔离区2内及硅底材1表面上方,通过化学机械研磨法及氧化物回蚀方式,使该氧化物层的高度低于硅底材1表面;
一氮化硅侧隙壁3,形成于所述浅沟槽隔离区2的氧化物层上部内侧,用以作为无边界接触窗的阻绝层;
一闸氧化层4与多晶硅层5,依序形成于硅底材1表面上方,用以作为半导体的闸极结构;
一轻掺杂汲极6,形成于所述闸极3与浅沟槽隔离区2之间;
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