[实用新型]一种现代电子综合实验系统有效
申请号: | 201320744761.9 | 申请日: | 2013-11-21 |
公开(公告)号: | CN203552556U | 公开(公告)日: | 2014-04-16 |
发明(设计)人: | 莫钊;曾任贤;刘志明;樊飞燕;陈谣 | 申请(专利权)人: | 南昌工程学院 |
主分类号: | G09B23/18 | 分类号: | G09B23/18 |
代理公司: | 南京同泽专利事务所(特殊普通合伙) 32245 | 代理人: | 蒋全强 |
地址: | 330000 江西*** | 国省代码: | 江西;36 |
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摘要: | |||
搜索关键词: | 一种 现代 电子 综合 实验 系统 | ||
技术领域
本实用新型涉及一种现代电子综合实验系统。
背景技术
在电专业课程中,实验是教学过程中的重要组成部分。目前,国内电子专业教学中实验项目很多,但是集成度较低,有些适用于模拟电子课程,有些适用于数字电子课程,有些还适用于单片机课程,即不同的课程涉及到的实验项目须用不同的实验仪器和设备,并且各实验仪器和设备相互独立,资源浪费大,自动化程度低,无法进行较为综合的课程设计和毕业设计。
实用新型内容
本实用新型要解决的技术问题是提供一种现代电子综合实验系统,该综合实验系统解决了一套实验系统完成多门课程的多项实验的技术问题。
为了解决上述技术问题,本实用新型提供了一种现代电子综合实验系统,包括:多处理器单元区,设有若干个用于插接处理器模块的处理器模块插口;传感器单元区,设有若干个用于插接传感器模块的传感器模块插口;数模电单元区,设有若干个用于分别插接电子测量用仪器仪表模块的仪器仪表模块插口;数模电单元区,设有若干个用于插接模数电模块的数模电模块插口;外设单元区,设有若干个用于插接外设模块的外设模块插口;以及,设有万能接插板的自由发挥单元区;插接于所述多处理器单元区的处理器模块通过数据总线与插接于传感器单元区、仪器仪表单元区、数模电单元区、外设单元区、自由发挥单元区的相应模块相连。
进一步,为了便于各模块与各相应单元区之间进行连接,所述传感器模块、处理器模块、仪器仪表模块、模数电模块、外设模块与相应各单元区之间通过欧式连接器相连。
本实用新型的上述技术方案相比现有技术具有以下优点:本实用新型通过多单元区共存,通过数据总线使插接于各单元区的相应模块进行连接通讯,实现了一机多平台,满足了不同学科的实验要求,例如:模电、数电、单片机等课程的实验需要,特别适合专业课程设计、毕业设计;并且不仅可以用于广大高校学生自主学习,及理论应用于实际的学习,及创新研究试验,而且也可以用于广大理论研究人员和工程技术人员的理论验证研究和实际工程方案的测评。
附图说明
为了使本实用新型的内容更容易被清楚的理解,下面根据的具体实施例并结合附图,对本实用新型作进一步详细的说明,其中
图1为本实用新型的实验基板中各单元区的分布图;
图2为本实用新型的处理器模块与各单元区相应模块的连接示意图;
图3为所述现代电子综合实验系统的整体结构示意图。
其中,传感器单元区1、多处理器单元区2、仪器仪表单元区3、数模电单元区4、外设单元区5、自由发挥单元区6、设备状态检测区7、实验基板8-1、实验系统的上半部分8、实验系统的下半部分9、操作台9-1、显示器托盘9-2、PC机柜9-3、键盘托盘9-4、模块存放区9-5。
具体实施方式
下面结合附图及实施例对本发明进行详细说明:
见图1和图2、一种现代电子综合实验系统,包括:实验基板8-1,所述实验基板8-1包括:
多处理器单元区2,设有若干个用于插接处理器模块的处理器模块插口;传感器单元区1,设有若干个用于插接传感器模块的传感器模块插口;数模电单元区3,设有若干个用于分别插接电子测量用仪器仪表模块的仪器仪表模块插口;数模电单元区4,设有若干个用于插接模数电模块的数模电模块插口;外设单元区5,设有若干个用于插接外设模块的外设模块插口;以及,设有万能接插板的自由发挥单元区6;插接于所述多处理器单元区2的处理器模块通过数据总线与插接于传感器单元区1、仪器仪表单元区3、数模电单元区4、外设单元区5、自由发挥单元区6的相应模块相连,且设备状态检测区7也通过数据总线与所述处理器模块相连,该设备状态检测区用于检测各模块运行是否正常。
所述数据总线包括:串行总线、并行总线、GPIO。
所述传感器模块、处理器模块、仪器仪表模块、模数电模块、外设模块与相应各单元区之间通过欧式连接器相连。该欧式连接器可以采用中国专利文献CN 2773938Y 欧式连接器的技术方案,处理器模块也可以采用 D型插板连接器,中国专利文献CN 201478501 U D型插板连接器的技术方案。
所述现代电子综合实验系统还包括开关电源,所述开关电源分别设有多路输出端,适于提供各模块相应的电压。
图2示出了处理器模块与各单元区相应模块之间的连接总线关系,为了清楚的说明问题,图中仅例举了相应典型模块。
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