[实用新型]基于OpenVPX标准的主控器有效
申请号: | 201320603521.7 | 申请日: | 2013-09-25 |
公开(公告)号: | CN203588122U | 公开(公告)日: | 2014-05-07 |
发明(设计)人: | 何浩 | 申请(专利权)人: | 北京国科环宇空间技术有限公司 |
主分类号: | G06F1/16 | 分类号: | G06F1/16 |
代理公司: | 北京德琦知识产权代理有限公司 11018 | 代理人: | 周华霞;王丽琴 |
地址: | 100190 北京市*** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 基于 openvpx 标准 主控 | ||
1.一种基于OpenVPX标准的主控器,其特征在于,该主控器包括:P0连接器、P1连接器和P2连接器,P0连接器、P1连接器和P2连接器与OpenVPX设备的背板连接;还包括通过扩展外设部件互联标准PCIe总线与所述P1连接器和所述P2连接器连接的PCIe切换芯片,以及通过PCIe总线与所述PCIe切换芯片进行连接的MPC8536处理器;所述PCIe切换芯片将MPC8536处理器的PCIe接口转换成至少两个PCIe接口,通过转换后的PCIe接口与所述P1连接器和所述P2连接器进行连接。
2.如权利要求1所述的主控器,其特征在于,该主控器还包括PCIe转SATA芯片,所述PCIe转SATA芯片将PCIe切换芯片的PCIe接口转换为串行标准硬盘接口SATA,通过SATA与所述P1连接器和所述P2连接器进行连接。
3.如权利要求1或2所述的主控器,其特征在于,该主控器还包括与MPC8536处理器连接的复杂可编程逻辑器件CPLD芯片,还包括分别与所述CPLD芯片连接的复位芯片、联合测试行为组织JTAG芯片、Flash系统和网络芯片,所述联合测试行为组织JTAG芯片、Flash系统和网络芯片还分别与所述MPC8536处理器连接;
所述复位芯片将复位信号发送给所述CPLD芯片,所述CPLD芯片将复位信号发送给所述MPC8536处理器、所述PCIe转SATA芯片、所述PCIe切换芯片、所述JTAG芯片、所述Flash系统和所述网络芯片进行复位。
4.如权利要求3所述的主控器,其特征在于,该主控器还包括与所述MPC8536处理器连接的双倍数据率DDR芯片。
5.如权利要求4所述的主控器,其特征在于,所述Flash系统包括Nor Flash芯片和NAND Flash芯片。
6.如权利要求4所述的主控器,其特征在于,所述主控器还包括与所述P0连接器连接的电压转换芯片组,以及与所述电压转换芯片组连接的电源管理芯片;所述P0连接器连接背板上的5V电源和3.3V_AUX电源,还连接智能平台管理接口IPMI总线;所述电压转换芯片组将5V电源转换为目标电源,为所述DDR芯片供电,所述电源管理芯片还将目标电源转换为3.3V_AUX电源,通过P0连接器输出给背板。
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