[实用新型]光纤熔接机图像采集存储装置有效
申请号: | 201320328373.2 | 申请日: | 2013-06-07 |
公开(公告)号: | CN203313295U | 公开(公告)日: | 2013-11-27 |
发明(设计)人: | 李楚元 | 申请(专利权)人: | 大豪信息技术(威海)有限公司;(株)韩国一诺仪器株式会社;李楚元 |
主分类号: | H04N5/232 | 分类号: | H04N5/232;H04N7/18;H04N5/272 |
代理公司: | 上海金盛协力知识产权代理有限公司 31242 | 代理人: | 段迎春 |
地址: | 264207 山*** | 国省代码: | 山东;37 |
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摘要: | |||
搜索关键词: | 光纤 熔接 图像 采集 存储 装置 | ||
技术领域
本实用新型属于光纤维护技术领域,尤其适合于光纤熔接机图像采集存储装置。
背景技术
目前全球市面上出现各种各样的光纤熔接机,其是基于正交定位的光纤图像,从X/Y正交的方位将光纤的物理位置包括光纤断面、边缘确定,通过对芯机构将光纤对准,然后产出高压电弧,将光纤断面熔接。这种方式的关键技术在于如何采集光纤的位置数据存储并处理,从而准确地定位光纤断面及边沿。
目前,光纤熔接机图像采集、存储装置通常是采用CMOS摄像头获取图像的数字视频信号,在数据采集上采用将X/Y两路图像数据由FPGA模块存储到静态存储器。但对于用户高质量的显示需求,即在前景文字和光纤动态图像显示两层外还有背景图片层,这就要求大的图像数据存储容量和显示缓冲容量,则现有技术采用的FPGA外接静态存储器是无法实现的。
实用新型内容
本实用新型的目的是提供一种有大容量图像存储能力的光纤熔接机图像采集存储装置。
实现本实用新型的方法是:一种光纤熔接机图像采集存储装置,包括有FPGA模块、控制单元,还包括有用于采集光纤熔接机图像的图像采集单元,所述FPGA模块外挂动态随机存储单元,FPGA模块读取图像采集单元采集到的图像数据信号并将其存入动态随机存储单元中;控制单元通过FPGA模块从动态随机存储单元中读取图像数据进行分析、处理。
所述图像采集单元X和图像采集单元Y正交设置。
优选的图像采集单元数据是8位,控制单元与FPGA模块是16位接口,FPGA模块将第一次读取的单个图像采集单元数据与第二次读取的同一图像采集单元数据合并为16位存入动态随机存储单元中。
优选的动态随机存储单元是DRAM、SDRAM、DDR、DDR2、DDR3或DDR4中的任一种。
本实用新型的有益效果是:本实用新型熔接机图像采集存储装置实现了高质量显示要求,提高了系统稳定性,满足大容量数据存储,降低了设备制造成本。
附图说明
为了更清楚地说明本实用新型或现有技术中的技术方案,下面将对实施例或现有技术描述中所需要使用的附图作简单介绍。显而易见,下面描述中的附图仅仅是本实用新型的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动的前提下,还可以根据这些附图获得其它的附图。
图1为本实用新型结构图;
图2为本实用新型的三种显示内容优先顺序流程图;
图3为本实用新型LCD上的动态图像显示组合方式。
其中,图3中为两根光纤对接动态图像。
具体实施方式
下面将结合附图,对本实用新型实施例中的技术方案进行清楚、完整地描述,显然,所描述的实施例仅是本实用新型一部分实施例,而不是全部实施例。基于本实用新型中的实施例,本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其它实施例,都属于本实用新型保护的范围。
如图1所示,在一块FPGA(Field-Programmable Gate Array,即现场可编程门阵列集成电路)模块2中设置有显示控制器,负责显示控制。图像采集单元X和图像采集单元Y采用CMOS摄像头或者CCD摄像头(Charge Coupled Device,即电荷耦合器),其内装有CMOS(Complementary Metal-Oxide-Semiconductor,即互补金属氧化物半导体芯片)传感器芯片,CMOS传感器芯片与控制单元1之间有数据连接。FPGA模块2外挂动态随机存储单元3,该存储单元3作为显示缓冲区和图像数据存储区。工作时,FPGA模块2读取CMOS芯片采集到的光纤图像并把图像数据按显示要求送到外挂动态随机存储单元3里,当控制单元1请求读取图像数据时,FPGA模块2也能把当前CMOS采集图像送给控制单元1读取。本处控制单元1优选嵌入式CPU(Central Processing Unit,即微处理器)。
CPU需要读取CMOS摄像头数据时,先给FPGA模块2发送请求命令,命令字节中包含着是对哪一个摄像头请求读取数据。当FPGA准备好图像后,CPU就可以直接读取FPGA已经存储好在动态随机存储单元3里的图像了。如实施例中摄像头数据是8bit的,而CPU与FPGA是16位接口,FPGA模块将第一次读取的单个图像采集单元数据与第二次读取的同一图像采集单元数据合并为16位存入动态随机存储单元中。CPU读完之后,给FPGA发一个命令,表示图像数据已经读取完毕。当然CPU与FPGA也可改成其它位数接口。
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