[实用新型]变电站测控用对时系统有效

专利信息
申请号: 201320154101.5 申请日: 2013-03-30
公开(公告)号: CN203191748U 公开(公告)日: 2013-09-11
发明(设计)人: 潘爱强;曾平;张浙波;罗裬;朱奕帆 申请(专利权)人: 国家电网公司;上海市电力公司;华东电力试验研究院有限公司
主分类号: G05B19/042 分类号: G05B19/042
代理公司: 上海三和万国知识产权代理事务所(普通合伙) 31230 代理人: 张民华
地址: 100031 *** 国省代码: 北京;11
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摘要:
搜索关键词: 变电站 测控 系统
【说明书】:

技术领域

实用新型涉及电力技术领域,尤其涉及变电站测控。

背景技术

目前变电站的二次设备均要进行对时,以便变电站的信息数据均带上时标,或者设备间能通过同步进行数据信息合成,生产更有用的数据,一般配置一套统一的时钟同步系统,以对各二次设备进行对时。智能变电站使传统变电站的电缆通过网络化变为光缆,而智能化变电站后没有变为光缆留下的电缆大部分将变为时间同步的同轴电缆。变电站要同步对时的设备包括站控层、间隔层、过程层设备。不同的设备对同步对时的精度要求不一样,站控层利用下层的时标信息,对精度要求不高;对过程层设备,因为其为最底层的原始信息,对精度要求最高;间隔层设备介于二者之间,如要采用时间补偿算法对底层时标信息进行同步校正,则精度要求也相对较高,如差动保护、同步相量系统等。

实用新型内容

本实用新型的目的在于,提供一种变电站测控用对时系统,以解决上述技术问题。

本实用新型所解决的技术问题可以采用以下技术方案来实现:

变电站测控用对时系统,包括一测控装置、一高精度对时同步采样脉冲模块、对时信号采集电路、控制输出电路,其特征在于,还包括一DAC板、一CPU板,所述DAC板上焊接有第一高精度对时同步采样脉冲模块和第一MPC8313模块,所述CPU板上焊接有第二高精度对时同步采样脉冲模块、第二MPC8313模块和测控装置,所述第一高精度对时同步采样脉冲模块和第二高精度对时同步采样脉冲模块之间通信连接。

所述高精度对时同步采样脉冲模块可以是一采用FPGA可编程器件的对时和同步采样脉冲模块,该模块接受GPS IRIG-B码差分或1PPM、1PPS光纤脉冲对时信号,输出5k、10k高速同步采样脉冲和GPS对时时标。

所述测控装置采用DSP处理器,所述DSP处理器通过并行总线连接高精度对时同步采样脉冲模块。所述DSP处理器的芯片采用TMS320F28335芯片。

IEC61588对时可以在主CPU和DAC板的MPC8313实现,具有两路独立的对时网口。两路对时根据IEC61588对时原理分别处理对时报文,并计算MPC8313和主钟的时间差,由最佳主时钟算法从两路对时中选择一路作为主对时源,并输出年月日时分秒和1pps给FPGA,如果经过算法判断两路对时均无效,则年月日时分秒输出为0。FPGA根据年月日时分秒是否为0判断当前IE61588对时有效性。

当配置DAC板时,装置具有多个对时源,所有对时首先发送到CPU板的FPGA,由该FPGA将各对时源状态发送给CPU板的MPC8313,MPC8313根据各对时源的优先级选择一个最佳对时源,并将选择结果送给CPU板的FPGA,该FPGA使用最佳对时源的对时信息同步系统所有CPU芯片。FPGA可编程器件为具有DSP功能的Spartan-3A系列FPGA可编程器件。

附图说明

图1为本实用新型的电路框图。

具体实施方式

为了使本实用新型实现的技术手段、创作特征、达成目的与功效易于明白了解,下面结合具体图示进一步阐述本实用新型。

变电站测控用对时系统,包括一测控装置、一高精度对时同步采样脉冲模块、对时信号采集电路、控制输出电路,还包括一DAC板、一CPU板,第一高精度对时同步采样脉冲模块和第一MPC8313模块焊接在DAC板上,第二高精度对时同步采样脉冲模块、第二MPC8313模块和测控装置焊接在CPU板上,第一高精度对时同步采样脉冲模块和第二高精度对时同步采样脉冲模块之间通信连接。

高精度对时同步采样脉冲模块可以是一采用FPGA可编程器件,接受GPSIRIG-B码差分或1PPM、1PPS光纤脉冲对时信号,输出5k、10k高速同步采样脉冲和GPS对时时标的对时和同步采样脉冲模块。

测控装置采用DSP处理器,DSP处理器通过并行总线连接高精度对时同步采样脉冲模块

参照图1,IEC61588对时可以在主CPU和DAC板的MPC8313实现,具有两路独立的对时网口。两路对时根据IEC61588对时原理分别处理对时报文,并计算MPC8313和主钟的时间差,由最佳主时钟算法从两路对时中选择一路作为主对时源,并输出年月日时分秒和1pps给FPGA,如果经过算法判断两路对时均无效,则年月日时分秒输出为0。FPGA根据年月日时分秒是否为0判断当前IE61588对时有效性。

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