[实用新型]像素电路、阵列基板及显示装置有效
申请号: | 201320128825.2 | 申请日: | 2013-03-20 |
公开(公告)号: | CN203165421U | 公开(公告)日: | 2013-08-28 |
发明(设计)人: | 曾勉;尹傛俊;涂志中;金在光 | 申请(专利权)人: | 合肥京东方光电科技有限公司;京东方科技集团股份有限公司 |
主分类号: | G09G3/32 | 分类号: | G09G3/32;G09G3/20 |
代理公司: | 北京天昊联合知识产权代理有限公司 11112 | 代理人: | 柴亮;张天舒 |
地址: | 230011 安*** | 国省代码: | 安徽;34 |
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摘要: | |||
搜索关键词: | 像素 电路 阵列 显示装置 | ||
技术领域
本实用新型属于有机发光显示技术领域,具体涉及一种像素电路、阵列基板及显示装置。
背景技术
有机发光显示器(Organic Light Emitting Diode,OLED)相比现在的主流显示技术薄膜晶体管液晶显示器(Thin Film Transisitor Liquid Crystal Display,TFT-LCD),具有广视角、高亮度、高对比度、低能耗、体积更轻薄等优点,是目前平板显示技术关注的焦点。
有机发光显示器的驱动方法分为被动矩阵式(PM,Passive Matrix)和主动矩阵式(AM,Active Matrix)两种。而相比被动矩阵式驱动,主动矩阵式驱动具有显示信息量大、功耗低、器件寿命长、画面对比度高等优点。现有技术的一种主动矩阵式有机发光显示器的像素单元驱动电路的等效电路,如图1所示,包括:第一开关晶体管M1、驱动晶体管M2、存储电容C1以及发光器件D1。其中,第一开关晶体管M1的漏极与驱动晶体管M2的栅极连接;驱动晶体管M2的栅极同时连接存储电容C1的一端,其源极与存储电容C1另一端连接,其漏极与发光器件D1连接。第一开关晶体管M1在栅极被扫描信号Vscan(n)选通时打开,从源极引入数据信号Vdata。驱动晶体管M2一般工作在饱和区,其栅源电压Vgs决定了流过其电流的大小,进而为发光器件D1提供了稳定的电流。其中Vgs=Vdata-VD1,VD1为发光器件D1的开启电压,VDD为稳压或者稳流电源,连接驱动晶体管M2,用于提供发光器件D1发光所需要的能源。而存储电容C1的作用是在一帧的时间内维持驱动晶体管M2栅极电压的稳定。
当扫描信号Vscan(n)的第一个高电平开始时,第n行像素单元被选通,将该行像素单元中的第一开关晶体管M1打开,引入数据信号驱动Vdata,发光器件D1开始发光。通过驱动数据信号Vdata的高电平使发光器件D1发光将该行像素单元中的存储电容C1充电完成,之后,通过扫描信号Vscan(n)的第一个低电平关闭该行像素单元的第一开关晶体管M1。此时,存储电容C1维持充电时的电压,维持该行像素单元的驱动晶体管M2输出稳定的电流,使得该行像素单元的有机发光二级管D1持续发光直到一帧时间结束。一帧时间通常为同一行像素单元连续两次被扫描信号选通的时间间隔。
在第n行像素单元的充电完成后,扫描信号选通第n+1行像素单元,将第n+1行像素单元的第一开关晶体管M1打开,引入驱动数据信号进行同样的充电过程,充电完成后通过像素单元中的存储电容C1维持充电时的电压,维持驱动管输出稳定电流,使得n+1行像素单元的发光器件D1持续发光直到一帧时间结束。如此依序下去,当对最后一行像素单元充电完成后,便又从第一行像素单元开始重新扫描充电。
尽管现有技术像素单元电路被广泛使用,但是其仍然必不可免的存在以下问题:驱动晶体管M2的阈值电压Vth会随着使用时间的增加而出现漂移,从而导致针对同样的数据驱动信号Vdata的Vgs出现变化,即发光器件D1的电流(也就是亮度)不同,从而将会影响整个有机发光显示器的画面均匀性及其发光质量。
实用新型内容
本实用新型所要解决的技术问题包括,针对现有的像素单元电路中由于驱动晶体管阈值电压漂移等原因引起电路不稳定,导致有机发光显示器的画面均匀性及其发光质量差的问题,提供一种可以有效地补偿驱动晶体管阈值电压的不均匀性,使得有机发光显示器的画面均匀性提高的像素电路、阵列基板及显示装置。
解决本实用新型技术问题所采用的技术方案是一种像素电路,包括:驱动晶体管、第一开关晶体管、存储电容、发光器件管以及阈值补偿电路;所述阈值补偿电路由第二开关晶体管、第三开关晶体管、第四开关晶体管以及耦合电容构成;
所述第一开关晶体管的栅极接第一扫描信号,所述第一开关晶体管的源极接数据信号输入端,所述第一开关晶体管的漏极接存储电容第一端、耦合电容的第一端以及第二开关晶体管的源极;
所述存储电容的第二端接电源电压同时接所述驱动晶体管的源极;
所述第二开关晶体管的栅极接第二扫描信号同时接所述第三开关晶体管的栅极,所述第二开关晶体管的漏极接电源负极端;
所述第三开关晶体管的源极接所述驱动晶体管的栅极,所述第三开关晶体管的漏极接所述驱动晶体管的漏极同时接所述第四开关晶体管的源极;
所述第四开关晶体管的栅极接第一控制信号,所述第四开关晶体管的漏极接所述发光器件;
所述耦合电容的第二端与所述驱动晶体管的栅极相连。
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