[发明专利]多线程处理单元中的高效存储器虚拟化有效
| 申请号: | 201310512294.1 | 申请日: | 2013-10-25 |
| 公开(公告)号: | CN103777926B | 公开(公告)日: | 2019-09-06 |
| 发明(设计)人: | 尼克·巴罗威廉姆斯;布雷恩·法斯;杰尔姆·F·小杜鲁克;詹姆士·勒罗伊·德明;蒂莫西·约翰·珀塞尔;卢森·邓宁;马克·海尔格罗夫 | 申请(专利权)人: | 辉达公司 |
| 主分类号: | G06F9/50 | 分类号: | G06F9/50;G06F12/109 |
| 代理公司: | 北京市磐华律师事务所 11336 | 代理人: | 谢栒;魏宁 |
| 地址: | 美国加利*** | 国省代码: | 美国;US |
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| 摘要: | |||
| 搜索关键词: | 多线程 处理 单元 中的 高效 存储器 虚拟 | ||
1.一种用于在并行处理器内并发地执行具有不同虚拟地址空间的两个或更多个线程程序的方法,所述方法包括:
检索与由第一地址空间标识符(ASID)所标识的第一虚拟地址空间相关联的第一页表;
基于所述第一ASID,经由所述第一页表实施第一查找操作,以生成从第一虚拟地址到第一物理地址的第一映射;以及
将所述第一映射存储在包括在第一转译后备缓冲区(TLB)内的条目中,所述第一转译后备缓冲区与所述第一虚拟地址空间并且与第一流多处理器相关联,其中所述TLB包括多个条目,所述多个条目包括存储在所述TLB内的所有条目,并且每个条目包括虚拟地址到物理地址的映射,
其中第一命令将所述第一页表与所述第一ASID相关联,并且使得包括在所述多个条目中的每个所述虚拟地址到物理地址的映射无效,所述多个条目存储在所述第一TLB内,并且响应于由第二TLB所生成的第二未命中,基于第二ASID,经由第二页表来实施第二查找操作以生成从第二虚拟地址到第二物理地址的第二映射;以及将所述第二映射存储为所述第二TLB内的条目。
2.一种并行处理子系统,包括并行处理器,其配置为:
检索与由第一地址空间标识符(ASID)所标识的第一虚拟地址空间相关联的第一页表;
基于所述第一ASID,经由所述第一页表实施第一查找操作,以生成从第一虚拟地址到第一物理地址的第一映射;以及
将所述第一映射存储在包括在第一转译后备缓冲区(TLB)内的条目中,所述第一转译后备缓冲区与所述第一虚拟地址空间并且与第一流多处理器相关联,其中所述TLB包括多个条目,所述多个条目包括存储在所述TLB内的所有条目,并且每个条目包括虚拟地址到物理地址的映射,
其中第一命令将所述第一页表与所述第一ASID相关联,并且使得包括所述多个条目中的每个所述虚拟地址到物理地址的映射无效,所述多个条目存储在所述第一TLB内,并且响应于由第二TLB所生成的第二未命中,基于第二ASID,经由第二页表来实施第二查找操作以生成从第二虚拟地址到第二物理地址的第二映射;以及将所述第二映射存储为所述第二TLB内的条目。
3.根据权利要求2所述的并行处理子系统,其中所述并行处理子系统进一步配置为检索与由第二ASID所标识的第二虚拟地址空间相关联的第二页表,并且执行第二线程程序以生成包括所述第二ASID和所述第二虚拟地址空间内的第二虚拟地址的第二访问请求。
4.根据权利要求2所述的并行处理子系统,其中所述第一映射包含包括所述第一ASID和所述第一虚拟地址的标签,所述第二映射包含包括所述第二ASID和所述第二虚拟地址的标签。
5.根据权利要求3所述的并行处理子系统,其中用于所述并行处理子系统的执行上下文包括所述第一页表、第一线程程序、所述第二页表以及所述第二线程程序。
6.根据权利要求3所述的并行处理子系统,其中所述第一页表生成自第一应用上下文页表,所述第二页表生成自第二应用上下文页表。
7.根据权利要求3所述的并行处理子系统,其中在相同的处理核心内执行第一线程程序和所述第二线程程序。
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