[发明专利]放大器电路有效
| 申请号: | 201310471428.X | 申请日: | 2013-10-11 |
| 公开(公告)号: | CN103731111A | 公开(公告)日: | 2014-04-16 |
| 发明(设计)人: | 山崎善一 | 申请(专利权)人: | 佳能株式会社 |
| 主分类号: | H03F3/45 | 分类号: | H03F3/45 |
| 代理公司: | 中国国际贸易促进委员会专利商标事务所 11038 | 代理人: | 康建忠 |
| 地址: | 日本*** | 国省代码: | 日本;JP |
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| 摘要: | |||
| 搜索关键词: | 放大器 电路 | ||
技术领域
本发明涉及放大器电路。
背景技术
日本专利公开No.5-226948公开了包含恒流源、放大器输入级、电平偏移级和多个输出电路的多输出放大器。在该多输出放大器中,多个输出电路共享恒流源、放大器输入级和电平偏移级,由此抑制芯片面积的增加。
在日本专利公开No.5-226948中公开的多输出放大器没有停止不处于使用中的输出电路的操作。当负载与不处于使用中的输出电路连接时,不处于使用中的输出电路会以诸如串扰的方式不利地影响使用中的输出电路。另外,用于使不处于使用中的输出电路操作的偏置电流消耗功率。
发明内容
本发明提供了有利于减少串扰和/或功耗的技术。
本发明的一个方面提供了一种放大器电路,该放大器电路包括:差分放大器电路,被配置为放大输入到第一输入端子的信号与输入到第二输入端子的信号之间的电压;多个输出电路,每一输出电路被配置为输出与从差分放大器电路输出的信号对应的信号;和控制电路,被配置为将多个输出电路中的选择的一个输出电路设定为操作状态以驱动所选择的输出电路的输出端子,并且将其余的输出电路设定为非操作状态以及将其余的输出电路的输出端子设定为高阻抗状态。
(参照附图)阅读示例性实施例的以下描述,本发明的其它特征将变得清晰。
附图说明
图1是示出根据第一实施例的放大器电路的布置的框图;
图2是示出第一实施例的放大器电路中的多个输出电路的第一布置例子的电路图;
图3是示出第一实施例的放大器电路中的差分放大器电路的布置例子的电路图;
图4是示出第一实施例的放大器电路中的多个输出电路的第二布置例子的电路图;
图5A~5D是示出第一实施例的放大器电路中的多个输出电路的第三布置例子的电路图;
图6是示出第一实施例的放大器电路中的多个输出电路的第四布置例子的电路图;
图7是示出根据第二实施例的放大器电路的布置的电路图;
图8是示出根据第三实施例的放大器电路的布置的电路图;以及
图9A和图9B是根据第四实施例的放大器电路的布置的电路图和波形图。
具体实施方式
现在将根据附图详细描述本发明的优选实施例。注意,为了便于描述,在以下的描述和附图中,端子和与端子对应的信号由相同的名称表示。
图1示出根据本发明的第一实施例的放大器电路100的布置。放大器电路100被布置为具有多个输出端子O1和O2的差分放大器。放大器电路100从多个输出端子O1和O2中的选择的一个输出端子输出如下这样的信号,该信号是通过放大输入到非反相输入端子(第一输入端子)INP的信号INP和输入到反相输入端子(第二输入端子)INN的信号INN之间的电压获得的。放大器电路100包含差分放大器电路30、多个输出电路10和20以及控制电路40。
差分放大器电路30放大输入到非反相输入端子(第一输入端子)INP的信号INP和输入到反相输入端子(第二输入端子)INN的信号INN,并且输出驱动信号BP和BN。驱动信号BP和BN是用于驱动多个输出电路10和20的信号。多个输出电路10和20输出与从差分放大器电路30输出的驱动信号BP和BN对应的信号。注意,输出电路10从输出端子O1输出与驱动信号BP和BN对应的信号O1,并且,输出电路20从输出端子O2输出与驱动信号BP和BN对应的信号O2。
控制电路40将多个输出电路10和20中的选择的一个输出电路设定为操作状态以驱动所选择的输出电路的输出端子。控制电路40将多个输出电路10和20中的除所选择的一个输出电路以外的输出电路(未被选择的输出电路)设定为非操作状态,并且将未被选择的输出电路的输出端子设定为高阻抗状态。多个输出电路10和20中的所选择的一个输出电路的输出端子被设定为低阻抗状态。当将未被选择的输出电路设定为非操作状态并且将未被选择的输出电路的输出端子设定为高阻抗状态时,降低功耗。另外,这使得能够减少来自未被选择的输出电路的串扰对于所选择的输出电路的影响。
控制电路40根据控制信号φ1和φ2控制多个输出电路10和20中的处于操作状态中的输出电路和处于非操作状态中的输出电路。在这种情况下,输出电路的数量可以为三个或更多个。控制电路40可将多个输出电路中的全部或一些设定为选择状态。当多个输出电路中的一些要被设定为选择状态时,控制电路将其余的输出电路设定为未被选择状态。
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