[发明专利]能够减轻漏电流影响的增益控制电路与方法有效
申请号: | 201310364488.1 | 申请日: | 2013-08-20 |
公开(公告)号: | CN104426487B | 公开(公告)日: | 2017-09-15 |
发明(设计)人: | 江明澄;徐元平;高立龙 | 申请(专利权)人: | 瑞昱半导体股份有限公司 |
主分类号: | H03F3/20 | 分类号: | H03F3/20 |
代理公司: | 北京康信知识产权代理有限责任公司11240 | 代理人: | 余刚,吴孟秋 |
地址: | 中国台*** | 国省代码: | 台湾;71 |
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摘要: | |||
搜索关键词: | 能够 减轻 漏电 影响 增益 控制电路 方法 | ||
技术领域
本发明是关于增益控制电路与方法,尤其是关于能够减轻漏电流影响的增益控制电路与方法。
背景技术
一般可调式增益电路或混合信号增益电路具有多个增益路径可供选择,每个增益路径上具有一开关,通过控制这些开关的启闭即可选择想要的增益路径,换句话说,通过控制这些开关,可使这些增益路径的其中之一导通,并使其余的增益路径不导通,由此透过该导通的增益路径将一输入信号进行放大。一般而言,上述开关是由MOS晶体管来实现,然而MOS晶体管或多或少会有漏电流的问题,尤其当该增益电路的输入信号愈大时,原本应该不导通的MOS晶体管的漏电流也会相对应地变大,此时这些漏电流会干扰到导通的增益路径,并使得总谐波失真(Total Harmonic Distortion)上升。
发明内容
鉴于先前技术的不足,本发明的一目的在于提供一种增益控制电路与方法,以改善漏电流的问题。
本发明揭露了一种能够减轻漏电流影响的增益控制电路。依据本发明的一实施例,该增益控制电路包含:至少一信号输入端,用来接收至少一输入信号;一信号输出端,用来输出一输出信号;一放大器,耦接于一放大器输入端与该信号输出端之间;以及多个增益架构(Scheme),每个该增益架构设于该至少一信号输入端与该信号输出端之间,当这些增益架构的其中之一用来产生该输出信号时,其余增益架构即停止提供增益作用,并分别透过各自的接地路径来排除漏电流。上述增益架构包含一第一增益架构与一第二增益架构,该第一增益架构包含:一第一节点;一第一信号路径,用来依据一第一控制信号经由该第一节点电性连接或断开该至少一信号输入端与该放大器输入端;以及一第一接地路径,用来依据该第一控制信号的反相信号电性连接或断开该第一节点与一参考电压端,当该第一信号路径经由该第一节点电性连接该至少一信号输入端与该放大器输入端时,该第一接地路径电性断开该第一节点与该参考电压端。另外,该第二增益架构包含:一第二节点;一第二信号路径,用来依据一第二控制信号经由该第二节点电性连接或断开该至少一信号输入端与该放大器输入端;以及一第二接地路径,用来依据该第二控制信号的反相信号电性连接或断开该第二节点与该参考电压端,当该第二信号路径经由该第二节点电性连接该至少一信号输入端与该放大器输入端时,该第二接地路径电性断开该第二节点与该参考电压端。
本发明亦揭露了一种能够减轻漏电流影响的增益控制方法,通过本发明的增益控制电路或其等效电路来执行。依据本发明的一实施例,该方法包含下列步骤:一信号接收步骤,用来接收至少一输入信号;一信号产生步骤,用来依据该至少一输入信号与一增益值产生一输出信号;以及一增益选择步骤,用来选择多个增益架构的其中之一以决定该增益值,其中每个该增益架构形成于该至少一输入信号与该输出信号之间,且包含一信号路径与一接地路径,当被选择的增益架构依据该输入信号经由本身的信号路径输出该输出信号时,其余增益架构即分别经由本身的接地路径将可能的漏电流引导至一参考电压端(例如一接地端)。详言之,上述增益选择步骤包含:从该多个增益架构中选择一目标增益架构;电性导通该目标增益架构的信号路径,并电性断开该目标增益架构的接地路径;以及电性导通该目标增益架构以外的每个该增益架构的接地路径,并电性断开该目标增益架构以外的每个该增益架构的信号路径。
本发明另揭露了一种能够减轻漏电流影响的增益控制电路。依据本发明的一实施例,该增益控制电路包含:一放大器,具有一输入端及一输出端;一输入阻抗电路,耦接于一信号输入端与该输入端之间,用来形成多个输入阻抗的其中之一,其中该多个输入阻抗包含一第一输入阻抗与一第二输入阻抗;以及一输出阻抗电路,耦接于该输入端与该输出端之间,用来形成多个输出阻抗的其中之一或一固定输出阻抗,其中,当一信号经由该信号输入端、该第一输入阻抗及该输出阻抗电路输出时,耦接于该第二输入阻抗与该输入端之间的一开关不导通,且该开关经由另一开关接地。
有关本发明的特征、实施与功效,现结合图式作较佳实施例详细说明如下。
附图说明
图1为本发明的增益控制电路的一实施例的示意图;
图2a为图1的增益控制电路的一实施方式的示意图;
图2b为图2a的模拟输入增益电路的第一增益架构的示意图;
图2c为图2a的模拟输入增益电路的第二增益架构的示意图;
图3a为图1的增益控制电路的另一实施方式的示意图;
图3b为图3a的模拟混合信号增益电路的第一增益架构的示意图;
图3c为图3a的模拟混合信号增益电路的第二增益架构的示意图;以及
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