[发明专利]基于包的时序测量有效

专利信息
申请号: 201280064720.3 申请日: 2012-11-16
公开(公告)号: CN104054298A 公开(公告)日: 2014-09-17
发明(设计)人: 阿尔内·克里斯托弗森;莫滕·泰尔什翠普 申请(专利权)人: 维特赛半导体公司
主分类号: H04L7/04 分类号: H04L7/04;H04L12/28
代理公司: 北京律盟知识产权代理有限责任公司 11287 代理人: 薛晶晶
地址: 美国加利*** 国省代码: 美国;US
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摘要:
搜索关键词: 基于 时序 测量
【说明书】:

背景技术

发明一股来说涉及时钟的同步,且更特定来说涉及包交换通信网络中的延迟测量及/或时钟同步。

在连网系统中网络中的装置具有共用时基可为有利的。举例来说,所述共用时基可用以触发传感器网络中的经协调测量实例或协调工业系统中的控制器的动作或协调在无线通信系统中使用的时间间隔。

电子行业已开发供在使时钟同步中使用的数种标准协议,举例来说,IEEE标准1588的网络时间协议(NTP)及精确时间协议(PTP)。PTP包含在通信网络中的节点之间发送时序相关消息。举例来说,所述时序相关消息包含节点发射经加时间戳的包以将其时基供应到另一节点及节点发射请求接收节点以接收时间进行回复的包。对时序相关消息的高效处置是有益的以便避免干扰其它通信。此外,处置时序相关消息中的任何误差可不利于准确的时钟同步。

发明内容

本发明的一些方面提供一种确定包在通信网络上的渡越时间的方法,其包括:给从通信装置的物理层部分提供一包,所述包包含指示所述从通信装置对所述包的大致发射时间的值;使所述从通信装置的所述物理层部分将校正值插入到所述包中,所述校正值指示所述从通信装置对所述包的所述大致发射时间与实际发射时间之间的差;由所述从通信装置的所述物理层部分将所述包发射到主通信装置;由所述从通信装置从所述主通信装置接收响应包,所述响应包包含指示所述主通信装置对所述包的接收时间的时间值及所述校正值的指示;及使用所述大致发射时间、所述校正值的所述指示及所述主通信装置的所述接收时间来计算所述包在所述通信网络上的所述渡越时间。

本发明的另一方面提供一种用于确定包在通信网络上的渡越时间的网络通信装置,其包括:至少一个端口,其用于发射及接收网络包;较高层,其经配置以将包提供到物理层,所述包中的至少一些包包含指示所述通信装置对所述包的大致发射时间的值;且所述物理层经配置以:将校正值插入于所述包中的至少一些包中,所述校正值指示所述通信装置对所述包的所述大致发射时间与实际发射时间之间的差;在通信网络上将所述包发射到主通信装置;从所述主通信装置接收响应包,所述响应包中的至少一些响应包包含指示所述主通信装置对所述包的接收时间的时间值及所述校正值。

本发明的另一方面提供一种用于确定包在通信网络上的渡越时间的方法,其包括:由从通信装置的物理层部分从媒体接入控制器(MAC)接收包,所述包包含指示所述从通信装置对所述包的大致发射时间的值;修改所述包的校正字段以指示所述从通信装置对所述包的所述大致发射时间与实际发射时间之间的差;在通信网络上将所述包从所述从通信装置的所述物理层部分发射到主通信装置;由所述从通信装置从所述主通信装置接收响应包,所述响应包包含指示所述主通信装置对所述包的接收时间的时间值及校正值;及使用所述大致发射时间、所述校正值及所述主通信装置的所述接收时间来计算所述包在所述通信网络上的所述渡越时间。

在审阅本发明后会更全面地领会本发明的这些及其它方面。

附图说明

图1是根据本发明的方面的通信系统的框图;

图2是根据本发明的方面由较高层部分执行的时间戳相关过程的流程图;

图3是根据本发明的方面由物理层部分执行的发射时间戳相关过程的流程图;

图4是根据本发明的方面由物理层部分执行的接收时间戳相关过程的流程图;

图5是根据本发明的方面包含耦合到通信网络的通信装置的框图;且

图6是根据本发明的方面用于处置时序信息的过程的流程图。

具体实施方式

图1是根据本发明的方面的通信系统的框图。所述系统包含主通信装置111及从通信装置113。主通信装置111与从通信装置113通过通信网络121进行通信。通信网络121包含在所述装置之间以及可能地其它通信装置(例如交换机或路由器或其它网络节点)之间的物理链路。

举例来说,所述从通信装置包含耦合到所述通信网络的物理层部分113b。所述物理层部分在通信网络上发射信息且从所述通信网络接收信息。从通信装置的较高层部分113a又将信息提供到物理层部分以供在所述网络上发射,且从物理层部分接收在通信网络上接收的信息。在一些实例中,所述较高层部分可为媒体接入控制器(MAC)部分,在一些实例中,所述较高层部分可为从通信装置的MAC及其它部分,且在一些实例中,所述较高层部分可为从通信装置内可能包含一或若干处理器的其它电路。

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