[发明专利]用于控制两个集成电路之间的事务交换的方法有效

专利信息
申请号: 201280033571.4 申请日: 2012-07-06
公开(公告)号: CN103797435B 公开(公告)日: 2017-05-31
发明(设计)人: 拜平·巴拉克李施南;阿布德拉齐兹·古拉森 申请(专利权)人: 瑞典爱立信有限公司
主分类号: G06F1/32 分类号: G06F1/32
代理公司: 中国专利代理(香港)有限公司72001 代理人: 徐予红,付曼
地址: 瑞典斯*** 国省代码: 暂无信息
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摘要:
搜索关键词: 用于 控制 两个 集成电路 之间 事务 交换 方法
【说明书】:

技术领域

发明涉及用于控制两个集成电路之间的事务交换的方法。本发明还涉及适于执行该方法的系统。

背景技术

片上系统或者系统芯片(也以缩写词表示为SoC或SOC)是指将计算机的所有部件或者其它电子系统的所有部件集成到单一的集成电路(芯片)。集成电路或单片集成电路(也称为IC、芯片和微芯片)是通过将痕量元素图案化的扩散到半导体材料的薄衬底的表面所制备的电子电路。其可以包含数字功能、模拟功能、混合信号功能,以及通常的射频功能,并且都在单一的芯片衬底上。典型应用是在嵌入系统领域。

当前的片上系统中,不同的部件通过片上互连而互连。互连基本可以被理解成用于电路的总线。这样的互连的示例是开放式内核协议(Open Core Protocol)(也采用缩写词表示为OCP)或者Advanced RISC (也采用缩写词表示为ARM)的高级可扩展接口(Advanced eXtensible Interface)(也以缩写词表示为AXI)。部件可以是中央处理器(也以缩写词表示为CPU)。ARM A9处理器核是CPU的示例。直接存储器存取(也以缩写词表示为DMA)引擎或者如通用异步收发报机(也以缩写词表示为UART)的外围设备也可以认为是部件。

每个部件通常是存储器映射的。此外,部件彼此之间交换事务。

这样的事务包括发送到另一部件的请求,其中,该请求被执行。如示出的,该请求可以是从存储器读取、写入存储器或者从存储器提取的指令。发送该请求的部件是事务发起部件或者发起部件,而执行该请求的部件是事务目标部件或目标部件。一些部件可以既是事务发起方又是事务目标方,而另一些部件可以仅是事务发起方或者事务目标方。

被发起的每个事务应该具有包含所请求的信息或者原始请求的状态的响应。举例来说,所请求的信息可以是读取数据,而状态可以是成功写入指示或者失败写入指示。响应通过目标部件发送到发起事务的部件。

除了在片上总线上发送的事务以外,部件还交换状态信息(如,中断)。由于中断通常是边带信号,因此,片上互连也包含边带信号。

有时,SoC所需的所有功能不能在单一芯片中有效地实现。在这样的情况中,SoC被分成多个,通常是两个。例如,一些部件包括模拟模块,这些模块以不同的技术处理节点被设计,而其它部件是纯数字的并且可以以较小的处理节点被设计。

低延迟接口(也以缩写词表示为LLI)可以用来使SoC或系统灵活的划分成多个物理芯片,同时在系统中实施的软件将该多个物理芯片视为单独的逻辑芯片。LLI基于移动产业处理器接口(也以缩写词表示为MIPI)被标准化。LLI是允许两个芯片以另一个芯片位于所考虑的芯片上进行通信的点对点接口。LLI是由对偶单纯子链路组成的双向接口。LLI允许两个芯片同时发起和接收事务。换言之,LLI可以被认为是“总线扩展”或者“互连隧道(interconnect tunnel)”。通过被称为“服务事务”的特定事务,LLI可以承载边带信号(如,中断)。

为了有效地管理LLI物理链路电源,可以关闭链路或者使链路处于非常低的供电状态。当从低供电状态开始时,物理链路需要时间来激活。该时间通常在毫秒的范围内。由于“互连隧道”协议(如,LLI)应该能够确保低延迟,同时传输事务,因此,需要在链路被置于该低功耗状态或者在极端的情况被关闭之前,完成所有未解决的事务。

发明内容

本发明的目的是至少部分地减少上述缺陷。

更具体地,本发明的目的是关闭两个IC之间的链路或者以安全方式使链路处于非常低的供电状态。

该目的通过采用一种用于控制系统中的两个集成电路之间的事务交换的方法来实现,该系统包括:两个集成电路和电源,该电源用于对两个集成电路之间的链路供电,由此能够实现两个集成电路之间的事务交换。该系统还包括控制器,该控制器控制集成电路和电源。这通常可以被称为链路管理系统。在LLI术语中,由于一个芯片将控制LLI IP(在两个芯片上)并且还管理链路,故该芯片被称为“系统主芯片”。系统主芯片等同于控制器40。在图1中,“控制器”项40通常指两个IC。典型地,然而,仅该主芯片具有控制器。在该情况中,例如,从属“控制器”管理在从属芯片中的时钟、功率和重置。主控制器40还可以通过下发命令到从属PMU来控制从属芯片。一旦完成,则从属PMU将报告返回到主PMU。

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