[发明专利]信号间延迟处理方法及装置有效
| 申请号： | 201210551976.9 | 申请日： | 2012-12-18 |
| 公开（公告）号： | CN103051422B | 公开（公告）日： | 2018-08-17 |
| 发明（设计）人： | 孟英 | 申请（专利权）人： | 南京中兴新软件有限责任公司 |
| 主分类号： | H04L1/00 | 分类号： | H04L1/00 |
| 代理公司： | 北京康信知识产权代理有限责任公司 11240 | 代理人： | 余刚;梁丽超 |
| 地址： | 210012 江苏*** | 国省代码： | 江苏;32 |
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| 摘要： | |||
| 搜索关键词： | 信号 延迟 处理 方法 装置 | ||
1.一种信号间延迟处理方法，其特征在于包括：
确定多路串行数字信号的每一路串行数字信号在N个采样时钟的误码率，其中，所述N个采样时钟中的每个采样时钟为恢复时钟与N个内插相位之和，所述N个内插相位在预设的一个时钟单位之内，其中，N为大于1的正整数；
根据所述误码率，确定所述每一路串行数字信号所对应的内插相位；
使用所述每一路串行数字信号所对应的内插相位对该每一路串行数字信号的时钟进行调整；
其中，在使用所述每一路串行数字信号所对应的内插相位对该每一路串行数字信号的时钟进行调整之后，还包括：
对所述多路串行数字信号进行串并转换。
2.根据权利要求1所述的方法，其特征在于，根据所述误码率，确定所述每一路串行数字信号所对应的采样时钟包括：
确定所述误码率中的最小值对应的采样时钟为该每一路串行数字信号所对应的采样时钟。
3.根据权利要求1或2所述的方法，其特征在于，所述N个内插相位在所述预设的一个时钟单位之内是均匀分布的。
4.根据权利要求1或2所述的方法，其特征在于，所述恢复时钟为模数转换器ADC输出数据的同源时钟和预设参考时钟确定的时钟。
5.一种信号间延迟处理装置，其特征在于包括：
第一确定模块，用于确定多路串行数字信号的每一路串行数字信号在N个采样时钟的误码率，其中，所述N个采样时钟中的每个采样时钟为恢复时钟与N个内插相位之和，所述N个内插相位在预设的一个时钟单位之内，其中，N为大于1的正整数；
第二确定模块，用于根据所述误码率，确定所述每一路串行数字信号所对应的内插相位；
调整模块，用于使用所述每一路串行数字信号所对应的内插相位对该每一路串行数字信号的时钟进行调整；
转换模块，用于对所述多路串行数字信号进行串并转换。
6.根据权利要求5所述的装置，其特征在于，所述第二确定模块用于确定所述误码率中的最小值对应的采样时钟为该每一路串行数字信号所对应的采样时钟。
7.根据权利要求5或6所述的装置，其特征在于，所述N个内插相位在所述预设的一个时钟单位之内是均匀分布的。
8.根据权利要求5或6所述的装置，其特征在于，所述恢复时钟为模数转换器ADC输出数据的同源时钟和预设参考时钟确定的时钟。
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