[发明专利]PLL电路有效

专利信息
申请号: 201210543566.X 申请日: 2012-12-14
公开(公告)号: CN103166631A 公开(公告)日: 2013-06-19
发明(设计)人: 胜岛明男 申请(专利权)人: 瑞萨电子株式会社
主分类号: H03L7/08 分类号: H03L7/08;H03L7/099
代理公司: 中国国际贸易促进委员会专利商标事务所 11038 代理人: 申发振
地址: 日本*** 国省代码: 日本;JP
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摘要:
搜索关键词: pll 电路
【权利要求书】:

1.一种PLL电路,包括:

相位比较器,用于检测在基准信号和反馈信号之间的相位差;

第一电荷泵和第二电荷泵,各自用于输出与所述相位比较器的检测结果相应的电流;

滤波器,用于输出通过去除所述第一电荷泵的输出电流的高频分量而获得的第一电流;

积分器,用于对所述第二电荷泵的输出电流积分;

电压-电流转换电路,用于输出与所述积分器的积分结果相应的第二电流;以及

振荡器,用于生成频率与通过将所述第一电流和所述第二电流相加而生成的第三电流相应的振荡信号并且将该振荡信号反馈给所述相位比较器。

2.根据权利要求1所述的PLL电路,还包括:

加法器,用于将所述第一电流和所述第二电流相加并且输出所述第三电流。

3.根据权利要求2所述的PLL电路,其中所述加法器包括:

第一晶体管,所述第一晶体管的源极与第一电源耦接,并且所述第一晶体管的漏极和栅极与被供应所述第一电流和所述第二电流的第一节点耦接;以及

第二晶体管,所述第二晶体管的源极与所述第一电源耦接,所述第二晶体管的栅极与所述第一节点耦接,并且所述第二晶体管的漏极与所述振荡器耦接。

4.根据权利要求3所述的PLL电路,其中所述加法器还包括:

第三晶体管,设置于所述第一晶体管的漏极与所述第一节点之间,并且所述第三晶体管的栅极被供以偏置电压;以及

第四晶体管,设置于所述第二晶体管的漏极与所述振荡器之间,并且所述第四晶体管的栅极被供以所述偏置电压。

5.根据权利要求2所述的PLL电路,其中所述加法器包括:

恒流源,用于发送固定电流;

第一晶体管,所述第一晶体管的源极与第一电源耦接,所述第一晶体管的漏极与被供应所述第一电流和所述第二电流的第一节点耦接,并且所述第一晶体管的栅极与所述恒流源耦接;

第二晶体管,所述第二晶体管的源极与所述第一电源耦接,所述第二晶体管的漏极与所述振荡器耦接,并且所述第二晶体管的栅极与所述恒流源耦接;

第三晶体管,设置于所述第一节点和所述恒流源之间,并且所述第三晶体管的栅极被供以偏置电压;以及

第四晶体管,设置于所述第二晶体管的漏极与所述振荡器之间,并且所述第四晶体管的栅极被供以所述偏置电压。

6.根据权利要求2所述的PLL电路,其中所述加法器将被供应所述第一电流和所述第二电流的第一节点的电流按原样输出为所述第三电流。

7.根据权利要求1所述的PLL电路,其中所述电压-电流转换电路包括:第五晶体管,所述第五晶体管的栅极被供以所述积分器的积分结果,并且所述第五晶体管将在其源极和漏极之间流过的电流输出为所述第二电流。

8.根据权利要求7所述的PLL电路,其中所述电压-电流转换电路包括:与所述第五晶体管串联耦接的第一电阻元件。

9.根据权利要求1所述的PLL电路,还包括:

分频器,用于对所述振荡器的所述振荡信号分频并且将其作为所述反馈信号输出。

10.根据权利要求1所述的PLL电路,其中所述滤波器包括:串联设置于其中有所述第一电荷泵的所述输出电流流过的第一信号线上的第二电阻元件;以及设置于所述第一信号线和所述第一电源之间的第一电容元件。

11.根据权利要求1所述的PLL电路,其中所述积分器包括:设置于其中有所述第二电荷泵的所述输出电流流过的第二信号线与第二电源之间的第二电容元件。

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