[发明专利]一种高速串行通信通道之间去偏差的方法无效

专利信息
申请号: 201210398970.2 申请日: 2012-10-19
公开(公告)号: CN102946294A 公开(公告)日: 2013-02-27
发明(设计)人: 王恩东;胡雷钧;刘金广;陈继承 申请(专利权)人: 浪潮电子信息产业股份有限公司
主分类号: H04L1/00 分类号: H04L1/00;H04L7/00
代理公司: 暂无信息 代理人: 暂无信息
地址: 250014 山东*** 国省代码: 山东;37
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摘要:
搜索关键词: 一种 高速 串行 通信 通道 之间 偏差 方法
【说明书】:

技术领域

发明涉及高速数据通信领域, 具体地说是一种高速串行通信通道之间去偏差的实现方法,特别是点对点的高速串行互连通信领域,应用于多个通道并行传输的通信协议。

背景技术

基于点对点的高速串行通信技术已广泛应用于系统内部芯片间或者处理器间的互连,互连通信协议如:QPI、HT、PCIe、InfiniBand都是基于此技术的实例,由多个通道绑定成为一个逻辑接口实现数据报文的传输,每个通道都是由收、发两个独立通道组成,可实现双向数据同时传输,每个方向都是有低压差分信号对实现高速串行传输,传输媒介包括铜线、板与板之间连接器或者光纤。

目前各种数据通信协议都是基于层次化的传输协议,从上至下分别是协议层、路由层、链路层和物理层,各个层次实现相对独立,易于重用或升级,协议层事务处理包括cache一致性和非一致性内存访问、IO访问、配置和中断处理等,路由层主要实现报文从源地址到目的地址正确路由功能,链路层实现报文的可靠性传输和流控功能,可靠传输通过CRC检错和重传机制实现,物理层实现数据流在实际物理链路的高速传输。

物理层向上服务于链路层,向下连接各种传输媒介,物理层根据实现情况又细分为物理子层和逻辑子层,物理子层通过模拟电路实现高速信号的串并转换和时钟频率或相位的锁定,逻辑子层通过数字逻辑电路实现训练初始化功能,包括链路检测、通道之间去偏差、链路带宽和速率的配置和扰码等功能。

对于数据报文分拆在多个通道并行传输协议,由于物理信道延时不能保证一致,而且模拟前端的串并转换不能保证转换后的并行数据有效性,所以需要一个同步和去偏差过程来将数据报文在接收端正确恢复出来并提供给链路层。

发明内容

本发明的目的是提供一种高速串行通信通道之间去偏差的方法。

本发明的目的是按以下方式实现的,包括如下步骤:

第一步,是在每个通道上进行特征字符的检测和数据缓存,从模拟前端接收到的并行乱序数据,将这些并行乱序数据进行多级寄存,只有检测到特征字符之后才开始传输数据,特征字符的检测方法是采用并行比较方法实现,在一个时钟周期确定特征字符的位置,在随后的两拍即可将有效特征字符和数据输出;

第二步,是在所有通道都检测到特征字符之后的同一时刻将特征字符送出,自然实现各个通道之间对齐,在第一步检测到特征字符的过程中,可能存在两个通道检测到字符会相差一个时钟周期,所以必须是提前检测到特征字符的通道要延迟一个时钟周期将有效数据输出,以保证两个通将有效特征字符和数据同步输出;

对于是哪些通道首先检测到特征字符很重要,直接关系多个通道组合后的数据是否正确,所以每个通道在使能对齐之前,先将检测结果告知链路状态机,然后链路状态机给所有通道发起通道对齐使能信号,这样就给每个通道提供一个基准,知道谁先到谁后到,最后向谁看齐,先到延迟一个周期输出,后到的直接输出即可,自然实现多个通道之间去偏差。

本发明的有益效果是:1)延时较短,5个时钟周期即可完成对齐操作;2)实现简单,逻辑资源使用较少;3)最大偏差可允许(特征字符长度/2-1)UI。

具体实施方式

 本发明的目的是解决点对点高速串行通信接收端多个通道的偏差的问题,通常由多个通道并行传输至对端接收模块,由PCB或芯片封装等物理实现原因,无法保证多个通道的延时一模一样,导致串行数据不能到达每个通道的接收端;

本发明适于物理传输编码方式采用扰码的情况,在链路初始化去偏差阶段只是接收特定通道对齐pattern,后续数据传输背靠背传输,在实现这种特征字符对齐之后就能保证后续数据的对齐,所以在训练初始化过程中解决通道去偏差的问题。

基于点对点的高速串行通信协议,本发明提出的一种通道之间去偏差的实现方法,应用本发明可以显著降低传输延时,而且实现简单,节省逻辑资源。

本发明的目的是按以下方式实现的,包括如下步骤:

第一步是在每个通道上进行特征字符的检测和数据缓存,从模拟前端接收到的并行乱序数据,将这些数据进行多级寄存,因为这些数据无法直接使用,只有检测到特征字符之后才能识别特征字符之后真正传输的数据,特征字符的检测方法是采用并行比较方法实现,在一个时钟周期确定特征字符的位置,在随后的两拍即可将有效特征字符和数据输出;

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