[发明专利]对可变大小分组进行LDPC编码和译码有效
| 申请号: | 201210394025.5 | 申请日: | 2008-01-24 |
| 公开(公告)号: | CN102904583B | 公开(公告)日: | 2017-06-23 |
| 发明(设计)人: | A·汉德卡尔;T·理查森 | 申请(专利权)人: | 高通股份有限公司 |
| 主分类号: | H03M13/11 | 分类号: | H03M13/11 |
| 代理公司: | 永新专利商标代理有限公司72002 | 代理人: | 张扬,王英 |
| 地址: | 美国加*** | 国省代码: | 暂无信息 |
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| 摘要: | |||
| 搜索关键词: | 可变 大小 分组 进行 ldpc 编码 译码 | ||
1.一种用于对分组进行编码或译码的装置,包括:
用于基于待编码或待译码的分组的分组大小,从其每一个提升值是2的不同次幂的一组提升值中选择一个提升值的模块;
用于基于所选择的提升值和所述分组大小,从多个基本奇偶校验矩阵中选择一基本奇偶校验矩阵的模块;以及
用于基于所选择的基本奇偶校验矩阵和所选择的提升值对所述分组进行编码或译码的模块
其中,所述基本奇偶校验矩阵包括:
其中,0是全零的矩阵,其中I是单位矩阵,其中,矩阵M1的宽度和矩阵M2的宽度是基于信息比特和奇偶比特的数量的,并且其中,所述矩阵M1包括:
其中,矩阵A的列数与信息比特的数量相对应,并且其中,所述矩阵M2的维数取决于所述矩阵M1。
2.根据权利要求1所述的装置,其中,所述一组提升值包括从4、8、16、32、64、128、256、512和1024的组中选择的多个提升值。
3.根据权利要求1所述的装置,其中,所述一组提升值包括9个不同的提升值。
4.根据权利要求1所述的装置,进一步包括:
用于确定所述待编码或待译码的分组的所述分组大小的模块;
用于基于所述基本奇偶校验矩阵和所选择的提升值,生成经过提升的奇偶校验矩阵的模块;以及
用于基于所述经过提升的奇偶校验矩阵,对所述分组进行编码或译码的模块。
5.根据权利要求4所述的装置,其中,所述用于生成所述经过提升的奇偶校验矩阵的模块进一步包括:
用于还基于针对所述基本奇偶校验矩阵的非零元素的循环移位值,生成所述经过提升的奇偶校验矩阵的模块。
6.根据权利要求1所述的装置,进一步包括:
用于针对所述基本奇偶校验矩阵的一列中的2个非零元素,使用循环移位值s和s+L/4来生成与所述基本奇偶校验矩阵和所选择的提升值相对应的经过提升的奇偶校验矩阵的模块,其中,所述列包括至少3个非零元素,并且其中,s是任意值,而L是所选择的提升值。
7.根据权利要求1所述的装置,其中,所述提升值是进一步基于所述基本奇偶校验矩阵的信息比特的数量来选择的。
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