[发明专利]堆叠半导体器件无效
| 申请号: | 201210371220.6 | 申请日: | 2012-09-28 |
| 公开(公告)号: | CN103035630A | 公开(公告)日: | 2013-04-10 |
| 发明(设计)人: | 佩里·H·派莱伊;凯文·J·埃斯;迈克尔·B·麦克沙恩 | 申请(专利权)人: | 飞思卡尔半导体公司 |
| 主分类号: | H01L25/065 | 分类号: | H01L25/065;H01L23/528;H01L21/98 |
| 代理公司: | 中原信达知识产权代理有限责任公司 11219 | 代理人: | 李佳;穆德骏 |
| 地址: | 美国得*** | 国省代码: | 美国;US |
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| 摘要: | |||
| 搜索关键词: | 堆叠 半导体器件 | ||
1.一种堆叠半导体器件,包括:
第一半导体器件,所述第一半导体器件具有第一主表面和与所述第一主表面相对的第二主表面,所述第一半导体器件的所述第一主表面具有有源电路;
第二半导体器件,所述第二半导体器件具有第一主表面和与所述第一主表面相对的第二主表面,所述第二半导体器件的所述第一主表面具有有源电路;
第三半导体器件,所述第三半导体器件具有第一主表面和与所述第一主表面相对的第二主表面,所述第三半导体器件的所述第一主表面具有有源电路;
第四半导体器件,所述第四半导体器件具有第一主表面和与所述第一主表面相对的第二主表面,所述第四半导体器件的所述第一主表面具有有源电路;其中:
所述第一半导体器件的所述第一主表面面向所述第二半导体器件的所述第一主表面,使得所述第一半导体器件和所述第二半导体器件的所述第一主表面位于所述第一半导体器件和所述第二半导体器件的所述第二主表面之间;
所述第三半导体器件的所述第一主表面面向所述第四半导体器件的所述第一主表面,使得所述第三半导体器件和所述第四半导体器件的所述第一主表面位于所述第三半导体器件和所述第四半导体器件的所述第二主表面之间;以及
所述第二半导体器件的所述第二主表面面向所述第三半导体器件的所述第二主表面,使得所述第二半导体器件和所述第三半导体器件的所述第二主表面位于所述第二半导体器件和所述第三半导体器件的所述第一主表面之间;以及
至少一个连续导电通孔,其中所述至少一个连续导电通孔的每个连续导电通孔从所述第一半导体器件的所述第二主表面延伸穿过所述第一半导体器件、所述第二半导体器件和所述第三半导体器件。
2.根据权利要求1所述的堆叠半导体器件,其中:
所述至少一个导电通孔中的每一个在所述第一半导体器件和所述第二半导体器件的所述第一主表面之间的接口处具有第一宽度,以及在所述第一半导体器件的所述第一主表面和所述第二主表面之间具有第二宽度,其中所述第一宽度大于所述第二宽度;以及
所述至少一个导电通孔中的每一个在所述第三半导体器件和所述第四半导体器件的所述第一主表面之间的接口处具有第三宽度,以及在所述第三半导体器件的所述第一主表面和所述第二主表面之间具有第四宽度,其中所述第三宽度大于所述第四宽度。
3.根据权利要求1所述的堆叠半导体器件,其中所述第一半导体器件、所述第二半导体器件、所述第三半导体器件和所述第四半导体器件中每一个的进一步特征在于半导体管芯。
4.根据权利要求1所述的堆叠半导体器件,所述第一半导体器件、所述第二半导体器件、所述第三半导体器件和所述第四半导体器件中每一个的进一步特征在于存储器件。
5.根据权利要求1所述的堆叠半导体器件,所述第一半导体器件、所述第二半导体器件、所述第三半导体器件和所述第四半导体器件中每一个的进一步特征在于半导体晶圆。
6.根据权利要求1所述的堆叠半导体器件,所述第一半导体器件、所述第二半导体器件、所述第三半导体器件和所述第四半导体器件中每一个包括导电面,并且其中所述至少一个连续导电通孔的一个或多个连续导电通孔电耦合于每个所述导电面。
7.根据权利要求1所述的堆叠半导体器件,其中所述至少一个连续导电通孔的一个或多个连续导电通孔是用于在所述第一半导体器件、所述第二半导体器件、所述第三半导体器件和所述第四半导体器件中每一个的所述有源电路之间耦合信号。
8.根据权利要求1所述的堆叠半导体器件,其中所述第一半导体器件、所述第二半导体器件、所述第三半导体器件和所述第四半导体器件中每一个在所述半导体器件的至少一个边上的所述第一主表面处包括斜面。
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