[发明专利]一种视频图像数据处理方法及系统无效
申请号: | 201210348720.8 | 申请日: | 2012-09-19 |
公开(公告)号: | CN102883167A | 公开(公告)日: | 2013-01-16 |
发明(设计)人: | 林绿德;张科科;罗平 | 申请(专利权)人: | 旗瀚科技有限公司 |
主分类号: | H04N9/04 | 分类号: | H04N9/04;H04N5/243 |
代理公司: | 深圳市科吉华烽知识产权事务所(普通合伙) 44248 | 代理人: | 胡吉科;孙伟 |
地址: | 518000 广东省深圳市福田区深南*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 一种 视频 图像 数据处理 方法 系统 | ||
技术领域
本发明涉及视频图像数据处理技术。
背景技术
随着目前高清安防的不断发展,视频分辨率越来越大,这给予存储的压力也越来越大。目前市面上的存储方案都是将前端传输过来的视频图像进行压缩编码实现存储。如果压缩比例太大,会导致视频图像严重受损;但如果压缩比例不大,就需要更多的存储介质,系统成本就会增加。如何在视频图像质量和存储空间上找到一个平衡点,是目前高清安防面临的一个继续解决的难题。
发明内容
为了解决现有现有安防摄像机的视频图像数据处理方法处理后的视频图像数据难以同时保障视频图像质量和较少存储介质的技术问题,本发明提供了一种视频图像数据处理方法。
本发明为解决上述技术问题提出的技术方案是:
一种视频图像数据处理方法,该方法应用于视频图像数据处理系统,所述视频图像数据处理系统包括FPGA(Field-Programmable Gate Array,现场可编程门阵列)、CPU(中央处理器)和存储装置,该方法包括以下步骤:
步骤s1:FPGA获取视频图像原始RAW数据;
步骤s2:FPGA中的串并转换模块对原始RAW数据进行串并转换,转换成并行RAW数据,将并行RAW数据传输至FPGA中的编码模块;
步骤s3:FPGA中的编码模块对并行RAW数据进行加扰编码,得到加扰RAW数据并将其传输至CPU;
步骤s4:CPU对加扰RAW数据进行压缩,将压缩后的加扰RAW数据存入存储装置。
进一步的,步骤s3包括如下子步骤:
子步骤s31:FPGA中的编码模块将并行RAW数据中的每两个G分量相加取平均后作为新的G分量;
子步骤s32:FPGA中的编码模块将并行RAW数据中的R分量、B分量、子步骤s31中余下的G分量和子步骤s31中得到的新的G分量进行加扰编码,得到加扰RAW数据。
进一步的,所述视频图像数据处理方法还包括以下步骤:
步骤s5:CPU从存储装置中调取压缩后的加扰RAW数据并对其解压,将解压后的加扰RAW数据传输至FPGA中的解码模块;
步骤s6:FPGA中的解码模块对解压后的加扰RAW数据进行解扰解码,得到解扰RAW数据并将其传输至FPGA中的图像处理模块;
步骤s7:FPGA中的图像处理模块对解扰RAW数据进行ISP处理,得到适合显示的视频图像数据。
进一步的,步骤s7包括以下子步骤:
子步骤s71:FPGA中的图像处理模块对解扰RAW数据进行自动曝光、插值、自动白平衡、颜色增强、宽动态处理和色度空间转换处理,得到适合液晶显示器显示的视频图像数据。
或者,步骤s7包括以下子步骤:
子步骤s72:FPGA中的图像处理模块对解扰RAW数据进行自动曝光、插值、自动白平衡、颜色增强、宽动态处理、色度空间转换和伽玛矫正处理,得到适合CRT(Cathode Ray Tube,阴极射线管)显示器显示的视频图像数据。
本发明还提供一种应用上述视频图像数据处理方法的视频图像数据处理系统。
本发明的有益效果是:本发明的视频图像数据处理方法和视频图像数据处理系统对原始图像RAW数据进行编解码,使存入到硬盘里面的数据为图像的RAW数据,由于RAW数据的容量只有显示视频图像数据的三分之一,这样就大大节约了硬盘存储的空间。
在系统需要播放存储内容时,CPU将硬盘的数据发送出来,通过FPGA对数据进行解码和增加部分ISP(Image Signal Processing,图像信号处理)功能恢复出视频显示需要的格式,实现播放的功能。
本发明解决了视频图像质量和存储空间两者间的矛盾,在保证图像质量的前提下,与现有视频图像数据处理系统及其处理方法在相同的压缩比下,本发明至少缩小了三分之二的存储空间,使整个系统的成本大大降低。
附图说明
图1是本发明实施例视频图像数据处理系统结构示意框图;
图2是本发明实施例中视频图像数据的RAW数据格式图示;
图3是本发明实施例中图像处理模块结构示意框图。
具体实施方式
下面结合附图说明及具体实施方式对本发明进一步说明。
本实施例的视频图像数据处理方法,该方法应用于本实施例的视频图像数据处理系统,如图1所示,本实施例的视频图像数据处理系统包括FPGA 1、CPU 2和存储装置3,本实施例的视频图像数据处理方法包括以下步骤:
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