[发明专利]半导体器件制造方法有效
申请号: | 201210228598.0 | 申请日: | 2012-07-02 |
公开(公告)号: | CN103531540A | 公开(公告)日: | 2014-01-22 |
发明(设计)人: | 韩锴;王晓磊;王文武;杨红;马雪丽 | 申请(专利权)人: | 中国科学院微电子研究所 |
主分类号: | H01L21/8238 | 分类号: | H01L21/8238;H01L21/28;H01L21/265 |
代理公司: | 北京蓝智辉煌知识产权代理事务所(普通合伙) 11345 | 代理人: | 陈红 |
地址: | 100029 *** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 半导体器件 制造 方法 | ||
1.一种半导体器件制造方法,用于制造具有双功函数金属栅的CMOS晶体管,其特征在于包括如下步骤:
提供半导体衬底,在该半导体衬底上形成STI结构,并进行阱区注入,形成NMOSFET区域和PMOSFET区域;
全面性地形成第一栅极绝缘层;
全面性地形成第一栅极;
刻蚀位于PMOSFET区域的第一栅极的至少部分厚度;
全面性地形成铝金属层;
对所述铝金属层进行退火;
沉积金属填充层,完成CMOS晶体管的金属栅极。
2.根据权利要求1所述的方法,其特征在于,所述第一栅极绝缘层的材料为高K栅极绝缘材料,其厚度为2-4nm;或者,所述第一栅极绝缘层的材料为SiO2,其厚度为5-7nm。
3.根据权利要求1所述的方法,其特征在于,所述第一栅极的材料为TiN、MoN或TaN,厚度为2-15nm。
4.根据权利要求1所述的方法,其特征在于,在刻蚀位于PMOSFET区域的第一栅极的至少部分厚度工艺中,至少刻蚀位于PMOSFET区域的第一栅极的三分之一厚度。
5.根据权利要求1所述的方法,其特征在于,在刻蚀位于PMOSFET区域的第一栅极的至少部分厚度工艺中,刻蚀位于PMOSFET区域的第一栅极的全部厚度,并且,在沉积所述金属填充层之前,全面性地形成第二栅极材料层。
6.根据权利要求5所述的方法,其特征在于,所述第二栅极材料层的材料为TiN、MoN或TaN,厚度为2-15nm。
7.根据权利要求1所述的方法,其特征在于,刻蚀位于PMOSFET区域的第一栅极的至少部分厚度具体包括:形成掩膜层,该掩膜层覆盖NMOSFET区域而暴露出PMOSFET区域,然后,各向异性地刻蚀位于PMOSFET区域的第一栅极。
8.根据权利要求1所述的方法,其特征在于,所述铝金属层的厚度为0.1-5nm。
9.根据权利要求1所述的方法,其特征在于,采用离子注入工艺引入所述铝金属层,注入能量为0.1-15keV,剂量为1e14-5e16/cm2。
10.根据权利要求1所述的方法,其特征在于,对所述铝金属层进行退火的具体工艺条件为:退火温度为300-1000℃,退火时间为5s-2min。
11.根据权利要求1所述的方法,其特征在于,所述金属填充层的材料为TaN、TiAl或W。
12.根据权利要求1所述的方法,其特征在于,采用后栅工艺,在进行阱区注入、形成NMOSFET区域和PMOSFET区域之后,以及在全面性地形成第一栅极绝缘层之前:
形成牺牲性栅极绝缘层、牺牲性栅极,定义栅极图形;
形成栅极间隙壁,其覆盖所述牺牲性栅极和牺牲性栅极绝缘层的侧壁;
形成栅极间介质层;
去除牺牲性栅极绝缘层和牺牲性栅极,形成栅极空洞。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造