[发明专利]信号隔离方法、装置及芯片有效

专利信息
申请号: 201210141650.9 申请日: 2012-05-09
公开(公告)号: CN102694542A 公开(公告)日: 2012-09-26
发明(设计)人: 于立波;马文波;张炜 申请(专利权)人: 北京华大信安科技有限公司
主分类号: H03K19/14 分类号: H03K19/14;H03K19/0175
代理公司: 北京弘权知识产权代理事务所(普通合伙) 11363 代理人: 郭放;许伟群
地址: 100015 北京市朝阳区*** 国省代码: 北京;11
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摘要:
搜索关键词: 信号 隔离 方法 装置 芯片
【说明书】:

技术领域

发明涉及芯片设计技术领域,尤其涉及信号隔离方法、装置及芯片。

背景技术

在进行芯片设计时,通常采用多电源域设计,以便实现特定的电路功能,例如,安全芯片的片上系统(SoC,System on Chip)内可以设置两个电源域,其中由主电源供电的电源域称为主电源域,一般包含常规芯片逻辑,例如,中央处理器(CPU,Central Processing Unit)、闪存(Flash)、只读存储器(ROM,Read-Only Memory)、随机存取存储器(RAM,Random Access Memory)等,由备用电源供电的电源域称为备用电源域,通常包括非易失随机存取存储体(NVRAM,Non-Volatile Random Access Memory)等,正常情况下主电源为上电状态,备用电源为掉电状态,而当主电源意外掉电时,备用电源才变为上电状态,这时备用电源仅给备用电源域进行供电,从而在主电源掉电后,可以由备用电源给备用电源域内的NVRAM供电,使NVRAM仍能保持数据,以延长数据保持时间。

上述安全芯片的SoC设计方案中,虽然通过设置主电源域和备用电源域,可以在主电源掉电后,由备用电源给备用电源域供电,但是在主电源掉电后,主电源域的信号仍然能够进入备用电源域,从而对备用电源域的信号产生影响。

发明内容

本发明实施例中提供了信号隔离方法、装置及芯片,用以解决现有技术中存在的在主电源掉电后,主电源域的信号仍然能够进入备用电源域,从而对备用电源域的信号产生影响的问题。

为解决上述问题,本发明实施例提供的技术方案如下:

一种信号隔离方法,该方法包括:对为主电源域供电的主电源电压进行检测,当检测出所述主电源电压处于预设电压区段时,产生复位信号;根据所述复位信号,产生第一电平信号;根据所述第一电平信号控制隔离器件隔离所述主电源域的信号,以使所述主电源域的信号无法进入所述备用电源域。

一种信号隔离装置,包括:电压检测单元,用于对为主电源域供电的主电源电压进行检测,当检测出所述主电源电压处于预设电压区段时,产生复位信号;第一信号产生单元,用于根据所述电压检测单元产生的复位信号,产生第一电平信号;隔离单元,用于根据所述第一信号产生单元产生的第一电平信号控制隔离器件隔离所述主电源域的信号,以使所述主电源域的信号无法进入所述备用电源域。

一种芯片,包括:电压检测器VD,所述VD对为主电源域供电的主电源电压进行检测,当检测出所述主电源电压处于预设电压区段时,产生复位信号;信号隔离电路,所述VD的输出端与所述信号隔离电路的输入端相连接,所述信号隔离电路根据所述VD产生的复位信号,产生一电平信号;隔离器件,所述信号隔离电路的输出端与所述隔离器件的使能端相连接,由所述信号隔离电路产生的电平信号直接控制隔离器件隔离所述主电源域的信号,以使所述主电源域的信号无法进入所述备用电源域。

本发明实施例技术方案所提供的信号隔离方法,通过对为主电源域供电的主电源电压进行检测,能够及时检测出主电源电压发生变化,并在检测出主电源电压处于预设电压区段时,产生复位信号,根据该复位信号,产生第一电平信号,根据该第一电平信号控制隔离器件隔离所述主电源域的信号,以使所述主电源域的信号无法进入所述备用电源域。由上可见,采用本发明实施例技术方案,可以通过检测主电源电压处于预设电压区段,及时发现主电源掉电,并控制隔离器件隔离主电源域的信号,从而使主电源域的信号无法进入备用电源域,避免了对备用电源域的信号产生影响。

附图说明

为了更清楚地说明本发明实施例或现有技术中的技术方案,下面将对实施例中所需要使用的附图作简单地介绍,显而易见地,下面描述中的附图仅仅是本发明的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动的前提下,还可以根据这些附图获得其他的附图。

图1是本发明实施例一中,信号隔离方法流程示意图;

图2是本发明实施例二中,信号隔离装置第一结构示意图;

图3是本发明实施例二中,隔离单元23第一结构示意图;

图4是本发明实施例二中,隔离单元23第二结构示意图;

图5是本发明实施例二中,信号隔离装置第二结构示意图;

图6是本发明实施例三中,芯片第一电路原理图;

图7是本发明实施例四中,芯片第二电路原理图;

图8是本发明实施例五中,芯片第三电路原理图;

图9是本发明实施例五中,主电源、复位信号与隔离信号的时序图;

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