[发明专利]基于PCI互联的地址内存映射系统和方法有效
申请号: | 201210047622.0 | 申请日: | 2012-02-28 |
公开(公告)号: | CN102629239A | 公开(公告)日: | 2012-08-08 |
发明(设计)人: | 王翔;肖红;荣彬杰 | 申请(专利权)人: | 四川赛狄信息技术有限公司 |
主分类号: | G06F13/36 | 分类号: | G06F13/36 |
代理公司: | 成都天嘉专利事务所(普通合伙) 51211 | 代理人: | 方强 |
地址: | 611731 四*** | 国省代码: | 四川;51 |
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摘要: | |||
搜索关键词: | 基于 pci 地址 内存 映射 系统 方法 | ||
1.基于PCI互联的地址内存映射系统,其特征在于:包括N个处理器节点,每两个处理器节点之间通过PCI-X总线连接,N个处理器节点均连接同一个中央控制器,其中,N≥1;每个处理器节点包括一个处理器和一个桥片,处理器与桥片连接,桥片与中央控制器连接,桥片上包含有两个PCI-X总线控制器;所述每两个处理器节点之间通过PCI-X总线连接各自的桥片。
2.根据权利要求1所述系统的内存地址映射方法,其特征在于:当N个处理器节点的桥片在上电复位后,N个处理器节点通过PCI-X总线串联形成环路;每个处理器节点的处理器配置各自连接的桥片,使桥片连接的两条PCI-X总线通过桥片的PCI-PCI桥功能相连接,并且把其中的一条PCI-X总线的地址映射到另外一条PCI-X总线上;然后,每个处理器配置各自连接的桥片,将桥片连接的两条PCI-X总线的地址分别映射到该处理器的MPX总线上;最后,按照事先规划好的每个处理器节点的处理器的内存空间,从第一处理器节点的处理器开始依次配置各自连接的桥片,将第一处理器节点的桥片连接的两条PCI-X总线地址分别映射到第二个处理器节点的处理器的MPX总线上,依次进行地址映射,直至第N个处理器节点的桥片连接的两条PCI-X总线地址分别映射到第一处理器节点的处理器的MPX总线上;从而完成PCI-X互联的地址内存映射。
3.根据权利要求2所述的基于PCI互联的地址内存映射系统,其特征在于:所述N个处理器节点通过PCI-X总线串联形成环路是指,每个处理器节点的两个PCI-X总线控制器经过自动初始化后,一个PCI-X总线控制器为主模式控制器,另一个PCI-X总线控制器为从模式控制器;然后,第一处理器节点的主模式控制器通过PCI-X总线连到第二处理器节点的从模式控制器,第二处理器节点的主模式控制器通过PCI-X总线连到第三处理器节点的从模式控制器,……,第N-1处理器节点的主模式控制器通过PCI-X总线连到第N处理器节点的从模式控制器,第N处理器节点的主模式控制器通过PCI-X总线连到第一处理器节点的从模式控制器,从而通过N条PCI-X总线形成一个环路。
4.根据权利要求1或3所述的基于PCI互联的地址内存映射系统,其特征在于:所述处理器为MPC7448处理器,该处理器的工作频率为1.0GHz到1.5GHz,所述Flash为512Mbyte、32bi的Flash,Flash的接口支持128Mbyte/s的传输数率。
5.根据权利要求1或3所述的基于PCI互联的地址内存映射系统,其特征在于:所述桥片为PowerPC桥片,桥片为MPC7448、DDR SDRAM和PCI-X总线提供无阻塞的数据通道,桥片同时支持PowerPC工作在MPX总线模式。
6.根据权利要求1或3所述的基于PCI互联的地址内存映射系统,其特征在于:所述PCI-X/PCI总线的最高速率为100MHz、64bit。
7.根据权利要求1或3所述的基于PCI互联的地址内存映射系统,其特征在于:所述每个处理器节点还具备四个千兆以太网接口,是由其对应的桥片实现。
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