[发明专利]数据处理装置有效
| 申请号: | 201180075908.3 | 申请日: | 2011-12-26 |
| 公开(公告)号: | CN104011692A | 公开(公告)日: | 2014-08-27 |
| 发明(设计)人: | T·E·C·余;山下源;伊藤雅之 | 申请(专利权)人: | 瑞萨电子株式会社 |
| 主分类号: | G06F12/08 | 分类号: | G06F12/08 |
| 代理公司: | 北京市金杜律师事务所 11256 | 代理人: | 陈伟;王娟娟 |
| 地址: | 日本神*** | 国省代码: | 日本;JP |
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| 摘要: | |||
| 搜索关键词: | 数据处理 装置 | ||
1.一种数据处理装置,其含有在多个路中存储多个高速缓存条目的组相联型的高速缓冲存储器,其中,
所述高速缓冲存储器在读取高速缓存标记时,根据基于作为地址信息的一部分的标记地址信息而生成的选择数据的值,从所述多个路中选择部分路,从所选择的路中,使用所述地址信息中的索引地址读取高速缓存标记,
所述高速缓冲存储器在进行高速缓存填充时,对从与所述选择数据的值相应的部分路中选择出的高速缓存条目,进行高速缓存填充。
2.根据权利要求1所述的数据处理装置,其中,
所述高速缓冲存储器针对作为所述地址信息的一部分的标记地址信息生成奇偶校验数据,来作为所述选择数据。
3.根据权利要求1所述的数据处理装置,其中,
所述高速缓冲存储器将从所述路读取的各个高速缓存标记与所述标记地址进行比较,判断它们的比较结果是完全不一致、仅一个一致以及有多个一致的哪一种,在判断为所述有多个一致时,生成高速缓存错误信号。
4.根据权利要求3所述的数据处理装置,其中,
还具有将所述高速缓存错误信号作为异常要素或中断要素进行输入的中断控制器。
5.根据权利要求3所述的数据处理装置,其中,
所述高速缓冲存储器将所述仅一个一致的比较结果所涉及的高速缓存标记的高速缓存条目作为数据操作的对象。
6.根据权利要求1所述的数据处理装置,其中,
所述路具有与所述索引地址对应地存储所述高速缓存标记的标记路、以及与所述索引地址对应地存储数据的数据路,高速缓存条目含有所述高速缓存标记以及与该高速缓存标记对应的数据,所述多个标记路分别由按每个标记路而被选择为激活或非激活的存储器块构成,
所述高速缓冲存储器在读取高速缓存标记时,根据使用了所述选择数据的存储器块的激活,进行所述部分标记路的选择。
7.根据权利要求6所述的数据处理装置,其中,
所述选择数据是相对于作为所述地址信息的一部分的标记地址信息的所有位而为1位的奇偶校验数据,第1逻辑值的奇偶校验数据用于选择所述多个存储器块的一半,第2逻辑值的奇偶校验数据用于选择所述多个存储器块的剩余一半。
8.根据权利要求6所述的数据处理装置,其中,
所述选择数据是由作为所述地址信息的一部分的标记地址信息的按多个分割部分的每一分割部分的奇偶校验位构成的多位的奇偶校验数据,所述奇偶校验数据的值决定从多个标记路中选择的标记路。
9.根据权利要求6所述的数据处理装置,其中,
所述高速缓冲存储器具有:第1模式,其基于所述选择数据从所述多个路中选择部分标记路而读取高速缓存标记;以及第2模式,其使读取高速缓存标记的对象标记路为所有的标记路,
所述高速缓冲存储器输入选择所述第1模式或第2模式的模式选择信号。
10.根据权利要求1所述的数据处理装置,其中,
所述路具有与所述索引地址对应地存储所述高速缓存标记的标记路、以及与所述索引地址对应地存储数据的数据路,高速缓存条目含有所述高速缓存标记以及与该高速缓存标记对应的数据,所述多个标记路是将每规定多个的标记路汇集到一个存储器块而构成的,构成在同一存储器块中的多个标记路通过彼此不同的选择数据而被选择,
所述高速缓冲存储器在读取高速缓存标记时,使用所述选择数据和所述索引地址信息来读取高速缓存标记。
11.根据权利要求10所述的数据处理装置,其中,
所述选择数据是相对于作为所述地址信息的一部分的标记地址信息的所有位而为1位的奇偶校验数据,第1逻辑值的奇偶校验数据用于选择各个所述存储器块中的一方的标记路,第2逻辑值的奇偶校验数据用于选择各个所述多个存储器块中的另一方的标记路。
12.根据权利要求10所述的数据处理装置,其中,
所述选择数据是由作为所述地址信息的一部分的标记地址信息的按多个分割部分的每一分割部分的奇偶校验位构成的多位的奇偶校验数据,所述奇偶校验数据的值决定从各个存储器块中选择的标记路。
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