[发明专利]具有金属-绝缘体-金属阈值开关的解码器电路无效
申请号: | 201180074578.6 | 申请日: | 2011-11-04 |
公开(公告)号: | CN103890853A | 公开(公告)日: | 2014-06-25 |
发明(设计)人: | M.D.皮克特;G.M.里贝罗 | 申请(专利权)人: | 惠普发展公司;有限责任合伙企业 |
主分类号: | G11C8/10 | 分类号: | G11C8/10 |
代理公司: | 中国专利代理(香港)有限公司 72001 | 代理人: | 王洪斌;徐红燕 |
地址: | 美国德*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 具有 金属 绝缘体 阈值 开关 解码器 电路 | ||
1.一种解码器电路,包括:
多个输入线路,用于接收选择信号;
偏置逻辑,用于提供电压偏置;
多个输出线路,用于提供输出信号;
耦合到所述多个输入线路、偏置逻辑和多个输出线路的多个金属-绝缘体-金属MIM阈值开关,所述多个MIM阈值开关中的每一个操作为电流控制的正电阻或负电阻,用以把选择信号的输入逻辑状态映射到输出信号的输出逻辑状态。
2.如权利要求1所述的解码器电路,其中,所述多个MIM阈值开关包括:
第一级,具有耦合到所述偏置逻辑和多个输入线路的第一多个MIM阈值开关,用以相对于选择信号提供逻辑反相的选择信号;以及
第二级,具有第二多个MIM阈值开关,所述第二多个MIM阈值开关与所述第一级并联地耦合到所述偏置逻辑,以及耦合到多个输入线路、多个输出线路和所述第一级,用以接收反相的选择信号。
3.如权利要求2所述的解码器电路,其中,第二多个MIM阈值开关逻辑地提供彼此并联地耦合到所述偏置逻辑的多个与门,所述多个与门均具有接收选择信号和逻辑反相的选择信号的输入以及分别耦合到多个输出线路以提供输出信号的输出。
4.如权利要求2所述的解码器电路,其中,第一多个MIM阈值开关逻辑地提供彼此并联地耦合到所述偏置逻辑的多个反相器门,所述多个反相器门均具有接收选择信号中的一个的输入以及提供逻辑反相的选择信号中的一个的输出。
5.如权利要求1所述的解码器电路,其中,所述偏置逻辑包括多个电阻。
6.一种存储器控制器电路,包括:
第一解码器电路,用于提供行选择信号;以及
第二解码器电路,用于提供列选择信号;
其中,所述第一解码器电路和第二解码器电路中的每一个包括:
多个输入线路,用于接收选择信号;
偏置逻辑,用于提供电压偏置;
多个输出线路,用于提供输出信号;
耦合到所述多个输入线路、偏置逻辑和多个输出线路的多个金属-绝缘体-金属MIM阈值开关,多个MIM阈值开关中的每一个操作为电流控制的正电阻或负电阻,用以把选择信号的输入逻辑状态映射到输出信号的输出逻辑状态。
7.如权利要求6所述的存储器控制器电路,其中,所述第一和第二解码器电路中的每一个中的多个MIM阈值开关包括:
第一级,具有耦合到所述偏置逻辑和多个输入线路的第一多个MIM阈值开关,用以相对于选择信号提供逻辑反相的选择信号;以及
第二级,具有第二多个MIM阈值开关,所述第二多个MIM阈值开关与所述第一级并联地耦合到所述偏置逻辑,以及耦合到多个输入线路、多个输出线路和所述第一级,用以接收反相的选择信号。
8.如权利要求6所述的存储器控制器电路,其中,所述第一和第二解码器电路中的每一个中的偏置逻辑包括多个电阻。
9.如权利要求6所述的存储器控制器电路,其中,所述第一和第二解码器电路被形成在薄膜集成电路IC中。
10.如权利要求9所述的存储器控制器电路,其中,使用第一金属膜、绝缘膜和第二金属膜把多个MIM阈值开关中的每一个形成在所述薄膜IC上。
11.一种集成电路IC器件,包括:
具有在基底上形成的导电互连的IC管芯;以及
在IC管芯上形成并电耦合到所述导电互连的薄膜器件,所述薄膜器件具有解码器电路,解码器电路包括:
多个输入线路,用于接收选择信号;
偏置逻辑,用于提供电压偏置;
多个输出线路,用于提供输出信号;
耦合到所述多个输入线路、偏置逻辑和多个输出线路的多个金属-绝缘体-金属MIM阈值开关,所述多个MIM阈值开关中的每一个操作为电流控制的正电阻或负电阻,用以把选择信号的输入逻辑状态映射到输出信号的输出逻辑状态。
12.如权利要求11所述的IC器件,其中,薄膜器件包括在所述导电互连的层上形成的多个薄膜层。
13.如权利要求11所述的IC器件,其中,使用第一金属膜、绝缘膜和第二金属膜把多个MIM阈值开关中的每一个形成在所述薄膜器件上。
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