[发明专利]用于在千兆比特LDPC解码器中并行处理的方法和设备有效
申请号: | 201180029377.4 | 申请日: | 2011-06-14 |
公开(公告)号: | CN102939720A | 公开(公告)日: | 2013-02-20 |
发明(设计)人: | 埃兰·皮塞克;沙迪·阿布·苏拉 | 申请(专利权)人: | 三星电子株式会社 |
主分类号: | H03M13/11 | 分类号: | H03M13/11;H04B1/06 |
代理公司: | 北京铭硕知识产权代理有限公司 11286 | 代理人: | 王兆赓;郑玉 |
地址: | 韩国京畿*** | 国省代码: | 韩国;KR |
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摘要: | |||
搜索关键词: | 用于 千兆 比特 ldpc 解码器 并行 处理 方法 设备 | ||
技术领域
本申请总体涉及无线通信装置,更具体地讲,涉及对在无线通信装置之间传输的数据进行编码和解码。
背景技术
在信息理论中,低密度奇偶校验(LDPC)码是用于在噪声传输信道上传输消息的纠错码。LDPC是一类线性分组码。当LDPC和其他纠错码不能保证完好的传输时,可作出尽可能小的丢失信息的可能性。LDPC是第一种允许数据传输率接近于被称为香农极限(Shannon Limit)理论上的最大值的码。可以以香农极限的0.0045dB来执行LDPC码。当LDPC在1963年被开发时,实现LDPC是不切实际的。在1993年发现的Turbo码成为在1990年代后期的编码方案的选择。Turbo码用于诸如深空卫星通信的应用。LDPC需要复杂的处理,但LDPC是截至2007年发现的最有效的方案。LDPC码可产生大的最小距离(在下文中,“dmin”)并降低解码复杂度。
发明内容
技术方案
提供一种用于无线通信网络的能够对编码的传输进行解码的接收器。
有益效果
本公开描述用于提高1 Gbps LDPC解码器的设计效率的设备和方法。
附图说明
为了更充分理解本公开和其优点,现结合附图参考下面的描述,在附图中相同的标号表示相同的部分:
图1示出根据本公开的示例性实施例的发送ACK/NACK消息的示例性无线网络100;
图2a示出根据本公开的示例性实施例的正交频分多址(OFDMA)发送路径的高级示图;
图2b示出根据本公开的示例性实施例的正交频分多址接收路径的高级示图;
图3示出根据本公开的实施例的LDPC CRISP顶层架构。
图4示出根据本公开的实施例的与奇偶校验矩阵相应的Tanner图。
图5a示出根据传统的LDPC解码器的一实施例的1/2码率;
图5b示出根据传统的LDPC解码器的一实施例的5/6码率;
图6示出根据洪水(flooding)方法的执行解码的示例性LDPC解码器的详细框图;
图7示出根据本发明的原理的执行分层解码的示例性LDPC解码器的详细框图;
图8描述1/2码率的H矩阵;
图9描述5/8码率的H矩阵;
图10描述3/4码率的H矩阵;
图11描述13/16码率的H矩阵。
最佳实施方式
提供一种用于无线通信网络的能够对编码的传输进行解码的接收器。所述接收器包括:接收路径电路,用于接收并下变换传入的射频(RF)信号以产生编码的接收的信号;与接收路径电路相关的低密度奇偶校验(LDPC)解码器,用于对编码的接收的信号进行解码。LDPC解码器还包括:存储器,用于存储包括R个行和C个列的奇偶校验H矩阵,其中,奇偶校验H矩阵的每个元素包括平移值或-1值之一;多个处理元件,用于执行LDPC分层解码,其中,至少一个处理元件能够用于在同一循环中处理奇偶校验H矩阵的第一行和第二行。
提供一种用于在无线通信网络中对传输进行解码的方法。所述方法包括以下步骤:在接收装置中,接收并下变换传入的射频(RF)信号以产生编码的接收的信号;在低密度奇偶校验(LDPC)解码器中对编码的接收的信号进行解码。LDPC解码器还包括:存储器,用于存储包括R个行和C个列的奇偶校验H矩阵,其中,奇偶校验H矩阵的每个元素包括平移值或-1值之一。所述方法还包括:在能够用于执行LDPC分层解码的解码器的处理元件中,在同一循环中处理奇偶校验H矩阵的第一行和第二行。
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