[发明专利]移位寄存器有效
申请号: | 201180027363.9 | 申请日: | 2011-12-28 |
公开(公告)号: | CN103299546A | 公开(公告)日: | 2013-09-11 |
发明(设计)人: | 松井雅史 | 申请(专利权)人: | 松下电器产业株式会社 |
主分类号: | H03K19/0185 | 分类号: | H03K19/0185;G11C19/00 |
代理公司: | 北京市中咨律师事务所 11247 | 代理人: | 周春燕;段承恩 |
地址: | 日本*** | 国省代码: | 日本;JP |
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摘要: | |||
搜索关键词: | 移位寄存器 | ||
技术领域
本发明涉及移位寄存器,特别涉及可以确保水平期间以上的输出期间的移位寄存器。
背景技术
在有源矩阵型的液晶显示器和/或有机EL显示器的像素电路中,使用以非晶硅为材料的像素选择用的薄膜晶体管(Thin Film Transistor:TFT)。为了驱动该选择用TFT,在上述显示器的周边区域配置有驱动电路。该驱动电路包括用于输出使选择用TFT导通截止的驱动脉冲的逻辑装置。
选择用TFT配置于多条扫描线与多条数据线的交点。驱动电路,将通过扫描线选择的像素行的选择用TFT设为导通状态,由此从信号线向各像素写入数据信号,或者使像素发光。作为对选择像素行按每个像素行输出选择信号的驱动电路,可列举移位寄存器。在专利文献1中,公开了仅包括单极性的TFT的移位寄存器的具体电路结构。
图11A是专利文献1所记载的移位寄存器的结构框图。该图所记载的现有的移位寄存器作为液晶显示器用的扫描线选择器而使用。上述移位寄存器,对包括大致相同的电路结构的多个级进行级联,将上级的输出信号设为输入信号,将输出信号设为下级的输入信号。另外,在时钟信号发生器522上连接有3条时钟信号线,在各级上,连接有这3条时钟信号线之中的2条时钟信号线。
图11B是专利文献1所记载的移位寄存器具有的级的具体电路结构图。该图所记载的级510具备TFT516~521。上述TFT全部以相同的导电型构成。另外,图12A是专利文献1所记载的移位寄存器以2水平期间为输出期间的情况下的驱动时间图的一例。级510,通过使用时钟信号C1的引导(bootstrap)工作,对输入信号进行转换而从输出1输出输出信号。从输出1输出作为选择信号的接通电压的开始定时成为输入信号以及时钟信号C1接通的定时,结束定时成为时钟信号C1断开而时钟信号C3接通的定时。同样,在第2行的级510,从输出2输出接通电压的开始定时成为输出1信号以及时钟信号C2接通的定时,结束定时成为时钟信号C2断开而时钟信号C1接通的定时。即,在专利文献1所记载的移位寄存器中,使用具有与输入信号的接通期间相同的2水平期间的接通期间并且具有1水平期间的移位量的3个时钟信号,由此可以实现1水平期间的传送移位量并且2水平期间内的扫描线选择。
专利文献1:特表平6-505605号公报
发明内容
但是,在专利文献1所公开的现有的移位寄存器中,要维持1水平期间的传送移位量并进一步延长扫描线的选择期间,为了将扫描线的选择期间限定于时钟信号的接通期间,需要在与该选择期间相同的期间内输出接通电压的时钟信号,另外,为了确保1水平期间的传送移位量,需要增加时钟信号。
图12B是专利文献1所记载的移位寄存器以4水平期间为输出期间的情况下的驱动时间图的一例。如该图所示,例如,要维持1水平期间的传送移位量并将扫描线的选择期间确保为4水平期间,需要在与4水平期间相同的期间内输出接通电压并且具有1水平期间的移位量的5个时钟信号。
一般,在显示面板大型化的情况下,由于扫描线的布线负荷增大,所以有时会设定比水平期间长的选择TFT的导通期间。与此相对,在专利文献1所公开的现有的移位寄存器中,在将用于选择扫描线的输出期间确保得较长的情况下,需要具有该输出期间的时钟信号的设定和用于确保传送移位量的时钟信号的增加。由此,具有布线数会增加、配置驱动电路的边框面积会增大的课题。
本发明是鉴于上述的课题而实现的,其目的在于提供不使时钟信号线增加而可以确保扫描线的水平期间以上的输出期间、可以避免由该输出期间的确保引起的边框面积的增大的移位寄存器。
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