[发明专利]具有多个存储装置的系统中的状态指示无效
申请号: | 201180019962.6 | 申请日: | 2011-04-19 |
公开(公告)号: | CN102859599A | 公开(公告)日: | 2013-01-02 |
发明(设计)人: | R·舒茨;吴学俊;潘弘柏 | 申请(专利权)人: | 莫塞德技术公司 |
主分类号: | G11C7/10 | 分类号: | G11C7/10;G11C11/4096;G11C16/06 |
代理公司: | 北京泛华伟业知识产权代理有限公司 11280 | 代理人: | 王勇 |
地址: | 加拿大*** | 国省代码: | 加拿大;CA |
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摘要: | |||
搜索关键词: | 具有 存储 装置 系统 中的 状态 指示 | ||
1.一种系统,包括:
多个装置,所述多个装置中的每一个都包括状态输入引脚、状态输出引脚和单独的数据输入和输出引脚,并且所述多个装置包括:
a)多个半导体存储装置,包括至少第一个和最后一个存储装置;和
b)控制器装置,用于与半导体存储装置进行通信,和
第一个存储装置具有与控制器装置的状态输出引脚连接的状态输入引脚,第一个存储装置的状态输出引脚与处于中间的存储装置或最后一个存储装置的状态输入引脚连接,最后一个存储装置的状态输入引脚与另一个处于中间的存储装置、所述处于中间的存储装置或第一个存储装置的状态输出引脚连接,以及最后一个存储装置的状态输出引脚与控制器装置的状态输入引脚连接,从而形成状态环,并且所述多个装置中的每一个都处于状态环上,且所述状态环提供独立于任何一个半导体存储装置与所述控制器装置之间的数据通信路径之外的状态通信路径。
2.根据权利要求1所述的系统,其中至少一个半导体存储装置被配置为将状态包输出到状态环上,以提供对在所述至少一个半导体存储装置内的状态变化的指示。
3.根据权利要求2所述的系统,其中状态包包括用于识别该状态包来源于所述至少一个半导体存储装置的识别位。
4.根据权利要求1所述的系统,其中半导体存储装置中的至少一个被配置为将单选通脉冲输出到状态环上,以提供对半导体存储装置中的所述至少一个内的状态变化的指示。
5.根据权利要求1所述的系统,其中半导体存储装置中的至少一个包括至少一个用于与时钟信号的边沿同步地输出数据的数据输出引脚。
6.根据权利要求5所述的系统,还包括至少两个异步闪存存储装置,这些异步闪存存储装置与半导体存储装置中的所述至少一个连接,并且其中,半导体存储装置中的所述至少一个是桥接装置,该桥接装置被配置为与所述至少两个异步闪存存储装置中的任何一个进行异步通信。
7.根据权利要求6所述的系统,其中半导体存储装置中的至少一个被配置为将状态包输出到状态环上,以提供对半导体存储装置中的所述至少一个内的状态变化的指示。
8.根据权利要求7所述的系统,其中状态包包括用于识别该状态包来源于半导体存储装置中的所述至少一个的识别位。
9.根据权利要求6所述的系统,其中半导体存储装置中的所述至少一个被配置为将单选通脉冲输出到状态环上,以提供对存储装置中的所述至少一个内的状态变化的指示。
10.根据权利要求1到9中任何一个所述的系统,其中所述多个半导体存储装置是闪存存储装置。
11.根据权利要求1到9中任何一个所述的系统,其中所述闪存存储装置是NAND闪存存储装置。
12.一种存储装置,包括:
多个数据引脚,用于与数据总线连接;
状态引脚,用于与独立于数据总线的状态线连接;
第一电路,用于在具有第一持续时间的存储器操作完成时,生成具有比第一持续时间短得多的第二持续时间的选通脉冲,并且该选通脉冲提供该存储器操作完成的指示;和
第二电路,用于将所述选通脉冲经由状态引脚输出到状态线上。
13.根据权利要求12所述的存储装置,其中所述存储装置是桥接装置,该桥接装置被配置为与多个分立的存储装置连接。
14.根据权利要求13所述的存储装置,其中所述存储器操作是分立的存储装置之一中的存储器操作。
15.根据权利要求14所述的存储装置,其中多个分立的存储装置是闪存存储装置,并且所述存储器操作由编程、读取和擦除之一组成。
16.根据权利要求15所述的存储装置,其中所述闪存存储装置是NAND闪存存储装置。
17.根据权利要求13到16中任何一项所述的存储装置,其中所述桥接装置被配置为与以下二者进行通信:i)环形拓扑结构的系统中的控制器装置;和ii)多点子系统中的多个分立的存储装置。
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