[实用新型]一种多屏幕显示控制器有效
申请号: | 201120336895.8 | 申请日: | 2011-09-08 |
公开(公告)号: | CN202217260U | 公开(公告)日: | 2012-05-09 |
发明(设计)人: | 廖裕民 | 申请(专利权)人: | 福州瑞芯微电子有限公司 |
主分类号: | G06F3/14 | 分类号: | G06F3/14 |
代理公司: | 福州市鼓楼区京华专利事务所(普通合伙) 35212 | 代理人: | 宋连梅 |
地址: | 350000 福建省*** | 国省代码: | 福建;35 |
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摘要: | |||
搜索关键词: | 一种 屏幕 显示 控制器 | ||
【技术领域】
本实用新型涉及一种显示控制器,特别涉及一种多屏幕显示控制器。
【背景技术】
视觉是人类获取信息最重要的渠道,特别是在电子设备与用户进行人机交互时,直观的显示输出是最方便、最直观的交互方式。
随着当前显示技术和硬件水平的高速发展,用户对多屏幕同时显示的需求越来越大,有的用户需要多个屏幕联合显示一个巨大的图像以得到单个屏幕不能到达的清晰度;有的用户需要手持设备在连接电视或者电脑等终端时可以在手持设备和电视、电脑上同时显示不同的内容。总之,现在用户对单一设备需要支持多屏幕同时显示不同内容的需求越来越大。
而现有的技术中,如果需要支持多个屏幕显示,通常需要设计多个显示控制器,但是如果实际应用中没有用到设计支持的最大屏幕数量时,没有被用到的屏幕显示控制器都被闲置,造成资源的浪费。
【发明内容】
本实用新型要解决的技术问题,在于提供一种多屏幕显示控制器,其实现了多屏幕显示,且可根据需要灵活配置每个屏幕需要的图层数,将所有可用资源进行复用,达到效率最大化。
本实用新型是这样实现的:一种多屏幕显示控制器,包括一CPU、一存储器、复数个屏幕、一显示控制器,所述显示控制器包括一控制信息处理模块、一数据读取控制电路、一图层缓存阵列、一图层通路选择器、m个图层叠加处理模块,所述m为任意自然数;所述CPU与控制信息处理模块连接,所述存储器、数据读取控制电路、图层缓存阵列、图层通路选择器顺次连接;所述图层通路选择器分别与m个图层叠加处理模块相连,所述每个图层叠加处理模块分别连接一屏幕。
进一步地,所述图层缓存阵列包括n个图层缓存区,所述n为任意自然数;所述图层通路选择器包括与所述m个图层叠加处理模块一一对应连接的m组通路开关组,所述每一组通路开关组包括n个通路开关,所述每一个通路开关均分别对应连接一图层缓存区和一图层叠加处理模块。
本实用新型可以支持多个屏幕同时显示不同的内容,又能在实际应用中没有用到设计最大屏幕数时,将所有可用资源进行复用,达到效率的最大化。在多屏幕显示时,可以根据需要灵活配置每个屏幕需要的图层数,每个图层叠加处理模块最多可以处理全部图层的缓存资源。
【附图说明】
下面参照附图结合实施例对本实用新型作进一步的说明。
图1是本实用新型的结构示意图。
图2是本实用新型中图层通路选择器的结构示意图。
图3是本实用新型实施例1的结构示意图。
图4是本实用新型实施例2的结构示意图。
图5是本实用新型实施例3的结构示意图。
【具体实施方式】
如图1至图2所示,一种多屏幕显示控制器,包括CPU、存储器1、一显示控制器2、第一屏幕至第m屏幕,所述m为任意自然数,所述显示控制器2包括一控制信息处理模块21、一数据读取控制电路22、一图层缓存阵列23、一图层通路选择器24、m个图层叠加处理模块25,所述m为任意自然数;所述CPU与控制信息处理模块21连接,所述存储器1、数据读取控制电路22、图层缓存阵列23、图层通路选择器24顺次连接。所述图层通路选择器24分别与m个图层叠加处理模块25相连。所述每个图层叠加处理模块25分别和一屏幕相连。
如图2所示,所述图层缓存阵列23包括n个图层缓存区231,所述n为任意自然数;所述图层通路选择器24包括与所述m个图层叠加处理模块25一一对应连接的m组通路开关组241,所述每一组通路开关组241包括n个通路开关2411,所述每一个通路开关2411均分别对应连接一图层缓存区231和一图层叠加处理模块25。
所述CPU,负责对所述显示控制器2进行配置,配置的信息包括:需要支持的屏幕的个数,每个屏幕的大小和控制时序信息,每个屏幕所需要使用的图层缓存阵列23中的图层缓存区231、每个图层在存储器1中的地址。
所述存储器1,负责存储待显示的图像数据。
所述显示控制器2中的控制信息处理模块21,负责接收并存储CPU的配置信息,并将该配置信息传递到各个内部单元。
所述数据读取控制电路22,负责从存储器1读取所有图层的数据,并将数据存储到图层缓存阵列23里对应的图层缓存区231中,每个图层缓存区231存储一个图层数的数据。
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