[实用新型]一种可自复位的DRAM有效

专利信息
申请号: 201120086331.3 申请日: 2011-03-29
公开(公告)号: CN202008842U 公开(公告)日: 2011-10-12
发明(设计)人: 余作明 申请(专利权)人: 山东华芯半导体有限公司
主分类号: G11C16/02 分类号: G11C16/02;G11C16/20
代理公司: 西安智邦专利商标代理有限公司 61211 代理人: 徐平;王少文
地址: 250101 山东省济南市高*** 国省代码: 山东;37
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摘要:
搜索关键词: 一种 复位 dram
【权利要求书】:

1.一种可自复位的DRAM,包括DRAM,其特征在于:还包括内置的关门狗电路,所述关门狗电路的输出端接DRAM的复位端或上电复位端。

2.根据权利要求1所述的可自复位的DRAM,其特征在于:所述关门狗电路包括接口单元和计数器单元;所述计数器单元的输入端接时钟信号;所述接口单元包括“无异常情况”接口、“无非法指令”接口或“指定指令”接口,所述接口单元的输出端与计数器单元的复位端相连,所述计数器单元的输出端与DRAM的复位端或上电复位端相连。

3.根据权利要求1所述的可自复位的DRAM,其特征在于:所述关门狗电路包括接口单元和计数器单元;所述计数器单元的输入端接时钟信号;所述接口单元包括“无异常情况”接口、“无非法指令”接口或“指定指令”接口中的两种或三种,所述接口单元的输出端通过“与”门后与计数器单元的复位端相连,所述计数器单元的输出端与DRAM的复位端或上电复位端相连。

4.根据权利要求2或3所述的可自复位的DRAM,其特征在于:还包括内置的时钟单元,所述时钟单元的输出端接计数器单元的输入端;所述计数器单元的输出端与内存控制器的反馈信号输入端相连。

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