[发明专利]一种改进的DMA通信方法及装置有效
申请号: | 201110443550.7 | 申请日: | 2011-12-26 |
公开(公告)号: | CN103176931A | 公开(公告)日: | 2013-06-26 |
发明(设计)人: | 冷永春;胡胜发 | 申请(专利权)人: | 安凯(广州)微电子技术有限公司 |
主分类号: | G06F13/28 | 分类号: | G06F13/28 |
代理公司: | 深圳中一专利商标事务所 44237 | 代理人: | 张全文 |
地址: | 510663 广东省广州市*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 一种 改进 dma 通信 方法 装置 | ||
1.一种改进的DMA通信方法,该方法用于受一DMA控制器控制的主设备和从设备之间的数据传输,所述数据传输基于一同步时钟实现,其特征在于,所述DMA通信方法包括下述步骤:
在所述同步时钟的每个时钟触发沿时刻监测所述的数据请求信号是否有效;
若在某个时钟触发沿时刻数据请求信号有效,则主设备开始更新传输数据,且在该时钟触发沿的下个时钟触发沿时刻,主设备将已完成更新后的有效传输数据保存在寄存器中;以及
所述有效的传输数据在DMA总线上传输一定时间后到达从设备,在主设备开始更新传输数据后的第二个时钟触发沿时刻,从设备开始采集所述有效传输数据。
2.如权利要求1所述的一种改进的DMA通信方法,其特征在于,所述主设备开始更新传输数据到传输数据更新完成所需的时间和所述有效数据在DMA总线上的传输时间均小于或等于所述同步时钟的时钟周期。
3.如权利要求1所述的一种改进的DMA通信方法,其特征在于,在所述同步时钟的每个时钟触发沿时刻监测所述的数据请求信号是否有效的步骤之前还包括下述步骤:
DMA控制器从CPU处获得总线控制权。
4.如权利要求3所述的一种改进的DMA通信方法,其特征在于,所述DMA控制器从CPU处获得总线控制权的实现步骤如下:
已准备就绪的从设备向DMA控制器发送数据请求信号;
DMA控制器接收到数据请求信号后,向CPU发出总线请求信号;
CPU接收到总线请求信号后若允许主从设备间的数据传输,则在当前总线周期结束后,释放总线控制权,并向DMA控制器发出已交出总线控制权的反馈信号。
5.如权利要求1至4所述的任一种改进的DMA通信方法,其特征在于,所述的时钟触发沿为时钟上升沿或时钟下降沿。
6.如权利要求1至4所述的方法,其特征在于,所述的主设备为存储器,所述的从设备为IO外设或从存储器。
7.如权利要求1至4所述的任一种改进的DMA通信方法,其特征在于,所述的数据请求信号有效是数据请求信号高电平有效。
8.一种改进的DMA通信装置,所述通信装置包括:相互进行数据传输的主设备和从设备以及控制所述主设备、从设备数据传输的DMA控制器,所述DMA控制器连接有一同步时钟,其特征在于,所述的DMA控制器包括:
信号监测模块,用于在所述同步时钟的每个时钟触发沿时刻监测所述的数据请求信号是否有效;
数据暂存模块,用于若在某个时钟触发沿时刻数据请求信号有效,则主设备开始更新传输数据,且在该时钟触发沿的下个时钟触发沿时刻,主设备将已完成更新后的有效传输数据保存在寄存器中;以及
数据操作模块,用于所述有效的传输数据在DMA总线上传输一定时间后到达从设备,在主设备开始更新传输数据后的第二个时钟触发沿时刻,从设备开始采集所述有效传输数据。
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